drm: Check for invalid cursor flags
[linux-2.6.git] / include / drm / nouveau_drm.h
1 /*
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22  * OTHER DEALINGS IN THE SOFTWARE.
23  */
24
25 #ifndef __NOUVEAU_DRM_H__
26 #define __NOUVEAU_DRM_H__
27
28 #define NOUVEAU_DRM_HEADER_PATCHLEVEL 16
29
30 struct drm_nouveau_channel_alloc {
31         uint32_t     fb_ctxdma_handle;
32         uint32_t     tt_ctxdma_handle;
33
34         int          channel;
35         uint32_t     pushbuf_domains;
36
37         /* Notifier memory */
38         uint32_t     notifier_handle;
39
40         /* DRM-enforced subchannel assignments */
41         struct {
42                 uint32_t handle;
43                 uint32_t grclass;
44         } subchan[8];
45         uint32_t nr_subchan;
46 };
47
48 struct drm_nouveau_channel_free {
49         int channel;
50 };
51
52 struct drm_nouveau_grobj_alloc {
53         int      channel;
54         uint32_t handle;
55         int      class;
56 };
57
58 struct drm_nouveau_notifierobj_alloc {
59         uint32_t channel;
60         uint32_t handle;
61         uint32_t size;
62         uint32_t offset;
63 };
64
65 struct drm_nouveau_gpuobj_free {
66         int      channel;
67         uint32_t handle;
68 };
69
70 /* FIXME : maybe unify {GET,SET}PARAMs */
71 #define NOUVEAU_GETPARAM_PCI_VENDOR      3
72 #define NOUVEAU_GETPARAM_PCI_DEVICE      4
73 #define NOUVEAU_GETPARAM_BUS_TYPE        5
74 #define NOUVEAU_GETPARAM_FB_SIZE         8
75 #define NOUVEAU_GETPARAM_AGP_SIZE        9
76 #define NOUVEAU_GETPARAM_CHIPSET_ID      11
77 #define NOUVEAU_GETPARAM_VM_VRAM_BASE    12
78 #define NOUVEAU_GETPARAM_GRAPH_UNITS     13
79 #define NOUVEAU_GETPARAM_PTIMER_TIME     14
80 #define NOUVEAU_GETPARAM_HAS_BO_USAGE    15
81 #define NOUVEAU_GETPARAM_HAS_PAGEFLIP    16
82 struct drm_nouveau_getparam {
83         uint64_t param;
84         uint64_t value;
85 };
86
87 struct drm_nouveau_setparam {
88         uint64_t param;
89         uint64_t value;
90 };
91
92 #define NOUVEAU_GEM_DOMAIN_CPU       (1 << 0)
93 #define NOUVEAU_GEM_DOMAIN_VRAM      (1 << 1)
94 #define NOUVEAU_GEM_DOMAIN_GART      (1 << 2)
95 #define NOUVEAU_GEM_DOMAIN_MAPPABLE  (1 << 3)
96
97 #define NOUVEAU_GEM_TILE_COMP        0x00030000 /* nv50-only */
98 #define NOUVEAU_GEM_TILE_LAYOUT_MASK 0x0000ff00
99 #define NOUVEAU_GEM_TILE_16BPP       0x00000001
100 #define NOUVEAU_GEM_TILE_32BPP       0x00000002
101 #define NOUVEAU_GEM_TILE_ZETA        0x00000004
102 #define NOUVEAU_GEM_TILE_NONCONTIG   0x00000008
103
104 struct drm_nouveau_gem_info {
105         uint32_t handle;
106         uint32_t domain;
107         uint64_t size;
108         uint64_t offset;
109         uint64_t map_handle;
110         uint32_t tile_mode;
111         uint32_t tile_flags;
112 };
113
114 struct drm_nouveau_gem_new {
115         struct drm_nouveau_gem_info info;
116         uint32_t channel_hint;
117         uint32_t align;
118 };
119
120 #define NOUVEAU_GEM_MAX_BUFFERS 1024
121 struct drm_nouveau_gem_pushbuf_bo_presumed {
122         uint32_t valid;
123         uint32_t domain;
124         uint64_t offset;
125 };
126
127 struct drm_nouveau_gem_pushbuf_bo {
128         uint64_t user_priv;
129         uint32_t handle;
130         uint32_t read_domains;
131         uint32_t write_domains;
132         uint32_t valid_domains;
133         struct drm_nouveau_gem_pushbuf_bo_presumed presumed;
134 };
135
136 #define NOUVEAU_GEM_RELOC_LOW  (1 << 0)
137 #define NOUVEAU_GEM_RELOC_HIGH (1 << 1)
138 #define NOUVEAU_GEM_RELOC_OR   (1 << 2)
139 #define NOUVEAU_GEM_MAX_RELOCS 1024
140 struct drm_nouveau_gem_pushbuf_reloc {
141         uint32_t reloc_bo_index;
142         uint32_t reloc_bo_offset;
143         uint32_t bo_index;
144         uint32_t flags;
145         uint32_t data;
146         uint32_t vor;
147         uint32_t tor;
148 };
149
150 #define NOUVEAU_GEM_MAX_PUSH 512
151 struct drm_nouveau_gem_pushbuf_push {
152         uint32_t bo_index;
153         uint32_t pad;
154         uint64_t offset;
155         uint64_t length;
156 };
157
158 struct drm_nouveau_gem_pushbuf {
159         uint32_t channel;
160         uint32_t nr_buffers;
161         uint64_t buffers;
162         uint32_t nr_relocs;
163         uint32_t nr_push;
164         uint64_t relocs;
165         uint64_t push;
166         uint32_t suffix0;
167         uint32_t suffix1;
168         uint64_t vram_available;
169         uint64_t gart_available;
170 };
171
172 #define NOUVEAU_GEM_CPU_PREP_NOWAIT                                  0x00000001
173 #define NOUVEAU_GEM_CPU_PREP_WRITE                                   0x00000004
174 struct drm_nouveau_gem_cpu_prep {
175         uint32_t handle;
176         uint32_t flags;
177 };
178
179 struct drm_nouveau_gem_cpu_fini {
180         uint32_t handle;
181 };
182
183 enum nouveau_bus_type {
184         NV_AGP     = 0,
185         NV_PCI     = 1,
186         NV_PCIE    = 2,
187 };
188
189 struct drm_nouveau_sarea {
190 };
191
192 #define DRM_NOUVEAU_GETPARAM           0x00
193 #define DRM_NOUVEAU_SETPARAM           0x01
194 #define DRM_NOUVEAU_CHANNEL_ALLOC      0x02
195 #define DRM_NOUVEAU_CHANNEL_FREE       0x03
196 #define DRM_NOUVEAU_GROBJ_ALLOC        0x04
197 #define DRM_NOUVEAU_NOTIFIEROBJ_ALLOC  0x05
198 #define DRM_NOUVEAU_GPUOBJ_FREE        0x06
199 #define DRM_NOUVEAU_GEM_NEW            0x40
200 #define DRM_NOUVEAU_GEM_PUSHBUF        0x41
201 #define DRM_NOUVEAU_GEM_CPU_PREP       0x42
202 #define DRM_NOUVEAU_GEM_CPU_FINI       0x43
203 #define DRM_NOUVEAU_GEM_INFO           0x44
204
205 #define DRM_IOCTL_NOUVEAU_GETPARAM           DRM_IOWR(DRM_COMMAND_BASE + DRM_NOUVEAU_GETPARAM, struct drm_nouveau_getparam)
206 #define DRM_IOCTL_NOUVEAU_SETPARAM           DRM_IOWR(DRM_COMMAND_BASE + DRM_NOUVEAU_SETPARAM, struct drm_nouveau_setparam)
207 #define DRM_IOCTL_NOUVEAU_CHANNEL_ALLOC      DRM_IOWR(DRM_COMMAND_BASE + DRM_NOUVEAU_CHANNEL_ALLOC, struct drm_nouveau_channel_alloc)
208 #define DRM_IOCTL_NOUVEAU_CHANNEL_FREE       DRM_IOW (DRM_COMMAND_BASE + DRM_NOUVEAU_CHANNEL_FREE, struct drm_nouveau_channel_free)
209 #define DRM_IOCTL_NOUVEAU_GROBJ_ALLOC        DRM_IOW (DRM_COMMAND_BASE + DRM_NOUVEAU_GROBJ_ALLOC, struct drm_nouveau_grobj_alloc)
210 #define DRM_IOCTL_NOUVEAU_NOTIFIEROBJ_ALLOC  DRM_IOWR(DRM_COMMAND_BASE + DRM_NOUVEAU_NOTIFIEROBJ_ALLOC, struct drm_nouveau_notifierobj_alloc)
211 #define DRM_IOCTL_NOUVEAU_GPUOBJ_FREE        DRM_IOW (DRM_COMMAND_BASE + DRM_NOUVEAU_GPUOBJ_FREE, struct drm_nouveau_gpuobj_free)
212 #define DRM_IOCTL_NOUVEAU_GEM_NEW            DRM_IOWR(DRM_COMMAND_BASE + DRM_NOUVEAU_GEM_NEW, struct drm_nouveau_gem_new)
213 #define DRM_IOCTL_NOUVEAU_GEM_PUSHBUF        DRM_IOWR(DRM_COMMAND_BASE + DRM_NOUVEAU_GEM_PUSHBUF, struct drm_nouveau_gem_pushbuf)
214 #define DRM_IOCTL_NOUVEAU_GEM_CPU_PREP       DRM_IOW (DRM_COMMAND_BASE + DRM_NOUVEAU_GEM_CPU_PREP, struct drm_nouveau_gem_cpu_prep)
215 #define DRM_IOCTL_NOUVEAU_GEM_CPU_FINI       DRM_IOW (DRM_COMMAND_BASE + DRM_NOUVEAU_GEM_CPU_FINI, struct drm_nouveau_gem_cpu_fini)
216 #define DRM_IOCTL_NOUVEAU_GEM_INFO           DRM_IOWR(DRM_COMMAND_BASE + DRM_NOUVEAU_GEM_INFO, struct drm_nouveau_gem_info)
217
218 #endif /* __NOUVEAU_DRM_H__ */