7b80cebffd41b02c607e14db76e7f4b57d4f7c09
[linux-2.6.git] / drivers / net / wireless / ath / ath5k / base.c
1 /*-
2  * Copyright (c) 2002-2005 Sam Leffler, Errno Consulting
3  * Copyright (c) 2004-2005 Atheros Communications, Inc.
4  * Copyright (c) 2006 Devicescape Software, Inc.
5  * Copyright (c) 2007 Jiri Slaby <jirislaby@gmail.com>
6  * Copyright (c) 2007 Luis R. Rodriguez <mcgrof@winlab.rutgers.edu>
7  *
8  * All rights reserved.
9  *
10  * Redistribution and use in source and binary forms, with or without
11  * modification, are permitted provided that the following conditions
12  * are met:
13  * 1. Redistributions of source code must retain the above copyright
14  *    notice, this list of conditions and the following disclaimer,
15  *    without modification.
16  * 2. Redistributions in binary form must reproduce at minimum a disclaimer
17  *    similar to the "NO WARRANTY" disclaimer below ("Disclaimer") and any
18  *    redistribution must be conditioned upon including a substantially
19  *    similar Disclaimer requirement for further binary redistribution.
20  * 3. Neither the names of the above-listed copyright holders nor the names
21  *    of any contributors may be used to endorse or promote products derived
22  *    from this software without specific prior written permission.
23  *
24  * Alternatively, this software may be distributed under the terms of the
25  * GNU General Public License ("GPL") version 2 as published by the Free
26  * Software Foundation.
27  *
28  * NO WARRANTY
29  * THIS SOFTWARE IS PROVIDED BY THE COPYRIGHT HOLDERS AND CONTRIBUTORS
30  * ``AS IS'' AND ANY EXPRESS OR IMPLIED WARRANTIES, INCLUDING, BUT NOT
31  * LIMITED TO, THE IMPLIED WARRANTIES OF NONINFRINGEMENT, MERCHANTIBILITY
32  * AND FITNESS FOR A PARTICULAR PURPOSE ARE DISCLAIMED. IN NO EVENT SHALL
33  * THE COPYRIGHT HOLDERS OR CONTRIBUTORS BE LIABLE FOR SPECIAL, EXEMPLARY,
34  * OR CONSEQUENTIAL DAMAGES (INCLUDING, BUT NOT LIMITED TO, PROCUREMENT OF
35  * SUBSTITUTE GOODS OR SERVICES; LOSS OF USE, DATA, OR PROFITS; OR BUSINESS
36  * INTERRUPTION) HOWEVER CAUSED AND ON ANY THEORY OF LIABILITY, WHETHER
37  * IN CONTRACT, STRICT LIABILITY, OR TORT (INCLUDING NEGLIGENCE OR OTHERWISE)
38  * ARISING IN ANY WAY OUT OF THE USE OF THIS SOFTWARE, EVEN IF ADVISED OF
39  * THE POSSIBILITY OF SUCH DAMAGES.
40  *
41  */
42
43 #include <linux/module.h>
44 #include <linux/delay.h>
45 #include <linux/hardirq.h>
46 #include <linux/if.h>
47 #include <linux/io.h>
48 #include <linux/netdevice.h>
49 #include <linux/cache.h>
50 #include <linux/pci.h>
51 #include <linux/ethtool.h>
52 #include <linux/uaccess.h>
53
54 #include <net/ieee80211_radiotap.h>
55
56 #include <asm/unaligned.h>
57
58 #include "base.h"
59 #include "reg.h"
60 #include "debug.h"
61
62 static int ath5k_calinterval = 10; /* Calibrate PHY every 10 secs (TODO: Fixme) */
63 static int modparam_nohwcrypt;
64 module_param_named(nohwcrypt, modparam_nohwcrypt, bool, S_IRUGO);
65 MODULE_PARM_DESC(nohwcrypt, "Disable hardware encryption.");
66
67 static int modparam_all_channels;
68 module_param_named(all_channels, modparam_all_channels, bool, S_IRUGO);
69 MODULE_PARM_DESC(all_channels, "Expose all channels the device can use.");
70
71
72 /******************\
73 * Internal defines *
74 \******************/
75
76 /* Module info */
77 MODULE_AUTHOR("Jiri Slaby");
78 MODULE_AUTHOR("Nick Kossifidis");
79 MODULE_DESCRIPTION("Support for 5xxx series of Atheros 802.11 wireless LAN cards.");
80 MODULE_SUPPORTED_DEVICE("Atheros 5xxx WLAN cards");
81 MODULE_LICENSE("Dual BSD/GPL");
82 MODULE_VERSION("0.6.0 (EXPERIMENTAL)");
83
84
85 /* Known PCI ids */
86 static const struct pci_device_id ath5k_pci_id_table[] = {
87         { PCI_VDEVICE(ATHEROS, 0x0207), .driver_data = AR5K_AR5210 }, /* 5210 early */
88         { PCI_VDEVICE(ATHEROS, 0x0007), .driver_data = AR5K_AR5210 }, /* 5210 */
89         { PCI_VDEVICE(ATHEROS, 0x0011), .driver_data = AR5K_AR5211 }, /* 5311 - this is on AHB bus !*/
90         { PCI_VDEVICE(ATHEROS, 0x0012), .driver_data = AR5K_AR5211 }, /* 5211 */
91         { PCI_VDEVICE(ATHEROS, 0x0013), .driver_data = AR5K_AR5212 }, /* 5212 */
92         { PCI_VDEVICE(3COM_2,  0x0013), .driver_data = AR5K_AR5212 }, /* 3com 5212 */
93         { PCI_VDEVICE(3COM,    0x0013), .driver_data = AR5K_AR5212 }, /* 3com 3CRDAG675 5212 */
94         { PCI_VDEVICE(ATHEROS, 0x1014), .driver_data = AR5K_AR5212 }, /* IBM minipci 5212 */
95         { PCI_VDEVICE(ATHEROS, 0x0014), .driver_data = AR5K_AR5212 }, /* 5212 combatible */
96         { PCI_VDEVICE(ATHEROS, 0x0015), .driver_data = AR5K_AR5212 }, /* 5212 combatible */
97         { PCI_VDEVICE(ATHEROS, 0x0016), .driver_data = AR5K_AR5212 }, /* 5212 combatible */
98         { PCI_VDEVICE(ATHEROS, 0x0017), .driver_data = AR5K_AR5212 }, /* 5212 combatible */
99         { PCI_VDEVICE(ATHEROS, 0x0018), .driver_data = AR5K_AR5212 }, /* 5212 combatible */
100         { PCI_VDEVICE(ATHEROS, 0x0019), .driver_data = AR5K_AR5212 }, /* 5212 combatible */
101         { PCI_VDEVICE(ATHEROS, 0x001a), .driver_data = AR5K_AR5212 }, /* 2413 Griffin-lite */
102         { PCI_VDEVICE(ATHEROS, 0x001b), .driver_data = AR5K_AR5212 }, /* 5413 Eagle */
103         { PCI_VDEVICE(ATHEROS, 0x001c), .driver_data = AR5K_AR5212 }, /* PCI-E cards */
104         { PCI_VDEVICE(ATHEROS, 0x001d), .driver_data = AR5K_AR5212 }, /* 2417 Nala */
105         { 0 }
106 };
107 MODULE_DEVICE_TABLE(pci, ath5k_pci_id_table);
108
109 /* Known SREVs */
110 static const struct ath5k_srev_name srev_names[] = {
111         { "5210",       AR5K_VERSION_MAC,       AR5K_SREV_AR5210 },
112         { "5311",       AR5K_VERSION_MAC,       AR5K_SREV_AR5311 },
113         { "5311A",      AR5K_VERSION_MAC,       AR5K_SREV_AR5311A },
114         { "5311B",      AR5K_VERSION_MAC,       AR5K_SREV_AR5311B },
115         { "5211",       AR5K_VERSION_MAC,       AR5K_SREV_AR5211 },
116         { "5212",       AR5K_VERSION_MAC,       AR5K_SREV_AR5212 },
117         { "5213",       AR5K_VERSION_MAC,       AR5K_SREV_AR5213 },
118         { "5213A",      AR5K_VERSION_MAC,       AR5K_SREV_AR5213A },
119         { "2413",       AR5K_VERSION_MAC,       AR5K_SREV_AR2413 },
120         { "2414",       AR5K_VERSION_MAC,       AR5K_SREV_AR2414 },
121         { "5424",       AR5K_VERSION_MAC,       AR5K_SREV_AR5424 },
122         { "5413",       AR5K_VERSION_MAC,       AR5K_SREV_AR5413 },
123         { "5414",       AR5K_VERSION_MAC,       AR5K_SREV_AR5414 },
124         { "2415",       AR5K_VERSION_MAC,       AR5K_SREV_AR2415 },
125         { "5416",       AR5K_VERSION_MAC,       AR5K_SREV_AR5416 },
126         { "5418",       AR5K_VERSION_MAC,       AR5K_SREV_AR5418 },
127         { "2425",       AR5K_VERSION_MAC,       AR5K_SREV_AR2425 },
128         { "2417",       AR5K_VERSION_MAC,       AR5K_SREV_AR2417 },
129         { "xxxxx",      AR5K_VERSION_MAC,       AR5K_SREV_UNKNOWN },
130         { "5110",       AR5K_VERSION_RAD,       AR5K_SREV_RAD_5110 },
131         { "5111",       AR5K_VERSION_RAD,       AR5K_SREV_RAD_5111 },
132         { "5111A",      AR5K_VERSION_RAD,       AR5K_SREV_RAD_5111A },
133         { "2111",       AR5K_VERSION_RAD,       AR5K_SREV_RAD_2111 },
134         { "5112",       AR5K_VERSION_RAD,       AR5K_SREV_RAD_5112 },
135         { "5112A",      AR5K_VERSION_RAD,       AR5K_SREV_RAD_5112A },
136         { "5112B",      AR5K_VERSION_RAD,       AR5K_SREV_RAD_5112B },
137         { "2112",       AR5K_VERSION_RAD,       AR5K_SREV_RAD_2112 },
138         { "2112A",      AR5K_VERSION_RAD,       AR5K_SREV_RAD_2112A },
139         { "2112B",      AR5K_VERSION_RAD,       AR5K_SREV_RAD_2112B },
140         { "2413",       AR5K_VERSION_RAD,       AR5K_SREV_RAD_2413 },
141         { "5413",       AR5K_VERSION_RAD,       AR5K_SREV_RAD_5413 },
142         { "2316",       AR5K_VERSION_RAD,       AR5K_SREV_RAD_2316 },
143         { "2317",       AR5K_VERSION_RAD,       AR5K_SREV_RAD_2317 },
144         { "5424",       AR5K_VERSION_RAD,       AR5K_SREV_RAD_5424 },
145         { "5133",       AR5K_VERSION_RAD,       AR5K_SREV_RAD_5133 },
146         { "xxxxx",      AR5K_VERSION_RAD,       AR5K_SREV_UNKNOWN },
147 };
148
149 static const struct ieee80211_rate ath5k_rates[] = {
150         { .bitrate = 10,
151           .hw_value = ATH5K_RATE_CODE_1M, },
152         { .bitrate = 20,
153           .hw_value = ATH5K_RATE_CODE_2M,
154           .hw_value_short = ATH5K_RATE_CODE_2M | AR5K_SET_SHORT_PREAMBLE,
155           .flags = IEEE80211_RATE_SHORT_PREAMBLE },
156         { .bitrate = 55,
157           .hw_value = ATH5K_RATE_CODE_5_5M,
158           .hw_value_short = ATH5K_RATE_CODE_5_5M | AR5K_SET_SHORT_PREAMBLE,
159           .flags = IEEE80211_RATE_SHORT_PREAMBLE },
160         { .bitrate = 110,
161           .hw_value = ATH5K_RATE_CODE_11M,
162           .hw_value_short = ATH5K_RATE_CODE_11M | AR5K_SET_SHORT_PREAMBLE,
163           .flags = IEEE80211_RATE_SHORT_PREAMBLE },
164         { .bitrate = 60,
165           .hw_value = ATH5K_RATE_CODE_6M,
166           .flags = 0 },
167         { .bitrate = 90,
168           .hw_value = ATH5K_RATE_CODE_9M,
169           .flags = 0 },
170         { .bitrate = 120,
171           .hw_value = ATH5K_RATE_CODE_12M,
172           .flags = 0 },
173         { .bitrate = 180,
174           .hw_value = ATH5K_RATE_CODE_18M,
175           .flags = 0 },
176         { .bitrate = 240,
177           .hw_value = ATH5K_RATE_CODE_24M,
178           .flags = 0 },
179         { .bitrate = 360,
180           .hw_value = ATH5K_RATE_CODE_36M,
181           .flags = 0 },
182         { .bitrate = 480,
183           .hw_value = ATH5K_RATE_CODE_48M,
184           .flags = 0 },
185         { .bitrate = 540,
186           .hw_value = ATH5K_RATE_CODE_54M,
187           .flags = 0 },
188         /* XR missing */
189 };
190
191 /*
192  * Prototypes - PCI stack related functions
193  */
194 static int __devinit    ath5k_pci_probe(struct pci_dev *pdev,
195                                 const struct pci_device_id *id);
196 static void __devexit   ath5k_pci_remove(struct pci_dev *pdev);
197 #ifdef CONFIG_PM
198 static int              ath5k_pci_suspend(struct pci_dev *pdev,
199                                         pm_message_t state);
200 static int              ath5k_pci_resume(struct pci_dev *pdev);
201 #else
202 #define ath5k_pci_suspend NULL
203 #define ath5k_pci_resume NULL
204 #endif /* CONFIG_PM */
205
206 static struct pci_driver ath5k_pci_driver = {
207         .name           = KBUILD_MODNAME,
208         .id_table       = ath5k_pci_id_table,
209         .probe          = ath5k_pci_probe,
210         .remove         = __devexit_p(ath5k_pci_remove),
211         .suspend        = ath5k_pci_suspend,
212         .resume         = ath5k_pci_resume,
213 };
214
215
216
217 /*
218  * Prototypes - MAC 802.11 stack related functions
219  */
220 static int ath5k_tx(struct ieee80211_hw *hw, struct sk_buff *skb);
221 static int ath5k_reset(struct ath5k_softc *sc, bool stop, bool change_channel);
222 static int ath5k_reset_wake(struct ath5k_softc *sc);
223 static int ath5k_start(struct ieee80211_hw *hw);
224 static void ath5k_stop(struct ieee80211_hw *hw);
225 static int ath5k_add_interface(struct ieee80211_hw *hw,
226                 struct ieee80211_if_init_conf *conf);
227 static void ath5k_remove_interface(struct ieee80211_hw *hw,
228                 struct ieee80211_if_init_conf *conf);
229 static int ath5k_config(struct ieee80211_hw *hw, u32 changed);
230 static void ath5k_configure_filter(struct ieee80211_hw *hw,
231                 unsigned int changed_flags,
232                 unsigned int *new_flags,
233                 int mc_count, struct dev_mc_list *mclist);
234 static int ath5k_set_key(struct ieee80211_hw *hw,
235                 enum set_key_cmd cmd,
236                 struct ieee80211_vif *vif, struct ieee80211_sta *sta,
237                 struct ieee80211_key_conf *key);
238 static int ath5k_get_stats(struct ieee80211_hw *hw,
239                 struct ieee80211_low_level_stats *stats);
240 static int ath5k_get_tx_stats(struct ieee80211_hw *hw,
241                 struct ieee80211_tx_queue_stats *stats);
242 static u64 ath5k_get_tsf(struct ieee80211_hw *hw);
243 static void ath5k_set_tsf(struct ieee80211_hw *hw, u64 tsf);
244 static void ath5k_reset_tsf(struct ieee80211_hw *hw);
245 static int ath5k_beacon_update(struct ath5k_softc *sc,
246                 struct sk_buff *skb);
247 static void ath5k_bss_info_changed(struct ieee80211_hw *hw,
248                 struct ieee80211_vif *vif,
249                 struct ieee80211_bss_conf *bss_conf,
250                 u32 changes);
251
252 static const struct ieee80211_ops ath5k_hw_ops = {
253         .tx             = ath5k_tx,
254         .start          = ath5k_start,
255         .stop           = ath5k_stop,
256         .add_interface  = ath5k_add_interface,
257         .remove_interface = ath5k_remove_interface,
258         .config         = ath5k_config,
259         .configure_filter = ath5k_configure_filter,
260         .set_key        = ath5k_set_key,
261         .get_stats      = ath5k_get_stats,
262         .conf_tx        = NULL,
263         .get_tx_stats   = ath5k_get_tx_stats,
264         .get_tsf        = ath5k_get_tsf,
265         .set_tsf        = ath5k_set_tsf,
266         .reset_tsf      = ath5k_reset_tsf,
267         .bss_info_changed = ath5k_bss_info_changed,
268 };
269
270 /*
271  * Prototypes - Internal functions
272  */
273 /* Attach detach */
274 static int      ath5k_attach(struct pci_dev *pdev,
275                         struct ieee80211_hw *hw);
276 static void     ath5k_detach(struct pci_dev *pdev,
277                         struct ieee80211_hw *hw);
278 /* Channel/mode setup */
279 static inline short ath5k_ieee2mhz(short chan);
280 static unsigned int ath5k_copy_channels(struct ath5k_hw *ah,
281                                 struct ieee80211_channel *channels,
282                                 unsigned int mode,
283                                 unsigned int max);
284 static int      ath5k_setup_bands(struct ieee80211_hw *hw);
285 static int      ath5k_chan_set(struct ath5k_softc *sc,
286                                 struct ieee80211_channel *chan);
287 static void     ath5k_setcurmode(struct ath5k_softc *sc,
288                                 unsigned int mode);
289 static void     ath5k_mode_setup(struct ath5k_softc *sc);
290
291 /* Descriptor setup */
292 static int      ath5k_desc_alloc(struct ath5k_softc *sc,
293                                 struct pci_dev *pdev);
294 static void     ath5k_desc_free(struct ath5k_softc *sc,
295                                 struct pci_dev *pdev);
296 /* Buffers setup */
297 static int      ath5k_rxbuf_setup(struct ath5k_softc *sc,
298                                 struct ath5k_buf *bf);
299 static int      ath5k_txbuf_setup(struct ath5k_softc *sc,
300                                 struct ath5k_buf *bf);
301 static inline void ath5k_txbuf_free(struct ath5k_softc *sc,
302                                 struct ath5k_buf *bf)
303 {
304         BUG_ON(!bf);
305         if (!bf->skb)
306                 return;
307         pci_unmap_single(sc->pdev, bf->skbaddr, bf->skb->len,
308                         PCI_DMA_TODEVICE);
309         dev_kfree_skb_any(bf->skb);
310         bf->skb = NULL;
311 }
312
313 static inline void ath5k_rxbuf_free(struct ath5k_softc *sc,
314                                 struct ath5k_buf *bf)
315 {
316         BUG_ON(!bf);
317         if (!bf->skb)
318                 return;
319         pci_unmap_single(sc->pdev, bf->skbaddr, sc->rxbufsize,
320                         PCI_DMA_FROMDEVICE);
321         dev_kfree_skb_any(bf->skb);
322         bf->skb = NULL;
323 }
324
325
326 /* Queues setup */
327 static struct   ath5k_txq *ath5k_txq_setup(struct ath5k_softc *sc,
328                                 int qtype, int subtype);
329 static int      ath5k_beaconq_setup(struct ath5k_hw *ah);
330 static int      ath5k_beaconq_config(struct ath5k_softc *sc);
331 static void     ath5k_txq_drainq(struct ath5k_softc *sc,
332                                 struct ath5k_txq *txq);
333 static void     ath5k_txq_cleanup(struct ath5k_softc *sc);
334 static void     ath5k_txq_release(struct ath5k_softc *sc);
335 /* Rx handling */
336 static int      ath5k_rx_start(struct ath5k_softc *sc);
337 static void     ath5k_rx_stop(struct ath5k_softc *sc);
338 static unsigned int ath5k_rx_decrypted(struct ath5k_softc *sc,
339                                         struct ath5k_desc *ds,
340                                         struct sk_buff *skb,
341                                         struct ath5k_rx_status *rs);
342 static void     ath5k_tasklet_rx(unsigned long data);
343 /* Tx handling */
344 static void     ath5k_tx_processq(struct ath5k_softc *sc,
345                                 struct ath5k_txq *txq);
346 static void     ath5k_tasklet_tx(unsigned long data);
347 /* Beacon handling */
348 static int      ath5k_beacon_setup(struct ath5k_softc *sc,
349                                         struct ath5k_buf *bf);
350 static void     ath5k_beacon_send(struct ath5k_softc *sc);
351 static void     ath5k_beacon_config(struct ath5k_softc *sc);
352 static void     ath5k_beacon_update_timers(struct ath5k_softc *sc, u64 bc_tsf);
353 static void     ath5k_tasklet_beacon(unsigned long data);
354
355 static inline u64 ath5k_extend_tsf(struct ath5k_hw *ah, u32 rstamp)
356 {
357         u64 tsf = ath5k_hw_get_tsf64(ah);
358
359         if ((tsf & 0x7fff) < rstamp)
360                 tsf -= 0x8000;
361
362         return (tsf & ~0x7fff) | rstamp;
363 }
364
365 /* Interrupt handling */
366 static int      ath5k_init(struct ath5k_softc *sc);
367 static int      ath5k_stop_locked(struct ath5k_softc *sc);
368 static int      ath5k_stop_hw(struct ath5k_softc *sc);
369 static irqreturn_t ath5k_intr(int irq, void *dev_id);
370 static void     ath5k_tasklet_reset(unsigned long data);
371
372 static void     ath5k_calibrate(unsigned long data);
373
374 /*
375  * Module init/exit functions
376  */
377 static int __init
378 init_ath5k_pci(void)
379 {
380         int ret;
381
382         ath5k_debug_init();
383
384         ret = pci_register_driver(&ath5k_pci_driver);
385         if (ret) {
386                 printk(KERN_ERR "ath5k_pci: can't register pci driver\n");
387                 return ret;
388         }
389
390         return 0;
391 }
392
393 static void __exit
394 exit_ath5k_pci(void)
395 {
396         pci_unregister_driver(&ath5k_pci_driver);
397
398         ath5k_debug_finish();
399 }
400
401 module_init(init_ath5k_pci);
402 module_exit(exit_ath5k_pci);
403
404
405 /********************\
406 * PCI Initialization *
407 \********************/
408
409 static const char *
410 ath5k_chip_name(enum ath5k_srev_type type, u_int16_t val)
411 {
412         const char *name = "xxxxx";
413         unsigned int i;
414
415         for (i = 0; i < ARRAY_SIZE(srev_names); i++) {
416                 if (srev_names[i].sr_type != type)
417                         continue;
418
419                 if ((val & 0xf0) == srev_names[i].sr_val)
420                         name = srev_names[i].sr_name;
421
422                 if ((val & 0xff) == srev_names[i].sr_val) {
423                         name = srev_names[i].sr_name;
424                         break;
425                 }
426         }
427
428         return name;
429 }
430
431 static int __devinit
432 ath5k_pci_probe(struct pci_dev *pdev,
433                 const struct pci_device_id *id)
434 {
435         void __iomem *mem;
436         struct ath5k_softc *sc;
437         struct ieee80211_hw *hw;
438         int ret;
439         u8 csz;
440
441         ret = pci_enable_device(pdev);
442         if (ret) {
443                 dev_err(&pdev->dev, "can't enable device\n");
444                 goto err;
445         }
446
447         /* XXX 32-bit addressing only */
448         ret = pci_set_dma_mask(pdev, DMA_BIT_MASK(32));
449         if (ret) {
450                 dev_err(&pdev->dev, "32-bit DMA not available\n");
451                 goto err_dis;
452         }
453
454         /*
455          * Cache line size is used to size and align various
456          * structures used to communicate with the hardware.
457          */
458         pci_read_config_byte(pdev, PCI_CACHE_LINE_SIZE, &csz);
459         if (csz == 0) {
460                 /*
461                  * Linux 2.4.18 (at least) writes the cache line size
462                  * register as a 16-bit wide register which is wrong.
463                  * We must have this setup properly for rx buffer
464                  * DMA to work so force a reasonable value here if it
465                  * comes up zero.
466                  */
467                 csz = L1_CACHE_BYTES / sizeof(u32);
468                 pci_write_config_byte(pdev, PCI_CACHE_LINE_SIZE, csz);
469         }
470         /*
471          * The default setting of latency timer yields poor results,
472          * set it to the value used by other systems.  It may be worth
473          * tweaking this setting more.
474          */
475         pci_write_config_byte(pdev, PCI_LATENCY_TIMER, 0xa8);
476
477         /* Enable bus mastering */
478         pci_set_master(pdev);
479
480         /*
481          * Disable the RETRY_TIMEOUT register (0x41) to keep
482          * PCI Tx retries from interfering with C3 CPU state.
483          */
484         pci_write_config_byte(pdev, 0x41, 0);
485
486         ret = pci_request_region(pdev, 0, "ath5k");
487         if (ret) {
488                 dev_err(&pdev->dev, "cannot reserve PCI memory region\n");
489                 goto err_dis;
490         }
491
492         mem = pci_iomap(pdev, 0, 0);
493         if (!mem) {
494                 dev_err(&pdev->dev, "cannot remap PCI memory region\n") ;
495                 ret = -EIO;
496                 goto err_reg;
497         }
498
499         /*
500          * Allocate hw (mac80211 main struct)
501          * and hw->priv (driver private data)
502          */
503         hw = ieee80211_alloc_hw(sizeof(*sc), &ath5k_hw_ops);
504         if (hw == NULL) {
505                 dev_err(&pdev->dev, "cannot allocate ieee80211_hw\n");
506                 ret = -ENOMEM;
507                 goto err_map;
508         }
509
510         dev_info(&pdev->dev, "registered as '%s'\n", wiphy_name(hw->wiphy));
511
512         /* Initialize driver private data */
513         SET_IEEE80211_DEV(hw, &pdev->dev);
514         hw->flags = IEEE80211_HW_RX_INCLUDES_FCS |
515                     IEEE80211_HW_SIGNAL_DBM |
516                     IEEE80211_HW_NOISE_DBM;
517
518         hw->wiphy->interface_modes =
519                 BIT(NL80211_IFTYPE_STATION) |
520                 BIT(NL80211_IFTYPE_ADHOC) |
521                 BIT(NL80211_IFTYPE_MESH_POINT);
522
523         hw->extra_tx_headroom = 2;
524         hw->channel_change_time = 5000;
525         sc = hw->priv;
526         sc->hw = hw;
527         sc->pdev = pdev;
528
529         ath5k_debug_init_device(sc);
530
531         /*
532          * Mark the device as detached to avoid processing
533          * interrupts until setup is complete.
534          */
535         __set_bit(ATH_STAT_INVALID, sc->status);
536
537         sc->iobase = mem; /* So we can unmap it on detach */
538         sc->cachelsz = csz * sizeof(u32); /* convert to bytes */
539         sc->opmode = NL80211_IFTYPE_STATION;
540         mutex_init(&sc->lock);
541         spin_lock_init(&sc->rxbuflock);
542         spin_lock_init(&sc->txbuflock);
543         spin_lock_init(&sc->block);
544
545         /* Set private data */
546         pci_set_drvdata(pdev, hw);
547
548         /* Setup interrupt handler */
549         ret = request_irq(pdev->irq, ath5k_intr, IRQF_SHARED, "ath", sc);
550         if (ret) {
551                 ATH5K_ERR(sc, "request_irq failed\n");
552                 goto err_free;
553         }
554
555         /* Initialize device */
556         sc->ah = ath5k_hw_attach(sc, id->driver_data);
557         if (IS_ERR(sc->ah)) {
558                 ret = PTR_ERR(sc->ah);
559                 goto err_irq;
560         }
561
562         /* set up multi-rate retry capabilities */
563         if (sc->ah->ah_version == AR5K_AR5212) {
564                 hw->max_rates = 4;
565                 hw->max_rate_tries = 11;
566         }
567
568         /* Finish private driver data initialization */
569         ret = ath5k_attach(pdev, hw);
570         if (ret)
571                 goto err_ah;
572
573         ATH5K_INFO(sc, "Atheros AR%s chip found (MAC: 0x%x, PHY: 0x%x)\n",
574                         ath5k_chip_name(AR5K_VERSION_MAC, sc->ah->ah_mac_srev),
575                                         sc->ah->ah_mac_srev,
576                                         sc->ah->ah_phy_revision);
577
578         if (!sc->ah->ah_single_chip) {
579                 /* Single chip radio (!RF5111) */
580                 if (sc->ah->ah_radio_5ghz_revision &&
581                         !sc->ah->ah_radio_2ghz_revision) {
582                         /* No 5GHz support -> report 2GHz radio */
583                         if (!test_bit(AR5K_MODE_11A,
584                                 sc->ah->ah_capabilities.cap_mode)) {
585                                 ATH5K_INFO(sc, "RF%s 2GHz radio found (0x%x)\n",
586                                         ath5k_chip_name(AR5K_VERSION_RAD,
587                                                 sc->ah->ah_radio_5ghz_revision),
588                                                 sc->ah->ah_radio_5ghz_revision);
589                         /* No 2GHz support (5110 and some
590                          * 5Ghz only cards) -> report 5Ghz radio */
591                         } else if (!test_bit(AR5K_MODE_11B,
592                                 sc->ah->ah_capabilities.cap_mode)) {
593                                 ATH5K_INFO(sc, "RF%s 5GHz radio found (0x%x)\n",
594                                         ath5k_chip_name(AR5K_VERSION_RAD,
595                                                 sc->ah->ah_radio_5ghz_revision),
596                                                 sc->ah->ah_radio_5ghz_revision);
597                         /* Multiband radio */
598                         } else {
599                                 ATH5K_INFO(sc, "RF%s multiband radio found"
600                                         " (0x%x)\n",
601                                         ath5k_chip_name(AR5K_VERSION_RAD,
602                                                 sc->ah->ah_radio_5ghz_revision),
603                                                 sc->ah->ah_radio_5ghz_revision);
604                         }
605                 }
606                 /* Multi chip radio (RF5111 - RF2111) ->
607                  * report both 2GHz/5GHz radios */
608                 else if (sc->ah->ah_radio_5ghz_revision &&
609                                 sc->ah->ah_radio_2ghz_revision){
610                         ATH5K_INFO(sc, "RF%s 5GHz radio found (0x%x)\n",
611                                 ath5k_chip_name(AR5K_VERSION_RAD,
612                                         sc->ah->ah_radio_5ghz_revision),
613                                         sc->ah->ah_radio_5ghz_revision);
614                         ATH5K_INFO(sc, "RF%s 2GHz radio found (0x%x)\n",
615                                 ath5k_chip_name(AR5K_VERSION_RAD,
616                                         sc->ah->ah_radio_2ghz_revision),
617                                         sc->ah->ah_radio_2ghz_revision);
618                 }
619         }
620
621
622         /* ready to process interrupts */
623         __clear_bit(ATH_STAT_INVALID, sc->status);
624
625         return 0;
626 err_ah:
627         ath5k_hw_detach(sc->ah);
628 err_irq:
629         free_irq(pdev->irq, sc);
630 err_free:
631         ieee80211_free_hw(hw);
632 err_map:
633         pci_iounmap(pdev, mem);
634 err_reg:
635         pci_release_region(pdev, 0);
636 err_dis:
637         pci_disable_device(pdev);
638 err:
639         return ret;
640 }
641
642 static void __devexit
643 ath5k_pci_remove(struct pci_dev *pdev)
644 {
645         struct ieee80211_hw *hw = pci_get_drvdata(pdev);
646         struct ath5k_softc *sc = hw->priv;
647
648         ath5k_debug_finish_device(sc);
649         ath5k_detach(pdev, hw);
650         ath5k_hw_detach(sc->ah);
651         free_irq(pdev->irq, sc);
652         pci_iounmap(pdev, sc->iobase);
653         pci_release_region(pdev, 0);
654         pci_disable_device(pdev);
655         ieee80211_free_hw(hw);
656 }
657
658 #ifdef CONFIG_PM
659 static int
660 ath5k_pci_suspend(struct pci_dev *pdev, pm_message_t state)
661 {
662         struct ieee80211_hw *hw = pci_get_drvdata(pdev);
663         struct ath5k_softc *sc = hw->priv;
664
665         ath5k_led_off(sc);
666
667         free_irq(pdev->irq, sc);
668         pci_save_state(pdev);
669         pci_disable_device(pdev);
670         pci_set_power_state(pdev, PCI_D3hot);
671
672         return 0;
673 }
674
675 static int
676 ath5k_pci_resume(struct pci_dev *pdev)
677 {
678         struct ieee80211_hw *hw = pci_get_drvdata(pdev);
679         struct ath5k_softc *sc = hw->priv;
680         int err;
681
682         pci_restore_state(pdev);
683
684         err = pci_enable_device(pdev);
685         if (err)
686                 return err;
687
688         err = request_irq(pdev->irq, ath5k_intr, IRQF_SHARED, "ath", sc);
689         if (err) {
690                 ATH5K_ERR(sc, "request_irq failed\n");
691                 goto err_no_irq;
692         }
693
694         ath5k_led_enable(sc);
695         return 0;
696
697 err_no_irq:
698         pci_disable_device(pdev);
699         return err;
700 }
701 #endif /* CONFIG_PM */
702
703
704 /***********************\
705 * Driver Initialization *
706 \***********************/
707
708 static int ath5k_reg_notifier(struct wiphy *wiphy, struct regulatory_request *request)
709 {
710         struct ieee80211_hw *hw = wiphy_to_ieee80211_hw(wiphy);
711         struct ath5k_softc *sc = hw->priv;
712         struct ath_regulatory *reg = &sc->ah->ah_regulatory;
713
714         return ath_reg_notifier_apply(wiphy, request, reg);
715 }
716
717 static int
718 ath5k_attach(struct pci_dev *pdev, struct ieee80211_hw *hw)
719 {
720         struct ath5k_softc *sc = hw->priv;
721         struct ath5k_hw *ah = sc->ah;
722         u8 mac[ETH_ALEN] = {};
723         int ret;
724
725         ATH5K_DBG(sc, ATH5K_DEBUG_ANY, "devid 0x%x\n", pdev->device);
726
727         /*
728          * Check if the MAC has multi-rate retry support.
729          * We do this by trying to setup a fake extended
730          * descriptor.  MAC's that don't have support will
731          * return false w/o doing anything.  MAC's that do
732          * support it will return true w/o doing anything.
733          */
734         ret = ah->ah_setup_mrr_tx_desc(ah, NULL, 0, 0, 0, 0, 0, 0);
735         if (ret < 0)
736                 goto err;
737         if (ret > 0)
738                 __set_bit(ATH_STAT_MRRETRY, sc->status);
739
740         /*
741          * Collect the channel list.  The 802.11 layer
742          * is resposible for filtering this list based
743          * on settings like the phy mode and regulatory
744          * domain restrictions.
745          */
746         ret = ath5k_setup_bands(hw);
747         if (ret) {
748                 ATH5K_ERR(sc, "can't get channels\n");
749                 goto err;
750         }
751
752         /* NB: setup here so ath5k_rate_update is happy */
753         if (test_bit(AR5K_MODE_11A, ah->ah_modes))
754                 ath5k_setcurmode(sc, AR5K_MODE_11A);
755         else
756                 ath5k_setcurmode(sc, AR5K_MODE_11B);
757
758         /*
759          * Allocate tx+rx descriptors and populate the lists.
760          */
761         ret = ath5k_desc_alloc(sc, pdev);
762         if (ret) {
763                 ATH5K_ERR(sc, "can't allocate descriptors\n");
764                 goto err;
765         }
766
767         /*
768          * Allocate hardware transmit queues: one queue for
769          * beacon frames and one data queue for each QoS
770          * priority.  Note that hw functions handle reseting
771          * these queues at the needed time.
772          */
773         ret = ath5k_beaconq_setup(ah);
774         if (ret < 0) {
775                 ATH5K_ERR(sc, "can't setup a beacon xmit queue\n");
776                 goto err_desc;
777         }
778         sc->bhalq = ret;
779
780         sc->txq = ath5k_txq_setup(sc, AR5K_TX_QUEUE_DATA, AR5K_WME_AC_BK);
781         if (IS_ERR(sc->txq)) {
782                 ATH5K_ERR(sc, "can't setup xmit queue\n");
783                 ret = PTR_ERR(sc->txq);
784                 goto err_bhal;
785         }
786
787         tasklet_init(&sc->rxtq, ath5k_tasklet_rx, (unsigned long)sc);
788         tasklet_init(&sc->txtq, ath5k_tasklet_tx, (unsigned long)sc);
789         tasklet_init(&sc->restq, ath5k_tasklet_reset, (unsigned long)sc);
790         tasklet_init(&sc->beacontq, ath5k_tasklet_beacon, (unsigned long)sc);
791         setup_timer(&sc->calib_tim, ath5k_calibrate, (unsigned long)sc);
792
793         ret = ath5k_eeprom_read_mac(ah, mac);
794         if (ret) {
795                 ATH5K_ERR(sc, "unable to read address from EEPROM: 0x%04x\n",
796                         sc->pdev->device);
797                 goto err_queues;
798         }
799
800         SET_IEEE80211_PERM_ADDR(hw, mac);
801         /* All MAC address bits matter for ACKs */
802         memset(sc->bssidmask, 0xff, ETH_ALEN);
803         ath5k_hw_set_bssid_mask(sc->ah, sc->bssidmask);
804
805         ah->ah_regulatory.current_rd =
806                 ah->ah_capabilities.cap_eeprom.ee_regdomain;
807         ret = ath_regd_init(&ah->ah_regulatory, hw->wiphy, ath5k_reg_notifier);
808         if (ret) {
809                 ATH5K_ERR(sc, "can't initialize regulatory system\n");
810                 goto err_queues;
811         }
812
813         ret = ieee80211_register_hw(hw);
814         if (ret) {
815                 ATH5K_ERR(sc, "can't register ieee80211 hw\n");
816                 goto err_queues;
817         }
818
819         if (!ath_is_world_regd(&sc->ah->ah_regulatory))
820                 regulatory_hint(hw->wiphy, sc->ah->ah_regulatory.alpha2);
821
822         ath5k_init_leds(sc);
823
824         return 0;
825 err_queues:
826         ath5k_txq_release(sc);
827 err_bhal:
828         ath5k_hw_release_tx_queue(ah, sc->bhalq);
829 err_desc:
830         ath5k_desc_free(sc, pdev);
831 err:
832         return ret;
833 }
834
835 static void
836 ath5k_detach(struct pci_dev *pdev, struct ieee80211_hw *hw)
837 {
838         struct ath5k_softc *sc = hw->priv;
839
840         /*
841          * NB: the order of these is important:
842          * o call the 802.11 layer before detaching ath5k_hw to
843          *   insure callbacks into the driver to delete global
844          *   key cache entries can be handled
845          * o reclaim the tx queue data structures after calling
846          *   the 802.11 layer as we'll get called back to reclaim
847          *   node state and potentially want to use them
848          * o to cleanup the tx queues the hal is called, so detach
849          *   it last
850          * XXX: ??? detach ath5k_hw ???
851          * Other than that, it's straightforward...
852          */
853         ieee80211_unregister_hw(hw);
854         ath5k_desc_free(sc, pdev);
855         ath5k_txq_release(sc);
856         ath5k_hw_release_tx_queue(sc->ah, sc->bhalq);
857         ath5k_unregister_leds(sc);
858
859         /*
860          * NB: can't reclaim these until after ieee80211_ifdetach
861          * returns because we'll get called back to reclaim node
862          * state and potentially want to use them.
863          */
864 }
865
866
867
868
869 /********************\
870 * Channel/mode setup *
871 \********************/
872
873 /*
874  * Convert IEEE channel number to MHz frequency.
875  */
876 static inline short
877 ath5k_ieee2mhz(short chan)
878 {
879         if (chan <= 14 || chan >= 27)
880                 return ieee80211chan2mhz(chan);
881         else
882                 return 2212 + chan * 20;
883 }
884
885 /*
886  * Returns true for the channel numbers used without all_channels modparam.
887  */
888 static bool ath5k_is_standard_channel(short chan)
889 {
890         return ((chan <= 14) ||
891                 /* UNII 1,2 */
892                 ((chan & 3) == 0 && chan >= 36 && chan <= 64) ||
893                 /* midband */
894                 ((chan & 3) == 0 && chan >= 100 && chan <= 140) ||
895                 /* UNII-3 */
896                 ((chan & 3) == 1 && chan >= 149 && chan <= 165));
897 }
898
899 static unsigned int
900 ath5k_copy_channels(struct ath5k_hw *ah,
901                 struct ieee80211_channel *channels,
902                 unsigned int mode,
903                 unsigned int max)
904 {
905         unsigned int i, count, size, chfreq, freq, ch;
906
907         if (!test_bit(mode, ah->ah_modes))
908                 return 0;
909
910         switch (mode) {
911         case AR5K_MODE_11A:
912         case AR5K_MODE_11A_TURBO:
913                 /* 1..220, but 2GHz frequencies are filtered by check_channel */
914                 size = 220 ;
915                 chfreq = CHANNEL_5GHZ;
916                 break;
917         case AR5K_MODE_11B:
918         case AR5K_MODE_11G:
919         case AR5K_MODE_11G_TURBO:
920                 size = 26;
921                 chfreq = CHANNEL_2GHZ;
922                 break;
923         default:
924                 ATH5K_WARN(ah->ah_sc, "bad mode, not copying channels\n");
925                 return 0;
926         }
927
928         for (i = 0, count = 0; i < size && max > 0; i++) {
929                 ch = i + 1 ;
930                 freq = ath5k_ieee2mhz(ch);
931
932                 /* Check if channel is supported by the chipset */
933                 if (!ath5k_channel_ok(ah, freq, chfreq))
934                         continue;
935
936                 if (!modparam_all_channels && !ath5k_is_standard_channel(ch))
937                         continue;
938
939                 /* Write channel info and increment counter */
940                 channels[count].center_freq = freq;
941                 channels[count].band = (chfreq == CHANNEL_2GHZ) ?
942                         IEEE80211_BAND_2GHZ : IEEE80211_BAND_5GHZ;
943                 switch (mode) {
944                 case AR5K_MODE_11A:
945                 case AR5K_MODE_11G:
946                         channels[count].hw_value = chfreq | CHANNEL_OFDM;
947                         break;
948                 case AR5K_MODE_11A_TURBO:
949                 case AR5K_MODE_11G_TURBO:
950                         channels[count].hw_value = chfreq |
951                                 CHANNEL_OFDM | CHANNEL_TURBO;
952                         break;
953                 case AR5K_MODE_11B:
954                         channels[count].hw_value = CHANNEL_B;
955                 }
956
957                 count++;
958                 max--;
959         }
960
961         return count;
962 }
963
964 static void
965 ath5k_setup_rate_idx(struct ath5k_softc *sc, struct ieee80211_supported_band *b)
966 {
967         u8 i;
968
969         for (i = 0; i < AR5K_MAX_RATES; i++)
970                 sc->rate_idx[b->band][i] = -1;
971
972         for (i = 0; i < b->n_bitrates; i++) {
973                 sc->rate_idx[b->band][b->bitrates[i].hw_value] = i;
974                 if (b->bitrates[i].hw_value_short)
975                         sc->rate_idx[b->band][b->bitrates[i].hw_value_short] = i;
976         }
977 }
978
979 static int
980 ath5k_setup_bands(struct ieee80211_hw *hw)
981 {
982         struct ath5k_softc *sc = hw->priv;
983         struct ath5k_hw *ah = sc->ah;
984         struct ieee80211_supported_band *sband;
985         int max_c, count_c = 0;
986         int i;
987
988         BUILD_BUG_ON(ARRAY_SIZE(sc->sbands) < IEEE80211_NUM_BANDS);
989         max_c = ARRAY_SIZE(sc->channels);
990
991         /* 2GHz band */
992         sband = &sc->sbands[IEEE80211_BAND_2GHZ];
993         sband->band = IEEE80211_BAND_2GHZ;
994         sband->bitrates = &sc->rates[IEEE80211_BAND_2GHZ][0];
995
996         if (test_bit(AR5K_MODE_11G, sc->ah->ah_capabilities.cap_mode)) {
997                 /* G mode */
998                 memcpy(sband->bitrates, &ath5k_rates[0],
999                        sizeof(struct ieee80211_rate) * 12);
1000                 sband->n_bitrates = 12;
1001
1002                 sband->channels = sc->channels;
1003                 sband->n_channels = ath5k_copy_channels(ah, sband->channels,
1004                                         AR5K_MODE_11G, max_c);
1005
1006                 hw->wiphy->bands[IEEE80211_BAND_2GHZ] = sband;
1007                 count_c = sband->n_channels;
1008                 max_c -= count_c;
1009         } else if (test_bit(AR5K_MODE_11B, sc->ah->ah_capabilities.cap_mode)) {
1010                 /* B mode */
1011                 memcpy(sband->bitrates, &ath5k_rates[0],
1012                        sizeof(struct ieee80211_rate) * 4);
1013                 sband->n_bitrates = 4;
1014
1015                 /* 5211 only supports B rates and uses 4bit rate codes
1016                  * (e.g normally we have 0x1B for 1M, but on 5211 we have 0x0B)
1017                  * fix them up here:
1018                  */
1019                 if (ah->ah_version == AR5K_AR5211) {
1020                         for (i = 0; i < 4; i++) {
1021                                 sband->bitrates[i].hw_value =
1022                                         sband->bitrates[i].hw_value & 0xF;
1023                                 sband->bitrates[i].hw_value_short =
1024                                         sband->bitrates[i].hw_value_short & 0xF;
1025                         }
1026                 }
1027
1028                 sband->channels = sc->channels;
1029                 sband->n_channels = ath5k_copy_channels(ah, sband->channels,
1030                                         AR5K_MODE_11B, max_c);
1031
1032                 hw->wiphy->bands[IEEE80211_BAND_2GHZ] = sband;
1033                 count_c = sband->n_channels;
1034                 max_c -= count_c;
1035         }
1036         ath5k_setup_rate_idx(sc, sband);
1037
1038         /* 5GHz band, A mode */
1039         if (test_bit(AR5K_MODE_11A, sc->ah->ah_capabilities.cap_mode)) {
1040                 sband = &sc->sbands[IEEE80211_BAND_5GHZ];
1041                 sband->band = IEEE80211_BAND_5GHZ;
1042                 sband->bitrates = &sc->rates[IEEE80211_BAND_5GHZ][0];
1043
1044                 memcpy(sband->bitrates, &ath5k_rates[4],
1045                        sizeof(struct ieee80211_rate) * 8);
1046                 sband->n_bitrates = 8;
1047
1048                 sband->channels = &sc->channels[count_c];
1049                 sband->n_channels = ath5k_copy_channels(ah, sband->channels,
1050                                         AR5K_MODE_11A, max_c);
1051
1052                 hw->wiphy->bands[IEEE80211_BAND_5GHZ] = sband;
1053         }
1054         ath5k_setup_rate_idx(sc, sband);
1055
1056         ath5k_debug_dump_bands(sc);
1057
1058         return 0;
1059 }
1060
1061 /*
1062  * Set/change channels.  If the channel is really being changed,
1063  * it's done by reseting the chip.  To accomplish this we must
1064  * first cleanup any pending DMA, then restart stuff after a la
1065  * ath5k_init.
1066  *
1067  * Called with sc->lock.
1068  */
1069 static int
1070 ath5k_chan_set(struct ath5k_softc *sc, struct ieee80211_channel *chan)
1071 {
1072         ATH5K_DBG(sc, ATH5K_DEBUG_RESET, "(%u MHz) -> (%u MHz)\n",
1073                 sc->curchan->center_freq, chan->center_freq);
1074
1075         if (chan->center_freq != sc->curchan->center_freq ||
1076                 chan->hw_value != sc->curchan->hw_value) {
1077
1078                 sc->curchan = chan;
1079                 sc->curband = &sc->sbands[chan->band];
1080
1081                 /*
1082                  * To switch channels clear any pending DMA operations;
1083                  * wait long enough for the RX fifo to drain, reset the
1084                  * hardware at the new frequency, and then re-enable
1085                  * the relevant bits of the h/w.
1086                  */
1087                 return ath5k_reset(sc, true, true);
1088         }
1089
1090         return 0;
1091 }
1092
1093 static void
1094 ath5k_setcurmode(struct ath5k_softc *sc, unsigned int mode)
1095 {
1096         sc->curmode = mode;
1097
1098         if (mode == AR5K_MODE_11A) {
1099                 sc->curband = &sc->sbands[IEEE80211_BAND_5GHZ];
1100         } else {
1101                 sc->curband = &sc->sbands[IEEE80211_BAND_2GHZ];
1102         }
1103 }
1104
1105 static void
1106 ath5k_mode_setup(struct ath5k_softc *sc)
1107 {
1108         struct ath5k_hw *ah = sc->ah;
1109         u32 rfilt;
1110
1111         /* configure rx filter */
1112         rfilt = sc->filter_flags;
1113         ath5k_hw_set_rx_filter(ah, rfilt);
1114
1115         if (ath5k_hw_hasbssidmask(ah))
1116                 ath5k_hw_set_bssid_mask(ah, sc->bssidmask);
1117
1118         /* configure operational mode */
1119         ath5k_hw_set_opmode(ah);
1120
1121         ath5k_hw_set_mcast_filter(ah, 0, 0);
1122         ATH5K_DBG(sc, ATH5K_DEBUG_MODE, "RX filter 0x%x\n", rfilt);
1123 }
1124
1125 static inline int
1126 ath5k_hw_to_driver_rix(struct ath5k_softc *sc, int hw_rix)
1127 {
1128         int rix;
1129
1130         /* return base rate on errors */
1131         if (WARN(hw_rix < 0 || hw_rix >= AR5K_MAX_RATES,
1132                         "hw_rix out of bounds: %x\n", hw_rix))
1133                 return 0;
1134
1135         rix = sc->rate_idx[sc->curband->band][hw_rix];
1136         if (WARN(rix < 0, "invalid hw_rix: %x\n", hw_rix))
1137                 rix = 0;
1138
1139         return rix;
1140 }
1141
1142 /***************\
1143 * Buffers setup *
1144 \***************/
1145
1146 static
1147 struct sk_buff *ath5k_rx_skb_alloc(struct ath5k_softc *sc, dma_addr_t *skb_addr)
1148 {
1149         struct sk_buff *skb;
1150         unsigned int off;
1151
1152         /*
1153          * Allocate buffer with headroom_needed space for the
1154          * fake physical layer header at the start.
1155          */
1156         skb = dev_alloc_skb(sc->rxbufsize + sc->cachelsz - 1);
1157
1158         if (!skb) {
1159                 ATH5K_ERR(sc, "can't alloc skbuff of size %u\n",
1160                                 sc->rxbufsize + sc->cachelsz - 1);
1161                 return NULL;
1162         }
1163         /*
1164          * Cache-line-align.  This is important (for the
1165          * 5210 at least) as not doing so causes bogus data
1166          * in rx'd frames.
1167          */
1168         off = ((unsigned long)skb->data) % sc->cachelsz;
1169         if (off != 0)
1170                 skb_reserve(skb, sc->cachelsz - off);
1171
1172         *skb_addr = pci_map_single(sc->pdev,
1173                 skb->data, sc->rxbufsize, PCI_DMA_FROMDEVICE);
1174         if (unlikely(pci_dma_mapping_error(sc->pdev, *skb_addr))) {
1175                 ATH5K_ERR(sc, "%s: DMA mapping failed\n", __func__);
1176                 dev_kfree_skb(skb);
1177                 return NULL;
1178         }
1179         return skb;
1180 }
1181
1182 static int
1183 ath5k_rxbuf_setup(struct ath5k_softc *sc, struct ath5k_buf *bf)
1184 {
1185         struct ath5k_hw *ah = sc->ah;
1186         struct sk_buff *skb = bf->skb;
1187         struct ath5k_desc *ds;
1188
1189         if (!skb) {
1190                 skb = ath5k_rx_skb_alloc(sc, &bf->skbaddr);
1191                 if (!skb)
1192                         return -ENOMEM;
1193                 bf->skb = skb;
1194         }
1195
1196         /*
1197          * Setup descriptors.  For receive we always terminate
1198          * the descriptor list with a self-linked entry so we'll
1199          * not get overrun under high load (as can happen with a
1200          * 5212 when ANI processing enables PHY error frames).
1201          *
1202          * To insure the last descriptor is self-linked we create
1203          * each descriptor as self-linked and add it to the end.  As
1204          * each additional descriptor is added the previous self-linked
1205          * entry is ``fixed'' naturally.  This should be safe even
1206          * if DMA is happening.  When processing RX interrupts we
1207          * never remove/process the last, self-linked, entry on the
1208          * descriptor list.  This insures the hardware always has
1209          * someplace to write a new frame.
1210          */
1211         ds = bf->desc;
1212         ds->ds_link = bf->daddr;        /* link to self */
1213         ds->ds_data = bf->skbaddr;
1214         ah->ah_setup_rx_desc(ah, ds,
1215                 skb_tailroom(skb),      /* buffer size */
1216                 0);
1217
1218         if (sc->rxlink != NULL)
1219                 *sc->rxlink = bf->daddr;
1220         sc->rxlink = &ds->ds_link;
1221         return 0;
1222 }
1223
1224 static int
1225 ath5k_txbuf_setup(struct ath5k_softc *sc, struct ath5k_buf *bf)
1226 {
1227         struct ath5k_hw *ah = sc->ah;
1228         struct ath5k_txq *txq = sc->txq;
1229         struct ath5k_desc *ds = bf->desc;
1230         struct sk_buff *skb = bf->skb;
1231         struct ieee80211_tx_info *info = IEEE80211_SKB_CB(skb);
1232         unsigned int pktlen, flags, keyidx = AR5K_TXKEYIX_INVALID;
1233         struct ieee80211_rate *rate;
1234         unsigned int mrr_rate[3], mrr_tries[3];
1235         int i, ret;
1236         u16 hw_rate;
1237         u16 cts_rate = 0;
1238         u16 duration = 0;
1239         u8 rc_flags;
1240
1241         flags = AR5K_TXDESC_INTREQ | AR5K_TXDESC_CLRDMASK;
1242
1243         /* XXX endianness */
1244         bf->skbaddr = pci_map_single(sc->pdev, skb->data, skb->len,
1245                         PCI_DMA_TODEVICE);
1246
1247         rate = ieee80211_get_tx_rate(sc->hw, info);
1248
1249         if (info->flags & IEEE80211_TX_CTL_NO_ACK)
1250                 flags |= AR5K_TXDESC_NOACK;
1251
1252         rc_flags = info->control.rates[0].flags;
1253         hw_rate = (rc_flags & IEEE80211_TX_RC_USE_SHORT_PREAMBLE) ?
1254                 rate->hw_value_short : rate->hw_value;
1255
1256         pktlen = skb->len;
1257
1258         /* FIXME: If we are in g mode and rate is a CCK rate
1259          * subtract ah->ah_txpower.txp_cck_ofdm_pwr_delta
1260          * from tx power (value is in dB units already) */
1261         if (info->control.hw_key) {
1262                 keyidx = info->control.hw_key->hw_key_idx;
1263                 pktlen += info->control.hw_key->icv_len;
1264         }
1265         if (rc_flags & IEEE80211_TX_RC_USE_RTS_CTS) {
1266                 flags |= AR5K_TXDESC_RTSENA;
1267                 cts_rate = ieee80211_get_rts_cts_rate(sc->hw, info)->hw_value;
1268                 duration = le16_to_cpu(ieee80211_rts_duration(sc->hw,
1269                         sc->vif, pktlen, info));
1270         }
1271         if (rc_flags & IEEE80211_TX_RC_USE_CTS_PROTECT) {
1272                 flags |= AR5K_TXDESC_CTSENA;
1273                 cts_rate = ieee80211_get_rts_cts_rate(sc->hw, info)->hw_value;
1274                 duration = le16_to_cpu(ieee80211_ctstoself_duration(sc->hw,
1275                         sc->vif, pktlen, info));
1276         }
1277         ret = ah->ah_setup_tx_desc(ah, ds, pktlen,
1278                 ieee80211_get_hdrlen_from_skb(skb), AR5K_PKT_TYPE_NORMAL,
1279                 (sc->power_level * 2),
1280                 hw_rate,
1281                 info->control.rates[0].count, keyidx, 0, flags,
1282                 cts_rate, duration);
1283         if (ret)
1284                 goto err_unmap;
1285
1286         memset(mrr_rate, 0, sizeof(mrr_rate));
1287         memset(mrr_tries, 0, sizeof(mrr_tries));
1288         for (i = 0; i < 3; i++) {
1289                 rate = ieee80211_get_alt_retry_rate(sc->hw, info, i);
1290                 if (!rate)
1291                         break;
1292
1293                 mrr_rate[i] = rate->hw_value;
1294                 mrr_tries[i] = info->control.rates[i + 1].count;
1295         }
1296
1297         ah->ah_setup_mrr_tx_desc(ah, ds,
1298                 mrr_rate[0], mrr_tries[0],
1299                 mrr_rate[1], mrr_tries[1],
1300                 mrr_rate[2], mrr_tries[2]);
1301
1302         ds->ds_link = 0;
1303         ds->ds_data = bf->skbaddr;
1304
1305         spin_lock_bh(&txq->lock);
1306         list_add_tail(&bf->list, &txq->q);
1307         sc->tx_stats[txq->qnum].len++;
1308         if (txq->link == NULL) /* is this first packet? */
1309                 ath5k_hw_set_txdp(ah, txq->qnum, bf->daddr);
1310         else /* no, so only link it */
1311                 *txq->link = bf->daddr;
1312
1313         txq->link = &ds->ds_link;
1314         ath5k_hw_start_tx_dma(ah, txq->qnum);
1315         mmiowb();
1316         spin_unlock_bh(&txq->lock);
1317
1318         return 0;
1319 err_unmap:
1320         pci_unmap_single(sc->pdev, bf->skbaddr, skb->len, PCI_DMA_TODEVICE);
1321         return ret;
1322 }
1323
1324 /*******************\
1325 * Descriptors setup *
1326 \*******************/
1327
1328 static int
1329 ath5k_desc_alloc(struct ath5k_softc *sc, struct pci_dev *pdev)
1330 {
1331         struct ath5k_desc *ds;
1332         struct ath5k_buf *bf;
1333         dma_addr_t da;
1334         unsigned int i;
1335         int ret;
1336
1337         /* allocate descriptors */
1338         sc->desc_len = sizeof(struct ath5k_desc) *
1339                         (ATH_TXBUF + ATH_RXBUF + ATH_BCBUF + 1);
1340         sc->desc = pci_alloc_consistent(pdev, sc->desc_len, &sc->desc_daddr);
1341         if (sc->desc == NULL) {
1342                 ATH5K_ERR(sc, "can't allocate descriptors\n");
1343                 ret = -ENOMEM;
1344                 goto err;
1345         }
1346         ds = sc->desc;
1347         da = sc->desc_daddr;
1348         ATH5K_DBG(sc, ATH5K_DEBUG_ANY, "DMA map: %p (%zu) -> %llx\n",
1349                 ds, sc->desc_len, (unsigned long long)sc->desc_daddr);
1350
1351         bf = kcalloc(1 + ATH_TXBUF + ATH_RXBUF + ATH_BCBUF,
1352                         sizeof(struct ath5k_buf), GFP_KERNEL);
1353         if (bf == NULL) {
1354                 ATH5K_ERR(sc, "can't allocate bufptr\n");
1355                 ret = -ENOMEM;
1356                 goto err_free;
1357         }
1358         sc->bufptr = bf;
1359
1360         INIT_LIST_HEAD(&sc->rxbuf);
1361         for (i = 0; i < ATH_RXBUF; i++, bf++, ds++, da += sizeof(*ds)) {
1362                 bf->desc = ds;
1363                 bf->daddr = da;
1364                 list_add_tail(&bf->list, &sc->rxbuf);
1365         }
1366
1367         INIT_LIST_HEAD(&sc->txbuf);
1368         sc->txbuf_len = ATH_TXBUF;
1369         for (i = 0; i < ATH_TXBUF; i++, bf++, ds++,
1370                         da += sizeof(*ds)) {
1371                 bf->desc = ds;
1372                 bf->daddr = da;
1373                 list_add_tail(&bf->list, &sc->txbuf);
1374         }
1375
1376         /* beacon buffer */
1377         bf->desc = ds;
1378         bf->daddr = da;
1379         sc->bbuf = bf;
1380
1381         return 0;
1382 err_free:
1383         pci_free_consistent(pdev, sc->desc_len, sc->desc, sc->desc_daddr);
1384 err:
1385         sc->desc = NULL;
1386         return ret;
1387 }
1388
1389 static void
1390 ath5k_desc_free(struct ath5k_softc *sc, struct pci_dev *pdev)
1391 {
1392         struct ath5k_buf *bf;
1393
1394         ath5k_txbuf_free(sc, sc->bbuf);
1395         list_for_each_entry(bf, &sc->txbuf, list)
1396                 ath5k_txbuf_free(sc, bf);
1397         list_for_each_entry(bf, &sc->rxbuf, list)
1398                 ath5k_rxbuf_free(sc, bf);
1399
1400         /* Free memory associated with all descriptors */
1401         pci_free_consistent(pdev, sc->desc_len, sc->desc, sc->desc_daddr);
1402
1403         kfree(sc->bufptr);
1404         sc->bufptr = NULL;
1405 }
1406
1407
1408
1409
1410
1411 /**************\
1412 * Queues setup *
1413 \**************/
1414
1415 static struct ath5k_txq *
1416 ath5k_txq_setup(struct ath5k_softc *sc,
1417                 int qtype, int subtype)
1418 {
1419         struct ath5k_hw *ah = sc->ah;
1420         struct ath5k_txq *txq;
1421         struct ath5k_txq_info qi = {
1422                 .tqi_subtype = subtype,
1423                 .tqi_aifs = AR5K_TXQ_USEDEFAULT,
1424                 .tqi_cw_min = AR5K_TXQ_USEDEFAULT,
1425                 .tqi_cw_max = AR5K_TXQ_USEDEFAULT
1426         };
1427         int qnum;
1428
1429         /*
1430          * Enable interrupts only for EOL and DESC conditions.
1431          * We mark tx descriptors to receive a DESC interrupt
1432          * when a tx queue gets deep; otherwise waiting for the
1433          * EOL to reap descriptors.  Note that this is done to
1434          * reduce interrupt load and this only defers reaping
1435          * descriptors, never transmitting frames.  Aside from
1436          * reducing interrupts this also permits more concurrency.
1437          * The only potential downside is if the tx queue backs
1438          * up in which case the top half of the kernel may backup
1439          * due to a lack of tx descriptors.
1440          */
1441         qi.tqi_flags = AR5K_TXQ_FLAG_TXEOLINT_ENABLE |
1442                                 AR5K_TXQ_FLAG_TXDESCINT_ENABLE;
1443         qnum = ath5k_hw_setup_tx_queue(ah, qtype, &qi);
1444         if (qnum < 0) {
1445                 /*
1446                  * NB: don't print a message, this happens
1447                  * normally on parts with too few tx queues
1448                  */
1449                 return ERR_PTR(qnum);
1450         }
1451         if (qnum >= ARRAY_SIZE(sc->txqs)) {
1452                 ATH5K_ERR(sc, "hw qnum %u out of range, max %tu!\n",
1453                         qnum, ARRAY_SIZE(sc->txqs));
1454                 ath5k_hw_release_tx_queue(ah, qnum);
1455                 return ERR_PTR(-EINVAL);
1456         }
1457         txq = &sc->txqs[qnum];
1458         if (!txq->setup) {
1459                 txq->qnum = qnum;
1460                 txq->link = NULL;
1461                 INIT_LIST_HEAD(&txq->q);
1462                 spin_lock_init(&txq->lock);
1463                 txq->setup = true;
1464         }
1465         return &sc->txqs[qnum];
1466 }
1467
1468 static int
1469 ath5k_beaconq_setup(struct ath5k_hw *ah)
1470 {
1471         struct ath5k_txq_info qi = {
1472                 .tqi_aifs = AR5K_TXQ_USEDEFAULT,
1473                 .tqi_cw_min = AR5K_TXQ_USEDEFAULT,
1474                 .tqi_cw_max = AR5K_TXQ_USEDEFAULT,
1475                 /* NB: for dynamic turbo, don't enable any other interrupts */
1476                 .tqi_flags = AR5K_TXQ_FLAG_TXDESCINT_ENABLE
1477         };
1478
1479         return ath5k_hw_setup_tx_queue(ah, AR5K_TX_QUEUE_BEACON, &qi);
1480 }
1481
1482 static int
1483 ath5k_beaconq_config(struct ath5k_softc *sc)
1484 {
1485         struct ath5k_hw *ah = sc->ah;
1486         struct ath5k_txq_info qi;
1487         int ret;
1488
1489         ret = ath5k_hw_get_tx_queueprops(ah, sc->bhalq, &qi);
1490         if (ret)
1491                 return ret;
1492         if (sc->opmode == NL80211_IFTYPE_AP ||
1493                 sc->opmode == NL80211_IFTYPE_MESH_POINT) {
1494                 /*
1495                  * Always burst out beacon and CAB traffic
1496                  * (aifs = cwmin = cwmax = 0)
1497                  */
1498                 qi.tqi_aifs = 0;
1499                 qi.tqi_cw_min = 0;
1500                 qi.tqi_cw_max = 0;
1501         } else if (sc->opmode == NL80211_IFTYPE_ADHOC) {
1502                 /*
1503                  * Adhoc mode; backoff between 0 and (2 * cw_min).
1504                  */
1505                 qi.tqi_aifs = 0;
1506                 qi.tqi_cw_min = 0;
1507                 qi.tqi_cw_max = 2 * ah->ah_cw_min;
1508         }
1509
1510         ATH5K_DBG(sc, ATH5K_DEBUG_BEACON,
1511                 "beacon queueprops tqi_aifs:%d tqi_cw_min:%d tqi_cw_max:%d\n",
1512                 qi.tqi_aifs, qi.tqi_cw_min, qi.tqi_cw_max);
1513
1514         ret = ath5k_hw_set_tx_queueprops(ah, sc->bhalq, &qi);
1515         if (ret) {
1516                 ATH5K_ERR(sc, "%s: unable to update parameters for beacon "
1517                         "hardware queue!\n", __func__);
1518                 return ret;
1519         }
1520
1521         return ath5k_hw_reset_tx_queue(ah, sc->bhalq); /* push to h/w */;
1522 }
1523
1524 static void
1525 ath5k_txq_drainq(struct ath5k_softc *sc, struct ath5k_txq *txq)
1526 {
1527         struct ath5k_buf *bf, *bf0;
1528
1529         /*
1530          * NB: this assumes output has been stopped and
1531          *     we do not need to block ath5k_tx_tasklet
1532          */
1533         spin_lock_bh(&txq->lock);
1534         list_for_each_entry_safe(bf, bf0, &txq->q, list) {
1535                 ath5k_debug_printtxbuf(sc, bf);
1536
1537                 ath5k_txbuf_free(sc, bf);
1538
1539                 spin_lock_bh(&sc->txbuflock);
1540                 sc->tx_stats[txq->qnum].len--;
1541                 list_move_tail(&bf->list, &sc->txbuf);
1542                 sc->txbuf_len++;
1543                 spin_unlock_bh(&sc->txbuflock);
1544         }
1545         txq->link = NULL;
1546         spin_unlock_bh(&txq->lock);
1547 }
1548
1549 /*
1550  * Drain the transmit queues and reclaim resources.
1551  */
1552 static void
1553 ath5k_txq_cleanup(struct ath5k_softc *sc)
1554 {
1555         struct ath5k_hw *ah = sc->ah;
1556         unsigned int i;
1557
1558         /* XXX return value */
1559         if (likely(!test_bit(ATH_STAT_INVALID, sc->status))) {
1560                 /* don't touch the hardware if marked invalid */
1561                 ath5k_hw_stop_tx_dma(ah, sc->bhalq);
1562                 ATH5K_DBG(sc, ATH5K_DEBUG_RESET, "beacon queue %x\n",
1563                         ath5k_hw_get_txdp(ah, sc->bhalq));
1564                 for (i = 0; i < ARRAY_SIZE(sc->txqs); i++)
1565                         if (sc->txqs[i].setup) {
1566                                 ath5k_hw_stop_tx_dma(ah, sc->txqs[i].qnum);
1567                                 ATH5K_DBG(sc, ATH5K_DEBUG_RESET, "txq [%u] %x, "
1568                                         "link %p\n",
1569                                         sc->txqs[i].qnum,
1570                                         ath5k_hw_get_txdp(ah,
1571                                                         sc->txqs[i].qnum),
1572                                         sc->txqs[i].link);
1573                         }
1574         }
1575         ieee80211_wake_queues(sc->hw); /* XXX move to callers */
1576
1577         for (i = 0; i < ARRAY_SIZE(sc->txqs); i++)
1578                 if (sc->txqs[i].setup)
1579                         ath5k_txq_drainq(sc, &sc->txqs[i]);
1580 }
1581
1582 static void
1583 ath5k_txq_release(struct ath5k_softc *sc)
1584 {
1585         struct ath5k_txq *txq = sc->txqs;
1586         unsigned int i;
1587
1588         for (i = 0; i < ARRAY_SIZE(sc->txqs); i++, txq++)
1589                 if (txq->setup) {
1590                         ath5k_hw_release_tx_queue(sc->ah, txq->qnum);
1591                         txq->setup = false;
1592                 }
1593 }
1594
1595
1596
1597
1598 /*************\
1599 * RX Handling *
1600 \*************/
1601
1602 /*
1603  * Enable the receive h/w following a reset.
1604  */
1605 static int
1606 ath5k_rx_start(struct ath5k_softc *sc)
1607 {
1608         struct ath5k_hw *ah = sc->ah;
1609         struct ath5k_buf *bf;
1610         int ret;
1611
1612         sc->rxbufsize = roundup(IEEE80211_MAX_LEN, sc->cachelsz);
1613
1614         ATH5K_DBG(sc, ATH5K_DEBUG_RESET, "cachelsz %u rxbufsize %u\n",
1615                 sc->cachelsz, sc->rxbufsize);
1616
1617         spin_lock_bh(&sc->rxbuflock);
1618         sc->rxlink = NULL;
1619         list_for_each_entry(bf, &sc->rxbuf, list) {
1620                 ret = ath5k_rxbuf_setup(sc, bf);
1621                 if (ret != 0) {
1622                         spin_unlock_bh(&sc->rxbuflock);
1623                         goto err;
1624                 }
1625         }
1626         bf = list_first_entry(&sc->rxbuf, struct ath5k_buf, list);
1627         ath5k_hw_set_rxdp(ah, bf->daddr);
1628         spin_unlock_bh(&sc->rxbuflock);
1629
1630         ath5k_hw_start_rx_dma(ah);      /* enable recv descriptors */
1631         ath5k_mode_setup(sc);           /* set filters, etc. */
1632         ath5k_hw_start_rx_pcu(ah);      /* re-enable PCU/DMA engine */
1633
1634         return 0;
1635 err:
1636         return ret;
1637 }
1638
1639 /*
1640  * Disable the receive h/w in preparation for a reset.
1641  */
1642 static void
1643 ath5k_rx_stop(struct ath5k_softc *sc)
1644 {
1645         struct ath5k_hw *ah = sc->ah;
1646
1647         ath5k_hw_stop_rx_pcu(ah);       /* disable PCU */
1648         ath5k_hw_set_rx_filter(ah, 0);  /* clear recv filter */
1649         ath5k_hw_stop_rx_dma(ah);       /* disable DMA engine */
1650
1651         ath5k_debug_printrxbuffs(sc, ah);
1652
1653         sc->rxlink = NULL;              /* just in case */
1654 }
1655
1656 static unsigned int
1657 ath5k_rx_decrypted(struct ath5k_softc *sc, struct ath5k_desc *ds,
1658                 struct sk_buff *skb, struct ath5k_rx_status *rs)
1659 {
1660         struct ieee80211_hdr *hdr = (void *)skb->data;
1661         unsigned int keyix, hlen;
1662
1663         if (!(rs->rs_status & AR5K_RXERR_DECRYPT) &&
1664                         rs->rs_keyix != AR5K_RXKEYIX_INVALID)
1665                 return RX_FLAG_DECRYPTED;
1666
1667         /* Apparently when a default key is used to decrypt the packet
1668            the hw does not set the index used to decrypt.  In such cases
1669            get the index from the packet. */
1670         hlen = ieee80211_hdrlen(hdr->frame_control);
1671         if (ieee80211_has_protected(hdr->frame_control) &&
1672             !(rs->rs_status & AR5K_RXERR_DECRYPT) &&
1673             skb->len >= hlen + 4) {
1674                 keyix = skb->data[hlen + 3] >> 6;
1675
1676                 if (test_bit(keyix, sc->keymap))
1677                         return RX_FLAG_DECRYPTED;
1678         }
1679
1680         return 0;
1681 }
1682
1683
1684 static void
1685 ath5k_check_ibss_tsf(struct ath5k_softc *sc, struct sk_buff *skb,
1686                      struct ieee80211_rx_status *rxs)
1687 {
1688         u64 tsf, bc_tstamp;
1689         u32 hw_tu;
1690         struct ieee80211_mgmt *mgmt = (struct ieee80211_mgmt *)skb->data;
1691
1692         if (ieee80211_is_beacon(mgmt->frame_control) &&
1693             le16_to_cpu(mgmt->u.beacon.capab_info) & WLAN_CAPABILITY_IBSS &&
1694             memcmp(mgmt->bssid, sc->ah->ah_bssid, ETH_ALEN) == 0) {
1695                 /*
1696                  * Received an IBSS beacon with the same BSSID. Hardware *must*
1697                  * have updated the local TSF. We have to work around various
1698                  * hardware bugs, though...
1699                  */
1700                 tsf = ath5k_hw_get_tsf64(sc->ah);
1701                 bc_tstamp = le64_to_cpu(mgmt->u.beacon.timestamp);
1702                 hw_tu = TSF_TO_TU(tsf);
1703
1704                 ATH5K_DBG_UNLIMIT(sc, ATH5K_DEBUG_BEACON,
1705                         "beacon %llx mactime %llx (diff %lld) tsf now %llx\n",
1706                         (unsigned long long)bc_tstamp,
1707                         (unsigned long long)rxs->mactime,
1708                         (unsigned long long)(rxs->mactime - bc_tstamp),
1709                         (unsigned long long)tsf);
1710
1711                 /*
1712                  * Sometimes the HW will give us a wrong tstamp in the rx
1713                  * status, causing the timestamp extension to go wrong.
1714                  * (This seems to happen especially with beacon frames bigger
1715                  * than 78 byte (incl. FCS))
1716                  * But we know that the receive timestamp must be later than the
1717                  * timestamp of the beacon since HW must have synced to that.
1718                  *
1719                  * NOTE: here we assume mactime to be after the frame was
1720                  * received, not like mac80211 which defines it at the start.
1721                  */
1722                 if (bc_tstamp > rxs->mactime) {
1723                         ATH5K_DBG_UNLIMIT(sc, ATH5K_DEBUG_BEACON,
1724                                 "fixing mactime from %llx to %llx\n",
1725                                 (unsigned long long)rxs->mactime,
1726                                 (unsigned long long)tsf);
1727                         rxs->mactime = tsf;
1728                 }
1729
1730                 /*
1731                  * Local TSF might have moved higher than our beacon timers,
1732                  * in that case we have to update them to continue sending
1733                  * beacons. This also takes care of synchronizing beacon sending
1734                  * times with other stations.
1735                  */
1736                 if (hw_tu >= sc->nexttbtt)
1737                         ath5k_beacon_update_timers(sc, bc_tstamp);
1738         }
1739 }
1740
1741 static void ath5k_tasklet_beacon(unsigned long data)
1742 {
1743         struct ath5k_softc *sc = (struct ath5k_softc *) data;
1744
1745         /*
1746          * Software beacon alert--time to send a beacon.
1747          *
1748          * In IBSS mode we use this interrupt just to
1749          * keep track of the next TBTT (target beacon
1750          * transmission time) in order to detect wether
1751          * automatic TSF updates happened.
1752          */
1753         if (sc->opmode == NL80211_IFTYPE_ADHOC) {
1754                 /* XXX: only if VEOL suppported */
1755                 u64 tsf = ath5k_hw_get_tsf64(sc->ah);
1756                 sc->nexttbtt += sc->bintval;
1757                 ATH5K_DBG(sc, ATH5K_DEBUG_BEACON,
1758                                 "SWBA nexttbtt: %x hw_tu: %x "
1759                                 "TSF: %llx\n",
1760                                 sc->nexttbtt,
1761                                 TSF_TO_TU(tsf),
1762                                 (unsigned long long) tsf);
1763         } else {
1764                 spin_lock(&sc->block);
1765                 ath5k_beacon_send(sc);
1766                 spin_unlock(&sc->block);
1767         }
1768 }
1769
1770 static void
1771 ath5k_tasklet_rx(unsigned long data)
1772 {
1773         struct ieee80211_rx_status rxs = {};
1774         struct ath5k_rx_status rs = {};
1775         struct sk_buff *skb, *next_skb;
1776         dma_addr_t next_skb_addr;
1777         struct ath5k_softc *sc = (void *)data;
1778         struct ath5k_buf *bf;
1779         struct ath5k_desc *ds;
1780         int ret;
1781         int hdrlen;
1782         int padsize;
1783
1784         spin_lock(&sc->rxbuflock);
1785         if (list_empty(&sc->rxbuf)) {
1786                 ATH5K_WARN(sc, "empty rx buf pool\n");
1787                 goto unlock;
1788         }
1789         do {
1790                 rxs.flag = 0;
1791
1792                 bf = list_first_entry(&sc->rxbuf, struct ath5k_buf, list);
1793                 BUG_ON(bf->skb == NULL);
1794                 skb = bf->skb;
1795                 ds = bf->desc;
1796
1797                 /* bail if HW is still using self-linked descriptor */
1798                 if (ath5k_hw_get_rxdp(sc->ah) == bf->daddr)
1799                         break;
1800
1801                 ret = sc->ah->ah_proc_rx_desc(sc->ah, ds, &rs);
1802                 if (unlikely(ret == -EINPROGRESS))
1803                         break;
1804                 else if (unlikely(ret)) {
1805                         ATH5K_ERR(sc, "error in processing rx descriptor\n");
1806                         spin_unlock(&sc->rxbuflock);
1807                         return;
1808                 }
1809
1810                 if (unlikely(rs.rs_more)) {
1811                         ATH5K_WARN(sc, "unsupported jumbo\n");
1812                         goto next;
1813                 }
1814
1815                 if (unlikely(rs.rs_status)) {
1816                         if (rs.rs_status & AR5K_RXERR_PHY)
1817                                 goto next;
1818                         if (rs.rs_status & AR5K_RXERR_DECRYPT) {
1819                                 /*
1820                                  * Decrypt error.  If the error occurred
1821                                  * because there was no hardware key, then
1822                                  * let the frame through so the upper layers
1823                                  * can process it.  This is necessary for 5210
1824                                  * parts which have no way to setup a ``clear''
1825                                  * key cache entry.
1826                                  *
1827                                  * XXX do key cache faulting
1828                                  */
1829                                 if (rs.rs_keyix == AR5K_RXKEYIX_INVALID &&
1830                                     !(rs.rs_status & AR5K_RXERR_CRC))
1831                                         goto accept;
1832                         }
1833                         if (rs.rs_status & AR5K_RXERR_MIC) {
1834                                 rxs.flag |= RX_FLAG_MMIC_ERROR;
1835                                 goto accept;
1836                         }
1837
1838                         /* let crypto-error packets fall through in MNTR */
1839                         if ((rs.rs_status &
1840                                 ~(AR5K_RXERR_DECRYPT|AR5K_RXERR_MIC)) ||
1841                                         sc->opmode != NL80211_IFTYPE_MONITOR)
1842                                 goto next;
1843                 }
1844 accept:
1845                 next_skb = ath5k_rx_skb_alloc(sc, &next_skb_addr);
1846
1847                 /*
1848                  * If we can't replace bf->skb with a new skb under memory
1849                  * pressure, just skip this packet
1850                  */
1851                 if (!next_skb)
1852                         goto next;
1853
1854                 pci_unmap_single(sc->pdev, bf->skbaddr, sc->rxbufsize,
1855                                 PCI_DMA_FROMDEVICE);
1856                 skb_put(skb, rs.rs_datalen);
1857
1858                 /* The MAC header is padded to have 32-bit boundary if the
1859                  * packet payload is non-zero. The general calculation for
1860                  * padsize would take into account odd header lengths:
1861                  * padsize = (4 - hdrlen % 4) % 4; However, since only
1862                  * even-length headers are used, padding can only be 0 or 2
1863                  * bytes and we can optimize this a bit. In addition, we must
1864                  * not try to remove padding from short control frames that do
1865                  * not have payload. */
1866                 hdrlen = ieee80211_get_hdrlen_from_skb(skb);
1867                 padsize = ath5k_pad_size(hdrlen);
1868                 if (padsize) {
1869                         memmove(skb->data + padsize, skb->data, hdrlen);
1870                         skb_pull(skb, padsize);
1871                 }
1872
1873                 /*
1874                  * always extend the mac timestamp, since this information is
1875                  * also needed for proper IBSS merging.
1876                  *
1877                  * XXX: it might be too late to do it here, since rs_tstamp is
1878                  * 15bit only. that means TSF extension has to be done within
1879                  * 32768usec (about 32ms). it might be necessary to move this to
1880                  * the interrupt handler, like it is done in madwifi.
1881                  *
1882                  * Unfortunately we don't know when the hardware takes the rx
1883                  * timestamp (beginning of phy frame, data frame, end of rx?).
1884                  * The only thing we know is that it is hardware specific...
1885                  * On AR5213 it seems the rx timestamp is at the end of the
1886                  * frame, but i'm not sure.
1887                  *
1888                  * NOTE: mac80211 defines mactime at the beginning of the first
1889                  * data symbol. Since we don't have any time references it's
1890                  * impossible to comply to that. This affects IBSS merge only
1891                  * right now, so it's not too bad...
1892                  */
1893                 rxs.mactime = ath5k_extend_tsf(sc->ah, rs.rs_tstamp);
1894                 rxs.flag |= RX_FLAG_TSFT;
1895
1896                 rxs.freq = sc->curchan->center_freq;
1897                 rxs.band = sc->curband->band;
1898
1899                 rxs.noise = sc->ah->ah_noise_floor;
1900                 rxs.signal = rxs.noise + rs.rs_rssi;
1901
1902                 /* An rssi of 35 indicates you should be able use
1903                  * 54 Mbps reliably. A more elaborate scheme can be used
1904                  * here but it requires a map of SNR/throughput for each
1905                  * possible mode used */
1906                 rxs.qual = rs.rs_rssi * 100 / 35;
1907
1908                 /* rssi can be more than 35 though, anything above that
1909                  * should be considered at 100% */
1910                 if (rxs.qual > 100)
1911                         rxs.qual = 100;
1912
1913                 rxs.antenna = rs.rs_antenna;
1914                 rxs.rate_idx = ath5k_hw_to_driver_rix(sc, rs.rs_rate);
1915                 rxs.flag |= ath5k_rx_decrypted(sc, ds, skb, &rs);
1916
1917                 if (rxs.rate_idx >= 0 && rs.rs_rate ==
1918                     sc->curband->bitrates[rxs.rate_idx].hw_value_short)
1919                         rxs.flag |= RX_FLAG_SHORTPRE;
1920
1921                 ath5k_debug_dump_skb(sc, skb, "RX  ", 0);
1922
1923                 /* check beacons in IBSS mode */
1924                 if (sc->opmode == NL80211_IFTYPE_ADHOC)
1925                         ath5k_check_ibss_tsf(sc, skb, &rxs);
1926
1927                 __ieee80211_rx(sc->hw, skb, &rxs);
1928
1929                 bf->skb = next_skb;
1930                 bf->skbaddr = next_skb_addr;
1931 next:
1932                 list_move_tail(&bf->list, &sc->rxbuf);
1933         } while (ath5k_rxbuf_setup(sc, bf) == 0);
1934 unlock:
1935         spin_unlock(&sc->rxbuflock);
1936 }
1937
1938
1939
1940
1941 /*************\
1942 * TX Handling *
1943 \*************/
1944
1945 static void
1946 ath5k_tx_processq(struct ath5k_softc *sc, struct ath5k_txq *txq)
1947 {
1948         struct ath5k_tx_status ts = {};
1949         struct ath5k_buf *bf, *bf0;
1950         struct ath5k_desc *ds;
1951         struct sk_buff *skb;
1952         struct ieee80211_tx_info *info;
1953         int i, ret;
1954
1955         spin_lock(&txq->lock);
1956         list_for_each_entry_safe(bf, bf0, &txq->q, list) {
1957                 ds = bf->desc;
1958
1959                 ret = sc->ah->ah_proc_tx_desc(sc->ah, ds, &ts);
1960                 if (unlikely(ret == -EINPROGRESS))
1961                         break;
1962                 else if (unlikely(ret)) {
1963                         ATH5K_ERR(sc, "error %d while processing queue %u\n",
1964                                 ret, txq->qnum);
1965                         break;
1966                 }
1967
1968                 skb = bf->skb;
1969                 info = IEEE80211_SKB_CB(skb);
1970                 bf->skb = NULL;
1971
1972                 pci_unmap_single(sc->pdev, bf->skbaddr, skb->len,
1973                                 PCI_DMA_TODEVICE);
1974
1975                 ieee80211_tx_info_clear_status(info);
1976                 for (i = 0; i < 4; i++) {
1977                         struct ieee80211_tx_rate *r =
1978                                 &info->status.rates[i];
1979
1980                         if (ts.ts_rate[i]) {
1981                                 r->idx = ath5k_hw_to_driver_rix(sc, ts.ts_rate[i]);
1982                                 r->count = ts.ts_retry[i];
1983                         } else {
1984                                 r->idx = -1;
1985                                 r->count = 0;
1986                         }
1987                 }
1988
1989                 /* count the successful attempt as well */
1990                 info->status.rates[ts.ts_final_idx].count++;
1991
1992                 if (unlikely(ts.ts_status)) {
1993                         sc->ll_stats.dot11ACKFailureCount++;
1994                         if (ts.ts_status & AR5K_TXERR_FILT)
1995                                 info->flags |= IEEE80211_TX_STAT_TX_FILTERED;
1996                 } else {
1997                         info->flags |= IEEE80211_TX_STAT_ACK;
1998                         info->status.ack_signal = ts.ts_rssi;
1999                 }
2000
2001                 ieee80211_tx_status(sc->hw, skb);
2002                 sc->tx_stats[txq->qnum].count++;
2003
2004                 spin_lock(&sc->txbuflock);
2005                 sc->tx_stats[txq->qnum].len--;
2006                 list_move_tail(&bf->list, &sc->txbuf);
2007                 sc->txbuf_len++;
2008                 spin_unlock(&sc->txbuflock);
2009         }
2010         if (likely(list_empty(&txq->q)))
2011                 txq->link = NULL;
2012         spin_unlock(&txq->lock);
2013         if (sc->txbuf_len > ATH_TXBUF / 5)
2014                 ieee80211_wake_queues(sc->hw);
2015 }
2016
2017 static void
2018 ath5k_tasklet_tx(unsigned long data)
2019 {
2020         struct ath5k_softc *sc = (void *)data;
2021
2022         ath5k_tx_processq(sc, sc->txq);
2023 }
2024
2025
2026 /*****************\
2027 * Beacon handling *
2028 \*****************/
2029
2030 /*
2031  * Setup the beacon frame for transmit.
2032  */
2033 static int
2034 ath5k_beacon_setup(struct ath5k_softc *sc, struct ath5k_buf *bf)
2035 {
2036         struct sk_buff *skb = bf->skb;
2037         struct  ieee80211_tx_info *info = IEEE80211_SKB_CB(skb);
2038         struct ath5k_hw *ah = sc->ah;
2039         struct ath5k_desc *ds;
2040         int ret, antenna = 0;
2041         u32 flags;
2042
2043         bf->skbaddr = pci_map_single(sc->pdev, skb->data, skb->len,
2044                         PCI_DMA_TODEVICE);
2045         ATH5K_DBG(sc, ATH5K_DEBUG_BEACON, "skb %p [data %p len %u] "
2046                         "skbaddr %llx\n", skb, skb->data, skb->len,
2047                         (unsigned long long)bf->skbaddr);
2048         if (pci_dma_mapping_error(sc->pdev, bf->skbaddr)) {
2049                 ATH5K_ERR(sc, "beacon DMA mapping failed\n");
2050                 return -EIO;
2051         }
2052
2053         ds = bf->desc;
2054
2055         flags = AR5K_TXDESC_NOACK;
2056         if (sc->opmode == NL80211_IFTYPE_ADHOC && ath5k_hw_hasveol(ah)) {
2057                 ds->ds_link = bf->daddr;        /* self-linked */
2058                 flags |= AR5K_TXDESC_VEOL;
2059                 /*
2060                  * Let hardware handle antenna switching if txantenna is not set
2061                  */
2062         } else {
2063                 ds->ds_link = 0;
2064                 /*
2065                  * Switch antenna every 4 beacons if txantenna is not set
2066                  * XXX assumes two antennas
2067                  */
2068                 if (antenna == 0)
2069                         antenna = sc->bsent & 4 ? 2 : 1;
2070         }
2071
2072         /* FIXME: If we are in g mode and rate is a CCK rate
2073          * subtract ah->ah_txpower.txp_cck_ofdm_pwr_delta
2074          * from tx power (value is in dB units already) */
2075         ds->ds_data = bf->skbaddr;
2076         ret = ah->ah_setup_tx_desc(ah, ds, skb->len,
2077                         ieee80211_get_hdrlen_from_skb(skb),
2078                         AR5K_PKT_TYPE_BEACON, (sc->power_level * 2),
2079                         ieee80211_get_tx_rate(sc->hw, info)->hw_value,
2080                         1, AR5K_TXKEYIX_INVALID,
2081                         antenna, flags, 0, 0);
2082         if (ret)
2083                 goto err_unmap;
2084
2085         return 0;
2086 err_unmap:
2087         pci_unmap_single(sc->pdev, bf->skbaddr, skb->len, PCI_DMA_TODEVICE);
2088         return ret;
2089 }
2090
2091 /*
2092  * Transmit a beacon frame at SWBA.  Dynamic updates to the
2093  * frame contents are done as needed and the slot time is
2094  * also adjusted based on current state.
2095  *
2096  * This is called from software irq context (beacontq or restq
2097  * tasklets) or user context from ath5k_beacon_config.
2098  */
2099 static void
2100 ath5k_beacon_send(struct ath5k_softc *sc)
2101 {
2102         struct ath5k_buf *bf = sc->bbuf;
2103         struct ath5k_hw *ah = sc->ah;
2104
2105         ATH5K_DBG_UNLIMIT(sc, ATH5K_DEBUG_BEACON, "in beacon_send\n");
2106
2107         if (unlikely(bf->skb == NULL || sc->opmode == NL80211_IFTYPE_STATION ||
2108                         sc->opmode == NL80211_IFTYPE_MONITOR)) {
2109                 ATH5K_WARN(sc, "bf=%p bf_skb=%p\n", bf, bf ? bf->skb : NULL);
2110                 return;
2111         }
2112         /*
2113          * Check if the previous beacon has gone out.  If
2114          * not don't don't try to post another, skip this
2115          * period and wait for the next.  Missed beacons
2116          * indicate a problem and should not occur.  If we
2117          * miss too many consecutive beacons reset the device.
2118          */
2119         if (unlikely(ath5k_hw_num_tx_pending(ah, sc->bhalq) != 0)) {
2120                 sc->bmisscount++;
2121                 ATH5K_DBG(sc, ATH5K_DEBUG_BEACON,
2122                         "missed %u consecutive beacons\n", sc->bmisscount);
2123                 if (sc->bmisscount > 3) {               /* NB: 3 is a guess */
2124                         ATH5K_DBG(sc, ATH5K_DEBUG_BEACON,
2125                                 "stuck beacon time (%u missed)\n",
2126                                 sc->bmisscount);
2127                         tasklet_schedule(&sc->restq);
2128                 }
2129                 return;
2130         }
2131         if (unlikely(sc->bmisscount != 0)) {
2132                 ATH5K_DBG(sc, ATH5K_DEBUG_BEACON,
2133                         "resume beacon xmit after %u misses\n",
2134                         sc->bmisscount);
2135                 sc->bmisscount = 0;
2136         }
2137
2138         /*
2139          * Stop any current dma and put the new frame on the queue.
2140          * This should never fail since we check above that no frames
2141          * are still pending on the queue.
2142          */
2143         if (unlikely(ath5k_hw_stop_tx_dma(ah, sc->bhalq))) {
2144                 ATH5K_WARN(sc, "beacon queue %u didn't stop?\n", sc->bhalq);
2145                 /* NB: hw still stops DMA, so proceed */
2146         }
2147
2148         ath5k_hw_set_txdp(ah, sc->bhalq, bf->daddr);
2149         ath5k_hw_start_tx_dma(ah, sc->bhalq);
2150         ATH5K_DBG(sc, ATH5K_DEBUG_BEACON, "TXDP[%u] = %llx (%p)\n",
2151                 sc->bhalq, (unsigned long long)bf->daddr, bf->desc);
2152
2153         sc->bsent++;
2154 }
2155
2156
2157 /**
2158  * ath5k_beacon_update_timers - update beacon timers
2159  *
2160  * @sc: struct ath5k_softc pointer we are operating on
2161  * @bc_tsf: the timestamp of the beacon. 0 to reset the TSF. -1 to perform a
2162  *          beacon timer update based on the current HW TSF.
2163  *
2164  * Calculate the next target beacon transmit time (TBTT) based on the timestamp
2165  * of a received beacon or the current local hardware TSF and write it to the
2166  * beacon timer registers.
2167  *
2168  * This is called in a variety of situations, e.g. when a beacon is received,
2169  * when a TSF update has been detected, but also when an new IBSS is created or
2170  * when we otherwise know we have to update the timers, but we keep it in this
2171  * function to have it all together in one place.
2172  */
2173 static void
2174 ath5k_beacon_update_timers(struct ath5k_softc *sc, u64 bc_tsf)
2175 {
2176         struct ath5k_hw *ah = sc->ah;
2177         u32 nexttbtt, intval, hw_tu, bc_tu;
2178         u64 hw_tsf;
2179
2180         intval = sc->bintval & AR5K_BEACON_PERIOD;
2181         if (WARN_ON(!intval))
2182                 return;
2183
2184         /* beacon TSF converted to TU */
2185         bc_tu = TSF_TO_TU(bc_tsf);
2186
2187         /* current TSF converted to TU */
2188         hw_tsf = ath5k_hw_get_tsf64(ah);
2189         hw_tu = TSF_TO_TU(hw_tsf);
2190
2191 #define FUDGE 3
2192         /* we use FUDGE to make sure the next TBTT is ahead of the current TU */
2193         if (bc_tsf == -1) {
2194                 /*
2195                  * no beacons received, called internally.
2196                  * just need to refresh timers based on HW TSF.
2197                  */
2198                 nexttbtt = roundup(hw_tu + FUDGE, intval);
2199         } else if (bc_tsf == 0) {
2200                 /*
2201                  * no beacon received, probably called by ath5k_reset_tsf().
2202                  * reset TSF to start with 0.
2203                  */
2204                 nexttbtt = intval;
2205                 intval |= AR5K_BEACON_RESET_TSF;
2206         } else if (bc_tsf > hw_tsf) {
2207                 /*
2208                  * beacon received, SW merge happend but HW TSF not yet updated.
2209                  * not possible to reconfigure timers yet, but next time we
2210                  * receive a beacon with the same BSSID, the hardware will
2211                  * automatically update the TSF and then we need to reconfigure
2212                  * the timers.
2213                  */
2214                 ATH5K_DBG_UNLIMIT(sc, ATH5K_DEBUG_BEACON,
2215                         "need to wait for HW TSF sync\n");
2216                 return;
2217         } else {
2218                 /*
2219                  * most important case for beacon synchronization between STA.
2220                  *
2221                  * beacon received and HW TSF has been already updated by HW.
2222                  * update next TBTT based on the TSF of the beacon, but make
2223                  * sure it is ahead of our local TSF timer.
2224                  */
2225                 nexttbtt = bc_tu + roundup(hw_tu + FUDGE - bc_tu, intval);
2226         }
2227 #undef FUDGE
2228
2229         sc->nexttbtt = nexttbtt;
2230
2231         intval |= AR5K_BEACON_ENA;
2232         ath5k_hw_init_beacon(ah, nexttbtt, intval);
2233
2234         /*
2235          * debugging output last in order to preserve the time critical aspect
2236          * of this function
2237          */
2238         if (bc_tsf == -1)
2239                 ATH5K_DBG_UNLIMIT(sc, ATH5K_DEBUG_BEACON,
2240                         "reconfigured timers based on HW TSF\n");
2241         else if (bc_tsf == 0)
2242                 ATH5K_DBG_UNLIMIT(sc, ATH5K_DEBUG_BEACON,
2243                         "reset HW TSF and timers\n");
2244         else
2245                 ATH5K_DBG_UNLIMIT(sc, ATH5K_DEBUG_BEACON,
2246                         "updated timers based on beacon TSF\n");
2247
2248         ATH5K_DBG_UNLIMIT(sc, ATH5K_DEBUG_BEACON,
2249                           "bc_tsf %llx hw_tsf %llx bc_tu %u hw_tu %u nexttbtt %u\n",
2250                           (unsigned long long) bc_tsf,
2251                           (unsigned long long) hw_tsf, bc_tu, hw_tu, nexttbtt);
2252         ATH5K_DBG_UNLIMIT(sc, ATH5K_DEBUG_BEACON, "intval %u %s %s\n",
2253                 intval & AR5K_BEACON_PERIOD,
2254                 intval & AR5K_BEACON_ENA ? "AR5K_BEACON_ENA" : "",
2255                 intval & AR5K_BEACON_RESET_TSF ? "AR5K_BEACON_RESET_TSF" : "");
2256 }
2257
2258
2259 /**
2260  * ath5k_beacon_config - Configure the beacon queues and interrupts
2261  *
2262  * @sc: struct ath5k_softc pointer we are operating on
2263  *
2264  * In IBSS mode we use a self-linked tx descriptor if possible. We enable SWBA
2265  * interrupts to detect TSF updates only.
2266  */
2267 static void
2268 ath5k_beacon_config(struct ath5k_softc *sc)
2269 {
2270         struct ath5k_hw *ah = sc->ah;
2271         unsigned long flags;
2272
2273         ath5k_hw_set_imr(ah, 0);
2274         sc->bmisscount = 0;
2275         sc->imask &= ~(AR5K_INT_BMISS | AR5K_INT_SWBA);
2276
2277         if (sc->opmode == NL80211_IFTYPE_ADHOC ||
2278                         sc->opmode == NL80211_IFTYPE_MESH_POINT ||
2279                         sc->opmode == NL80211_IFTYPE_AP) {
2280                 /*
2281                  * In IBSS mode we use a self-linked tx descriptor and let the
2282                  * hardware send the beacons automatically. We have to load it
2283                  * only once here.
2284                  * We use the SWBA interrupt only to keep track of the beacon
2285                  * timers in order to detect automatic TSF updates.
2286                  */
2287                 ath5k_beaconq_config(sc);
2288
2289                 sc->imask |= AR5K_INT_SWBA;
2290
2291                 if (sc->opmode == NL80211_IFTYPE_ADHOC) {
2292                         if (ath5k_hw_hasveol(ah)) {
2293                                 spin_lock_irqsave(&sc->block, flags);
2294                                 ath5k_beacon_send(sc);
2295                                 spin_unlock_irqrestore(&sc->block, flags);
2296                         }
2297                 } else
2298                         ath5k_beacon_update_timers(sc, -1);
2299         }
2300
2301         ath5k_hw_set_imr(ah, sc->imask);
2302 }
2303
2304
2305 /********************\
2306 * Interrupt handling *
2307 \********************/
2308
2309 static int
2310 ath5k_init(struct ath5k_softc *sc)
2311 {
2312         struct ath5k_hw *ah = sc->ah;
2313         int ret, i;
2314
2315         mutex_lock(&sc->lock);
2316
2317         ATH5K_DBG(sc, ATH5K_DEBUG_RESET, "mode %d\n", sc->opmode);
2318
2319         /*
2320          * Stop anything previously setup.  This is safe
2321          * no matter this is the first time through or not.
2322          */
2323         ath5k_stop_locked(sc);
2324
2325         /*
2326          * The basic interface to setting the hardware in a good
2327          * state is ``reset''.  On return the hardware is known to
2328          * be powered up and with interrupts disabled.  This must
2329          * be followed by initialization of the appropriate bits
2330          * and then setup of the interrupt mask.
2331          */
2332         sc->curchan = sc->hw->conf.channel;
2333         sc->curband = &sc->sbands[sc->curchan->band];
2334         sc->imask = AR5K_INT_RXOK | AR5K_INT_RXERR | AR5K_INT_RXEOL |
2335                 AR5K_INT_RXORN | AR5K_INT_TXDESC | AR5K_INT_TXEOL |
2336                 AR5K_INT_FATAL | AR5K_INT_GLOBAL;
2337         ret = ath5k_reset(sc, false, false);
2338         if (ret)
2339                 goto done;
2340
2341         /*
2342          * Reset the key cache since some parts do not reset the
2343          * contents on initial power up or resume from suspend.
2344          */
2345         for (i = 0; i < AR5K_KEYTABLE_SIZE; i++)
2346                 ath5k_hw_reset_key(ah, i);
2347
2348         /* Set ack to be sent at low bit-rates */
2349         ath5k_hw_set_ack_bitrate_high(ah, false);
2350
2351         mod_timer(&sc->calib_tim, round_jiffies(jiffies +
2352                         msecs_to_jiffies(ath5k_calinterval * 1000)));
2353
2354         ret = 0;
2355 done:
2356         mmiowb();
2357         mutex_unlock(&sc->lock);
2358         return ret;
2359 }
2360
2361 static int
2362 ath5k_stop_locked(struct ath5k_softc *sc)
2363 {
2364         struct ath5k_hw *ah = sc->ah;
2365
2366         ATH5K_DBG(sc, ATH5K_DEBUG_RESET, "invalid %u\n",
2367                         test_bit(ATH_STAT_INVALID, sc->status));
2368
2369         /*
2370          * Shutdown the hardware and driver:
2371          *    stop output from above
2372          *    disable interrupts
2373          *    turn off timers
2374          *    turn off the radio
2375          *    clear transmit machinery
2376          *    clear receive machinery
2377          *    drain and release tx queues
2378          *    reclaim beacon resources
2379          *    power down hardware
2380          *
2381          * Note that some of this work is not possible if the
2382          * hardware is gone (invalid).
2383          */
2384         ieee80211_stop_queues(sc->hw);
2385
2386         if (!test_bit(ATH_STAT_INVALID, sc->status)) {
2387                 ath5k_led_off(sc);
2388                 ath5k_hw_set_imr(ah, 0);
2389                 synchronize_irq(sc->pdev->irq);
2390         }
2391         ath5k_txq_cleanup(sc);
2392         if (!test_bit(ATH_STAT_INVALID, sc->status)) {
2393                 ath5k_rx_stop(sc);
2394                 ath5k_hw_phy_disable(ah);
2395         } else
2396                 sc->rxlink = NULL;
2397
2398         return 0;
2399 }
2400
2401 /*
2402  * Stop the device, grabbing the top-level lock to protect
2403  * against concurrent entry through ath5k_init (which can happen
2404  * if another thread does a system call and the thread doing the
2405  * stop is preempted).
2406  */
2407 static int
2408 ath5k_stop_hw(struct ath5k_softc *sc)
2409 {
2410         int ret;
2411
2412         mutex_lock(&sc->lock);
2413         ret = ath5k_stop_locked(sc);
2414         if (ret == 0 && !test_bit(ATH_STAT_INVALID, sc->status)) {
2415                 /*
2416                  * Set the chip in full sleep mode.  Note that we are
2417                  * careful to do this only when bringing the interface
2418                  * completely to a stop.  When the chip is in this state
2419                  * it must be carefully woken up or references to
2420                  * registers in the PCI clock domain may freeze the bus
2421                  * (and system).  This varies by chip and is mostly an
2422                  * issue with newer parts that go to sleep more quickly.
2423                  */
2424                 if (sc->ah->ah_mac_srev >= 0x78) {
2425                         /*
2426                          * XXX
2427                          * don't put newer MAC revisions > 7.8 to sleep because
2428                          * of the above mentioned problems
2429                          */
2430                         ATH5K_DBG(sc, ATH5K_DEBUG_RESET, "mac version > 7.8, "
2431                                 "not putting device to sleep\n");
2432                 } else {
2433                         ATH5K_DBG(sc, ATH5K_DEBUG_RESET,
2434                                 "putting device to full sleep\n");
2435                         ath5k_hw_set_power(sc->ah, AR5K_PM_FULL_SLEEP, true, 0);
2436                 }
2437         }
2438         ath5k_txbuf_free(sc, sc->bbuf);
2439
2440         mmiowb();
2441         mutex_unlock(&sc->lock);
2442
2443         del_timer_sync(&sc->calib_tim);
2444         tasklet_kill(&sc->rxtq);
2445         tasklet_kill(&sc->txtq);
2446         tasklet_kill(&sc->restq);
2447         tasklet_kill(&sc->beacontq);
2448
2449         return ret;
2450 }
2451
2452 static irqreturn_t
2453 ath5k_intr(int irq, void *dev_id)
2454 {
2455         struct ath5k_softc *sc = dev_id;
2456         struct ath5k_hw *ah = sc->ah;
2457         enum ath5k_int status;
2458         unsigned int counter = 1000;
2459
2460         if (unlikely(test_bit(ATH_STAT_INVALID, sc->status) ||
2461                                 !ath5k_hw_is_intr_pending(ah)))
2462                 return IRQ_NONE;
2463
2464         do {
2465                 ath5k_hw_get_isr(ah, &status);          /* NB: clears IRQ too */
2466                 ATH5K_DBG(sc, ATH5K_DEBUG_INTR, "status 0x%x/0x%x\n",
2467                                 status, sc->imask);
2468                 if (unlikely(status & AR5K_INT_FATAL)) {
2469                         /*
2470                          * Fatal errors are unrecoverable.
2471                          * Typically these are caused by DMA errors.
2472                          */
2473                         tasklet_schedule(&sc->restq);
2474                 } else if (unlikely(status & AR5K_INT_RXORN)) {
2475                         tasklet_schedule(&sc->restq);
2476                 } else {
2477                         if (status & AR5K_INT_SWBA) {
2478                                 tasklet_hi_schedule(&sc->beacontq);
2479                         }
2480                         if (status & AR5K_INT_RXEOL) {
2481                                 /*
2482                                 * NB: the hardware should re-read the link when
2483                                 *     RXE bit is written, but it doesn't work at
2484                                 *     least on older hardware revs.
2485                                 */
2486                                 sc->rxlink = NULL;
2487                         }
2488                         if (status & AR5K_INT_TXURN) {
2489                                 /* bump tx trigger level */
2490                                 ath5k_hw_update_tx_triglevel(ah, true);
2491                         }
2492                         if (status & (AR5K_INT_RXOK | AR5K_INT_RXERR))
2493                                 tasklet_schedule(&sc->rxtq);
2494                         if (status & (AR5K_INT_TXOK | AR5K_INT_TXDESC
2495                                         | AR5K_INT_TXERR | AR5K_INT_TXEOL))
2496                                 tasklet_schedule(&sc->txtq);
2497                         if (status & AR5K_INT_BMISS) {
2498                                 /* TODO */
2499                         }
2500                         if (status & AR5K_INT_MIB) {
2501                                 /*
2502                                  * These stats are also used for ANI i think
2503                                  * so how about updating them more often ?
2504                                  */
2505                                 ath5k_hw_update_mib_counters(ah, &sc->ll_stats);
2506                         }
2507                 }
2508         } while (ath5k_hw_is_intr_pending(ah) && --counter > 0);
2509
2510         if (unlikely(!counter))
2511                 ATH5K_WARN(sc, "too many interrupts, giving up for now\n");
2512
2513         return IRQ_HANDLED;
2514 }
2515
2516 static void
2517 ath5k_tasklet_reset(unsigned long data)
2518 {
2519         struct ath5k_softc *sc = (void *)data;
2520
2521         ath5k_reset_wake(sc);
2522 }
2523
2524 /*
2525  * Periodically recalibrate the PHY to account
2526  * for temperature/environment changes.
2527  */
2528 static void
2529 ath5k_calibrate(unsigned long data)
2530 {
2531         struct ath5k_softc *sc = (void *)data;
2532         struct ath5k_hw *ah = sc->ah;
2533
2534         ATH5K_DBG(sc, ATH5K_DEBUG_CALIBRATE, "channel %u/%x\n",
2535                 ieee80211_frequency_to_channel(sc->curchan->center_freq),
2536                 sc->curchan->hw_value);
2537
2538         if (ath5k_hw_gainf_calibrate(ah) == AR5K_RFGAIN_NEED_CHANGE) {
2539                 /*
2540                  * Rfgain is out of bounds, reset the chip
2541                  * to load new gain values.
2542                  */
2543                 ATH5K_DBG(sc, ATH5K_DEBUG_RESET, "calibration, resetting\n");
2544                 ath5k_reset_wake(sc);
2545         }
2546         if (ath5k_hw_phy_calibrate(ah, sc->curchan))
2547                 ATH5K_ERR(sc, "calibration of channel %u failed\n",
2548                         ieee80211_frequency_to_channel(
2549                                 sc->curchan->center_freq));
2550
2551         mod_timer(&sc->calib_tim, round_jiffies(jiffies +
2552                         msecs_to_jiffies(ath5k_calinterval * 1000)));
2553 }
2554
2555
2556 /********************\
2557 * Mac80211 functions *
2558 \********************/
2559
2560 static int
2561 ath5k_tx(struct ieee80211_hw *hw, struct sk_buff *skb)
2562 {
2563         struct ath5k_softc *sc = hw->priv;
2564         struct ath5k_buf *bf;
2565         unsigned long flags;
2566         int hdrlen;
2567         int padsize;
2568
2569         ath5k_debug_dump_skb(sc, skb, "TX  ", 1);
2570
2571         if (sc->opmode == NL80211_IFTYPE_MONITOR)
2572                 ATH5K_DBG(sc, ATH5K_DEBUG_XMIT, "tx in monitor (scan?)\n");
2573
2574         /*
2575          * the hardware expects the header padded to 4 byte boundaries
2576          * if this is not the case we add the padding after the header
2577          */
2578         hdrlen = ieee80211_get_hdrlen_from_skb(skb);
2579         padsize = ath5k_pad_size(hdrlen);
2580         if (padsize) {
2581
2582                 if (skb_headroom(skb) < padsize) {
2583                         ATH5K_ERR(sc, "tx hdrlen not %%4: %d not enough"
2584                                   " headroom to pad %d\n", hdrlen, padsize);
2585                         goto drop_packet;
2586                 }
2587                 skb_push(skb, padsize);
2588                 memmove(skb->data, skb->data+padsize, hdrlen);
2589         }
2590
2591         spin_lock_irqsave(&sc->txbuflock, flags);
2592         if (list_empty(&sc->txbuf)) {
2593                 ATH5K_ERR(sc, "no further txbuf available, dropping packet\n");
2594                 spin_unlock_irqrestore(&sc->txbuflock, flags);
2595                 ieee80211_stop_queue(hw, skb_get_queue_mapping(skb));
2596                 goto drop_packet;
2597         }
2598         bf = list_first_entry(&sc->txbuf, struct ath5k_buf, list);
2599         list_del(&bf->list);
2600         sc->txbuf_len--;
2601         if (list_empty(&sc->txbuf))
2602                 ieee80211_stop_queues(hw);
2603         spin_unlock_irqrestore(&sc->txbuflock, flags);
2604
2605         bf->skb = skb;
2606
2607         if (ath5k_txbuf_setup(sc, bf)) {
2608                 bf->skb = NULL;
2609                 spin_lock_irqsave(&sc->txbuflock, flags);
2610                 list_add_tail(&bf->list, &sc->txbuf);
2611                 sc->txbuf_len++;
2612                 spin_unlock_irqrestore(&sc->txbuflock, flags);
2613                 goto drop_packet;
2614         }
2615         return NETDEV_TX_OK;
2616
2617 drop_packet:
2618         dev_kfree_skb_any(skb);
2619         return NETDEV_TX_OK;
2620 }
2621
2622 static int
2623 ath5k_reset(struct ath5k_softc *sc, bool stop, bool change_channel)
2624 {
2625         struct ath5k_hw *ah = sc->ah;
2626         int ret;
2627
2628         ATH5K_DBG(sc, ATH5K_DEBUG_RESET, "resetting\n");
2629
2630         if (stop) {
2631                 ath5k_hw_set_imr(ah, 0);
2632                 ath5k_txq_cleanup(sc);
2633                 ath5k_rx_stop(sc);
2634         }
2635         ret = ath5k_hw_reset(ah, sc->opmode, sc->curchan, true);
2636         if (ret) {
2637                 ATH5K_ERR(sc, "can't reset hardware (%d)\n", ret);
2638                 goto err;
2639         }
2640
2641         ret = ath5k_rx_start(sc);
2642         if (ret) {
2643                 ATH5K_ERR(sc, "can't start recv logic\n");
2644                 goto err;
2645         }
2646
2647         /*
2648          * Change channels and update the h/w rate map if we're switching;
2649          * e.g. 11a to 11b/g.
2650          *
2651          * We may be doing a reset in response to an ioctl that changes the
2652          * channel so update any state that might change as a result.
2653          *
2654          * XXX needed?
2655          */
2656 /*      ath5k_chan_change(sc, c); */
2657
2658         ath5k_beacon_config(sc);
2659         /* intrs are enabled by ath5k_beacon_config */
2660
2661         return 0;
2662 err:
2663         return ret;
2664 }
2665
2666 static int
2667 ath5k_reset_wake(struct ath5k_softc *sc)
2668 {
2669         int ret;
2670
2671         ret = ath5k_reset(sc, true, true);
2672         if (!ret)
2673                 ieee80211_wake_queues(sc->hw);
2674
2675         return ret;
2676 }
2677
2678 static int ath5k_start(struct ieee80211_hw *hw)
2679 {
2680         return ath5k_init(hw->priv);
2681 }
2682
2683 static void ath5k_stop(struct ieee80211_hw *hw)
2684 {
2685         ath5k_stop_hw(hw->priv);
2686 }
2687
2688 static int ath5k_add_interface(struct ieee80211_hw *hw,
2689                 struct ieee80211_if_init_conf *conf)
2690 {
2691         struct ath5k_softc *sc = hw->priv;
2692         int ret;
2693
2694         mutex_lock(&sc->lock);
2695         if (sc->vif) {
2696                 ret = 0;
2697                 goto end;
2698         }
2699
2700         sc->vif = conf->vif;
2701
2702         switch (conf->type) {
2703         case NL80211_IFTYPE_AP:
2704         case NL80211_IFTYPE_STATION:
2705         case NL80211_IFTYPE_ADHOC:
2706         case NL80211_IFTYPE_MESH_POINT:
2707         case NL80211_IFTYPE_MONITOR:
2708                 sc->opmode = conf->type;
2709                 break;
2710         default:
2711                 ret = -EOPNOTSUPP;
2712                 goto end;
2713         }
2714
2715         /* Set to a reasonable value. Note that this will
2716          * be set to mac80211's value at ath5k_config(). */
2717         sc->bintval = 1000;
2718         ath5k_hw_set_lladdr(sc->ah, conf->mac_addr);
2719
2720         ret = 0;
2721 end:
2722         mutex_unlock(&sc->lock);
2723         return ret;
2724 }
2725
2726 static void
2727 ath5k_remove_interface(struct ieee80211_hw *hw,
2728                         struct ieee80211_if_init_conf *conf)
2729 {
2730         struct ath5k_softc *sc = hw->priv;
2731         u8 mac[ETH_ALEN] = {};
2732
2733         mutex_lock(&sc->lock);
2734         if (sc->vif != conf->vif)
2735                 goto end;
2736
2737         ath5k_hw_set_lladdr(sc->ah, mac);
2738         sc->vif = NULL;
2739 end:
2740         mutex_unlock(&sc->lock);
2741 }
2742
2743 /*
2744  * TODO: Phy disable/diversity etc
2745  */
2746 static int
2747 ath5k_config(struct ieee80211_hw *hw, u32 changed)
2748 {
2749         struct ath5k_softc *sc = hw->priv;
2750         struct ieee80211_conf *conf = &hw->conf;
2751         int ret;
2752
2753         mutex_lock(&sc->lock);
2754
2755         sc->power_level = conf->power_level;
2756
2757         ret = ath5k_chan_set(sc, conf->channel);
2758
2759         mutex_unlock(&sc->lock);
2760         return ret;
2761 }
2762
2763 #define SUPPORTED_FIF_FLAGS \
2764         FIF_PROMISC_IN_BSS |  FIF_ALLMULTI | FIF_FCSFAIL | \
2765         FIF_PLCPFAIL | FIF_CONTROL | FIF_OTHER_BSS | \
2766         FIF_BCN_PRBRESP_PROMISC
2767 /*
2768  * o always accept unicast, broadcast, and multicast traffic
2769  * o multicast traffic for all BSSIDs will be enabled if mac80211
2770  *   says it should be
2771  * o maintain current state of phy ofdm or phy cck error reception.
2772  *   If the hardware detects any of these type of errors then
2773  *   ath5k_hw_get_rx_filter() will pass to us the respective
2774  *   hardware filters to be able to receive these type of frames.
2775  * o probe request frames are accepted only when operating in
2776  *   hostap, adhoc, or monitor modes
2777  * o enable promiscuous mode according to the interface state
2778  * o accept beacons:
2779  *   - when operating in adhoc mode so the 802.11 layer creates
2780  *     node table entries for peers,
2781  *   - when operating in station mode for collecting rssi data when
2782  *     the station is otherwise quiet, or
2783  *   - when scanning
2784  */
2785 static void ath5k_configure_filter(struct ieee80211_hw *hw,
2786                 unsigned int changed_flags,
2787                 unsigned int *new_flags,
2788                 int mc_count, struct dev_mc_list *mclist)
2789 {
2790         struct ath5k_softc *sc = hw->priv;
2791         struct ath5k_hw *ah = sc->ah;
2792         u32 mfilt[2], val, rfilt;
2793         u8 pos;
2794         int i;
2795
2796         mfilt[0] = 0;
2797         mfilt[1] = 0;
2798
2799         /* Only deal with supported flags */
2800         changed_flags &= SUPPORTED_FIF_FLAGS;
2801         *new_flags &= SUPPORTED_FIF_FLAGS;
2802
2803         /* If HW detects any phy or radar errors, leave those filters on.
2804          * Also, always enable Unicast, Broadcasts and Multicast
2805          * XXX: move unicast, bssid broadcasts and multicast to mac80211 */
2806         rfilt = (ath5k_hw_get_rx_filter(ah) & (AR5K_RX_FILTER_PHYERR)) |
2807                 (AR5K_RX_FILTER_UCAST | AR5K_RX_FILTER_BCAST |
2808                 AR5K_RX_FILTER_MCAST);
2809
2810         if (changed_flags & (FIF_PROMISC_IN_BSS | FIF_OTHER_BSS)) {
2811                 if (*new_flags & FIF_PROMISC_IN_BSS) {
2812                         rfilt |= AR5K_RX_FILTER_PROM;
2813                         __set_bit(ATH_STAT_PROMISC, sc->status);
2814                 } else {
2815                         __clear_bit(ATH_STAT_PROMISC, sc->status);
2816                 }
2817         }
2818
2819         /* Note, AR5K_RX_FILTER_MCAST is already enabled */
2820         if (*new_flags & FIF_ALLMULTI) {
2821                 mfilt[0] =  ~0;
2822                 mfilt[1] =  ~0;
2823         } else {
2824                 for (i = 0; i < mc_count; i++) {
2825                         if (!mclist)
2826                                 break;
2827                         /* calculate XOR of eight 6-bit values */
2828                         val = get_unaligned_le32(mclist->dmi_addr + 0);
2829                         pos = (val >> 18) ^ (val >> 12) ^ (val >> 6) ^ val;
2830                         val = get_unaligned_le32(mclist->dmi_addr + 3);
2831                         pos ^= (val >> 18) ^ (val >> 12) ^ (val >> 6) ^ val;
2832                         pos &= 0x3f;
2833                         mfilt[pos / 32] |= (1 << (pos % 32));
2834                         /* XXX: we might be able to just do this instead,
2835                         * but not sure, needs testing, if we do use this we'd
2836                         * neet to inform below to not reset the mcast */
2837                         /* ath5k_hw_set_mcast_filterindex(ah,
2838                          *      mclist->dmi_addr[5]); */
2839                         mclist = mclist->next;
2840                 }
2841         }
2842
2843         /* This is the best we can do */
2844         if (*new_flags & (FIF_FCSFAIL | FIF_PLCPFAIL))
2845                 rfilt |= AR5K_RX_FILTER_PHYERR;
2846
2847         /* FIF_BCN_PRBRESP_PROMISC really means to enable beacons
2848         * and probes for any BSSID, this needs testing */
2849         if (*new_flags & FIF_BCN_PRBRESP_PROMISC)
2850                 rfilt |= AR5K_RX_FILTER_BEACON | AR5K_RX_FILTER_PROBEREQ;
2851
2852         /* FIF_CONTROL doc says that if FIF_PROMISC_IN_BSS is not
2853          * set we should only pass on control frames for this
2854          * station. This needs testing. I believe right now this
2855          * enables *all* control frames, which is OK.. but
2856          * but we should see if we can improve on granularity */
2857         if (*new_flags & FIF_CONTROL)
2858                 rfilt |= AR5K_RX_FILTER_CONTROL;
2859
2860         /* Additional settings per mode -- this is per ath5k */
2861
2862         /* XXX move these to mac80211, and add a beacon IFF flag to mac80211 */
2863
2864         if (sc->opmode == NL80211_IFTYPE_MONITOR)
2865                 rfilt |= AR5K_RX_FILTER_CONTROL | AR5K_RX_FILTER_BEACON |
2866                         AR5K_RX_FILTER_PROBEREQ | AR5K_RX_FILTER_PROM;
2867         if (sc->opmode != NL80211_IFTYPE_STATION)
2868                 rfilt |= AR5K_RX_FILTER_PROBEREQ;
2869         if (sc->opmode != NL80211_IFTYPE_AP &&
2870                 sc->opmode != NL80211_IFTYPE_MESH_POINT &&
2871                 test_bit(ATH_STAT_PROMISC, sc->status))
2872                 rfilt |= AR5K_RX_FILTER_PROM;
2873         if ((sc->opmode == NL80211_IFTYPE_STATION && sc->assoc) ||
2874                 sc->opmode == NL80211_IFTYPE_ADHOC ||
2875                 sc->opmode == NL80211_IFTYPE_AP)
2876                 rfilt |= AR5K_RX_FILTER_BEACON;
2877         if (sc->opmode == NL80211_IFTYPE_MESH_POINT)
2878                 rfilt |= AR5K_RX_FILTER_CONTROL | AR5K_RX_FILTER_BEACON |
2879                         AR5K_RX_FILTER_PROBEREQ | AR5K_RX_FILTER_PROM;
2880
2881         /* Set filters */
2882         ath5k_hw_set_rx_filter(ah, rfilt);
2883
2884         /* Set multicast bits */
2885         ath5k_hw_set_mcast_filter(ah, mfilt[0], mfilt[1]);
2886         /* Set the cached hw filter flags, this will alter actually
2887          * be set in HW */
2888         sc->filter_flags = rfilt;
2889 }
2890
2891 static int
2892 ath5k_set_key(struct ieee80211_hw *hw, enum set_key_cmd cmd,
2893               struct ieee80211_vif *vif, struct ieee80211_sta *sta,
2894               struct ieee80211_key_conf *key)
2895 {
2896         struct ath5k_softc *sc = hw->priv;
2897         int ret = 0;
2898
2899         if (modparam_nohwcrypt)
2900                 return -EOPNOTSUPP;
2901
2902         switch (key->alg) {
2903         case ALG_WEP:
2904         case ALG_TKIP:
2905                 break;
2906         case ALG_CCMP:
2907                 return -EOPNOTSUPP;
2908         default:
2909                 WARN_ON(1);
2910                 return -EINVAL;
2911         }
2912
2913         mutex_lock(&sc->lock);
2914
2915         switch (cmd) {
2916         case SET_KEY:
2917                 ret = ath5k_hw_set_key(sc->ah, key->keyidx, key,
2918                                        sta ? sta->addr : NULL);
2919                 if (ret) {
2920                         ATH5K_ERR(sc, "can't set the key\n");
2921                         goto unlock;
2922                 }
2923                 __set_bit(key->keyidx, sc->keymap);
2924                 key->hw_key_idx = key->keyidx;
2925                 key->flags |= (IEEE80211_KEY_FLAG_GENERATE_IV |
2926                                IEEE80211_KEY_FLAG_GENERATE_MMIC);
2927                 break;
2928         case DISABLE_KEY:
2929                 ath5k_hw_reset_key(sc->ah, key->keyidx);
2930                 __clear_bit(key->keyidx, sc->keymap);
2931                 break;
2932         default:
2933                 ret = -EINVAL;
2934                 goto unlock;
2935         }
2936
2937 unlock:
2938         mmiowb();
2939         mutex_unlock(&sc->lock);
2940         return ret;
2941 }
2942
2943 static int
2944 ath5k_get_stats(struct ieee80211_hw *hw,
2945                 struct ieee80211_low_level_stats *stats)
2946 {
2947         struct ath5k_softc *sc = hw->priv;
2948         struct ath5k_hw *ah = sc->ah;
2949
2950         /* Force update */
2951         ath5k_hw_update_mib_counters(ah, &sc->ll_stats);
2952
2953         memcpy(stats, &sc->ll_stats, sizeof(sc->ll_stats));
2954
2955         return 0;
2956 }
2957
2958 static int
2959 ath5k_get_tx_stats(struct ieee80211_hw *hw,
2960                 struct ieee80211_tx_queue_stats *stats)
2961 {
2962         struct ath5k_softc *sc = hw->priv;
2963
2964         memcpy(stats, &sc->tx_stats, sizeof(sc->tx_stats));
2965
2966         return 0;
2967 }
2968
2969 static u64
2970 ath5k_get_tsf(struct ieee80211_hw *hw)
2971 {
2972         struct ath5k_softc *sc = hw->priv;
2973
2974         return ath5k_hw_get_tsf64(sc->ah);
2975 }
2976
2977 static void
2978 ath5k_set_tsf(struct ieee80211_hw *hw, u64 tsf)
2979 {
2980         struct ath5k_softc *sc = hw->priv;
2981
2982         ath5k_hw_set_tsf64(sc->ah, tsf);
2983 }
2984
2985 static void
2986 ath5k_reset_tsf(struct ieee80211_hw *hw)
2987 {
2988         struct ath5k_softc *sc = hw->priv;
2989
2990         /*
2991          * in IBSS mode we need to update the beacon timers too.
2992          * this will also reset the TSF if we call it with 0
2993          */
2994         if (sc->opmode == NL80211_IFTYPE_ADHOC)
2995                 ath5k_beacon_update_timers(sc, 0);
2996         else
2997                 ath5k_hw_reset_tsf(sc->ah);
2998 }
2999
3000 static int
3001 ath5k_beacon_update(struct ath5k_softc *sc, struct sk_buff *skb)
3002 {
3003         unsigned long flags;
3004         int ret;
3005
3006         ath5k_debug_dump_skb(sc, skb, "BC  ", 1);
3007
3008         spin_lock_irqsave(&sc->block, flags);
3009         ath5k_txbuf_free(sc, sc->bbuf);
3010         sc->bbuf->skb = skb;
3011         ret = ath5k_beacon_setup(sc, sc->bbuf);
3012         if (ret)
3013                 sc->bbuf->skb = NULL;
3014         spin_unlock_irqrestore(&sc->block, flags);
3015         if (!ret) {
3016                 ath5k_beacon_config(sc);
3017                 mmiowb();
3018         }
3019
3020         return ret;
3021 }
3022 static void
3023 set_beacon_filter(struct ieee80211_hw *hw, bool enable)
3024 {
3025         struct ath5k_softc *sc = hw->priv;
3026         struct ath5k_hw *ah = sc->ah;
3027         u32 rfilt;
3028         rfilt = ath5k_hw_get_rx_filter(ah);
3029         if (enable)
3030                 rfilt |= AR5K_RX_FILTER_BEACON;
3031         else
3032                 rfilt &= ~AR5K_RX_FILTER_BEACON;
3033         ath5k_hw_set_rx_filter(ah, rfilt);
3034         sc->filter_flags = rfilt;
3035 }
3036
3037 static void ath5k_bss_info_changed(struct ieee80211_hw *hw,
3038                                     struct ieee80211_vif *vif,
3039                                     struct ieee80211_bss_conf *bss_conf,
3040                                     u32 changes)
3041 {
3042         struct ath5k_softc *sc = hw->priv;
3043         struct ath5k_hw *ah = sc->ah;
3044
3045         mutex_lock(&sc->lock);
3046         if (WARN_ON(sc->vif != vif))
3047                 goto unlock;
3048
3049         if (changes & BSS_CHANGED_BSSID) {
3050                 /* Cache for later use during resets */
3051                 memcpy(ah->ah_bssid, bss_conf->bssid, ETH_ALEN);
3052                 /* XXX: assoc id is set to 0 for now, mac80211 doesn't have
3053                  * a clean way of letting us retrieve this yet. */
3054                 ath5k_hw_set_associd(ah, ah->ah_bssid, 0);
3055                 mmiowb();
3056         }
3057
3058         if (changes & BSS_CHANGED_BEACON_INT)
3059                 sc->bintval = bss_conf->beacon_int;
3060
3061         if (changes & BSS_CHANGED_ASSOC) {
3062                 sc->assoc = bss_conf->assoc;
3063                 if (sc->opmode == NL80211_IFTYPE_STATION)
3064                         set_beacon_filter(hw, sc->assoc);
3065         }
3066
3067         if (changes & BSS_CHANGED_BEACON &&
3068             (vif->type == NL80211_IFTYPE_ADHOC ||
3069              vif->type == NL80211_IFTYPE_MESH_POINT ||
3070              vif->type == NL80211_IFTYPE_AP)) {
3071                 struct sk_buff *beacon = ieee80211_beacon_get(hw, vif);
3072
3073                 if (beacon)
3074                         ath5k_beacon_update(sc, beacon);
3075         }
3076
3077  unlock:
3078         mutex_unlock(&sc->lock);
3079 }