872cb1cc9c41c05d2b12048450a5b187b782608f
[linux-2.6.git] / drivers / net / sc92031.c
1 /*  Silan SC92031 PCI Fast Ethernet Adapter driver
2  *
3  *  Based on vendor drivers:
4  *  Silan Fast Ethernet Netcard Driver:
5  *    MODULE_AUTHOR ("gaoyonghong");
6  *    MODULE_DESCRIPTION ("SILAN Fast Ethernet driver");
7  *    MODULE_LICENSE("GPL");
8  *  8139D Fast Ethernet driver:
9  *    (C) 2002 by gaoyonghong
10  *    MODULE_AUTHOR ("gaoyonghong");
11  *    MODULE_DESCRIPTION ("Rsltek 8139D PCI Fast Ethernet Adapter driver");
12  *    MODULE_LICENSE("GPL");
13  *  Both are almost identical and seem to be based on pci-skeleton.c
14  *
15  *  Rewritten for 2.6 by Cesar Eduardo Barros
16  */
17
18 /* Note about set_mac_address: I don't know how to change the hardware
19  * matching, so you need to enable IFF_PROMISC when using it.
20  */
21
22 #include <linux/module.h>
23 #include <linux/kernel.h>
24 #include <linux/delay.h>
25 #include <linux/pci.h>
26 #include <linux/dma-mapping.h>
27 #include <linux/netdevice.h>
28 #include <linux/etherdevice.h>
29 #include <linux/ethtool.h>
30 #include <linux/crc32.h>
31
32 #include <asm/irq.h>
33
34 #define PCI_VENDOR_ID_SILAN             0x1904
35 #define PCI_DEVICE_ID_SILAN_SC92031     0x2031
36 #define PCI_DEVICE_ID_SILAN_8139D       0x8139
37
38 #define SC92031_NAME "sc92031"
39 #define SC92031_DESCRIPTION "Silan SC92031 PCI Fast Ethernet Adapter driver"
40 #define SC92031_VERSION "2.0c"
41
42 /* BAR 0 is MMIO, BAR 1 is PIO */
43 #ifndef SC92031_USE_BAR
44 #define SC92031_USE_BAR 0
45 #endif
46
47 /* Maximum number of multicast addresses to filter (vs. Rx-all-multicast). */
48 static int multicast_filter_limit = 64;
49 module_param(multicast_filter_limit, int, 0);
50 MODULE_PARM_DESC(multicast_filter_limit,
51         "Maximum number of filtered multicast addresses");
52
53 static int media;
54 module_param(media, int, 0);
55 MODULE_PARM_DESC(media, "Media type (0x00 = autodetect,"
56         " 0x01 = 10M half, 0x02 = 10M full,"
57         " 0x04 = 100M half, 0x08 = 100M full)");
58
59 /* Size of the in-memory receive ring. */
60 #define  RX_BUF_LEN_IDX  3 /* 0==8K, 1==16K, 2==32K, 3==64K ,4==128K*/
61 #define  RX_BUF_LEN     (8192 << RX_BUF_LEN_IDX)
62
63 /* Number of Tx descriptor registers. */
64 #define  NUM_TX_DESC       4
65
66 /* max supported ethernet frame size -- must be at least (dev->mtu+14+4).*/
67 #define  MAX_ETH_FRAME_SIZE       1536
68
69 /* Size of the Tx bounce buffers -- must be at least (dev->mtu+14+4). */
70 #define  TX_BUF_SIZE       MAX_ETH_FRAME_SIZE
71 #define  TX_BUF_TOT_LEN    (TX_BUF_SIZE * NUM_TX_DESC)
72
73 /* The following settings are log_2(bytes)-4:  0 == 16 bytes .. 6==1024, 7==end of packet. */
74 #define  RX_FIFO_THRESH    7     /* Rx buffer level before first PCI xfer.  */
75
76 /* Time in jiffies before concluding the transmitter is hung. */
77 #define  TX_TIMEOUT     (4*HZ)
78
79 #define  SILAN_STATS_NUM    2    /* number of ETHTOOL_GSTATS */
80
81 /* media options */
82 #define  AUTOSELECT    0x00
83 #define  M10_HALF      0x01
84 #define  M10_FULL      0x02
85 #define  M100_HALF     0x04
86 #define  M100_FULL     0x08
87
88  /* Symbolic offsets to registers. */
89 enum  silan_registers {
90    Config0    = 0x00,         // Config0
91    Config1    = 0x04,         // Config1
92    RxBufWPtr  = 0x08,         // Rx buffer writer poiter
93    IntrStatus = 0x0C,         // Interrupt status
94    IntrMask   = 0x10,         // Interrupt mask
95    RxbufAddr  = 0x14,         // Rx buffer start address
96    RxBufRPtr  = 0x18,         // Rx buffer read pointer
97    Txstatusall = 0x1C,        // Transmit status of all descriptors
98    TxStatus0  = 0x20,         // Transmit status (Four 32bit registers).
99    TxAddr0    = 0x30,         // Tx descriptors (also four 32bit).
100    RxConfig   = 0x40,         // Rx configuration
101    MAC0       = 0x44,         // Ethernet hardware address.
102    MAR0       = 0x4C,         // Multicast filter.
103    RxStatus0  = 0x54,         // Rx status
104    TxConfig   = 0x5C,         // Tx configuration
105    PhyCtrl    = 0x60,         // physical control
106    FlowCtrlConfig = 0x64,     // flow control
107    Miicmd0    = 0x68,         // Mii command0 register
108    Miicmd1    = 0x6C,         // Mii command1 register
109    Miistatus  = 0x70,         // Mii status register
110    Timercnt   = 0x74,         // Timer counter register
111    TimerIntr  = 0x78,         // Timer interrupt register
112    PMConfig   = 0x7C,         // Power Manager configuration
113    CRC0       = 0x80,         // Power Manager CRC ( Two 32bit regisers)
114    Wakeup0    = 0x88,         // power Manager wakeup( Eight 64bit regiser)
115    LSBCRC0    = 0xC8,         // power Manager LSBCRC(Two 32bit regiser)
116    TestD0     = 0xD0,
117    TestD4     = 0xD4,
118    TestD8     = 0xD8,
119 };
120
121 #define MII_BMCR            0        // Basic mode control register
122 #define MII_BMSR            1        // Basic mode status register
123 #define MII_JAB             16
124 #define MII_OutputStatus    24
125
126 #define BMCR_FULLDPLX       0x0100    // Full duplex
127 #define BMCR_ANRESTART      0x0200    // Auto negotiation restart
128 #define BMCR_ANENABLE       0x1000    // Enable auto negotiation
129 #define BMCR_SPEED100       0x2000    // Select 100Mbps
130 #define BMSR_LSTATUS        0x0004    // Link status
131 #define PHY_16_JAB_ENB      0x1000
132 #define PHY_16_PORT_ENB     0x1
133
134 enum IntrStatusBits {
135    LinkFail       = 0x80000000,
136    LinkOK         = 0x40000000,
137    TimeOut        = 0x20000000,
138    RxOverflow     = 0x0040,
139    RxOK           = 0x0020,
140    TxOK           = 0x0001,
141    IntrBits = LinkFail|LinkOK|TimeOut|RxOverflow|RxOK|TxOK,
142 };
143
144 enum TxStatusBits {
145    TxCarrierLost = 0x20000000,
146    TxAborted     = 0x10000000,
147    TxOutOfWindow = 0x08000000,
148    TxNccShift    = 22,
149    EarlyTxThresShift = 16,
150    TxStatOK      = 0x8000,
151    TxUnderrun    = 0x4000,
152    TxOwn         = 0x2000,
153 };
154
155 enum RxStatusBits {
156    RxStatesOK   = 0x80000,
157    RxBadAlign   = 0x40000,
158    RxHugeFrame  = 0x20000,
159    RxSmallFrame = 0x10000,
160    RxCRCOK      = 0x8000,
161    RxCrlFrame   = 0x4000,
162    Rx_Broadcast = 0x2000,
163    Rx_Multicast = 0x1000,
164    RxAddrMatch  = 0x0800,
165    MiiErr       = 0x0400,
166 };
167
168 enum RxConfigBits {
169    RxFullDx    = 0x80000000,
170    RxEnb       = 0x40000000,
171    RxSmall     = 0x20000000,
172    RxHuge      = 0x10000000,
173    RxErr       = 0x08000000,
174    RxAllphys   = 0x04000000,
175    RxMulticast = 0x02000000,
176    RxBroadcast = 0x01000000,
177    RxLoopBack  = (1 << 23) | (1 << 22),
178    LowThresholdShift  = 12,
179    HighThresholdShift = 2,
180 };
181
182 enum TxConfigBits {
183    TxFullDx       = 0x80000000,
184    TxEnb          = 0x40000000,
185    TxEnbPad       = 0x20000000,
186    TxEnbHuge      = 0x10000000,
187    TxEnbFCS       = 0x08000000,
188    TxNoBackOff    = 0x04000000,
189    TxEnbPrem      = 0x02000000,
190    TxCareLostCrs  = 0x1000000,
191    TxExdCollNum   = 0xf00000,
192    TxDataRate     = 0x80000,
193 };
194
195 enum PhyCtrlconfigbits {
196    PhyCtrlAne         = 0x80000000,
197    PhyCtrlSpd100      = 0x40000000,
198    PhyCtrlSpd10       = 0x20000000,
199    PhyCtrlPhyBaseAddr = 0x1f000000,
200    PhyCtrlDux         = 0x800000,
201    PhyCtrlReset       = 0x400000,
202 };
203
204 enum FlowCtrlConfigBits {
205    FlowCtrlFullDX = 0x80000000,
206    FlowCtrlEnb    = 0x40000000,
207 };
208
209 enum Config0Bits {
210    Cfg0_Reset  = 0x80000000,
211    Cfg0_Anaoff = 0x40000000,
212    Cfg0_LDPS   = 0x20000000,
213 };
214
215 enum Config1Bits {
216    Cfg1_EarlyRx = 1 << 31,
217    Cfg1_EarlyTx = 1 << 30,
218
219    //rx buffer size
220    Cfg1_Rcv8K   = 0x0,
221    Cfg1_Rcv16K  = 0x1,
222    Cfg1_Rcv32K  = 0x3,
223    Cfg1_Rcv64K  = 0x7,
224    Cfg1_Rcv128K = 0xf,
225 };
226
227 enum MiiCmd0Bits {
228    Mii_Divider = 0x20000000,
229    Mii_WRITE   = 0x400000,
230    Mii_READ    = 0x200000,
231    Mii_SCAN    = 0x100000,
232    Mii_Tamod   = 0x80000,
233    Mii_Drvmod  = 0x40000,
234    Mii_mdc     = 0x20000,
235    Mii_mdoen   = 0x10000,
236    Mii_mdo     = 0x8000,
237    Mii_mdi     = 0x4000,
238 };
239
240 enum MiiStatusBits {
241     Mii_StatusBusy = 0x80000000,
242 };
243
244 enum PMConfigBits {
245    PM_Enable  = 1 << 31,
246    PM_LongWF  = 1 << 30,
247    PM_Magic   = 1 << 29,
248    PM_LANWake = 1 << 28,
249    PM_LWPTN   = (1 << 27 | 1<< 26),
250    PM_LinkUp  = 1 << 25,
251    PM_WakeUp  = 1 << 24,
252 };
253
254 /* Locking rules:
255  * priv->lock protects most of the fields of priv and most of the
256  * hardware registers. It does not have to protect against softirqs
257  * between sc92031_disable_interrupts and sc92031_enable_interrupts;
258  * it also does not need to be used in ->open and ->stop while the
259  * device interrupts are off.
260  * Not having to protect against softirqs is very useful due to heavy
261  * use of mdelay() at _sc92031_reset.
262  * Functions prefixed with _sc92031_ must be called with the lock held;
263  * functions prefixed with sc92031_ must be called without the lock held.
264  * Use mmiowb() before unlocking if the hardware was written to.
265  */
266
267 /* Locking rules for the interrupt:
268  * - the interrupt and the tasklet never run at the same time
269  * - neither run between sc92031_disable_interrupts and
270  *   sc92031_enable_interrupt
271  */
272
273 struct sc92031_priv {
274         spinlock_t              lock;
275         /* iomap.h cookie */
276         void __iomem            *port_base;
277         /* pci device structure */
278         struct pci_dev          *pdev;
279         /* tasklet */
280         struct tasklet_struct   tasklet;
281
282         /* CPU address of rx ring */
283         void                    *rx_ring;
284         /* PCI address of rx ring */
285         dma_addr_t              rx_ring_dma_addr;
286         /* PCI address of rx ring read pointer */
287         dma_addr_t              rx_ring_tail;
288
289         /* tx ring write index */
290         unsigned                tx_head;
291         /* tx ring read index */
292         unsigned                tx_tail;
293         /* CPU address of tx bounce buffer */
294         void                    *tx_bufs;
295         /* PCI address of tx bounce buffer */
296         dma_addr_t              tx_bufs_dma_addr;
297
298         /* copies of some hardware registers */
299         u32                     intr_status;
300         atomic_t                intr_mask;
301         u32                     rx_config;
302         u32                     tx_config;
303         u32                     pm_config;
304
305         /* copy of some flags from dev->flags */
306         unsigned int            mc_flags;
307
308         /* for ETHTOOL_GSTATS */
309         u64                     tx_timeouts;
310         u64                     rx_loss;
311
312         /* for dev->get_stats */
313         long                    rx_value;
314         struct net_device_stats stats;
315 };
316
317 /* I don't know which registers can be safely read; however, I can guess
318  * MAC0 is one of them. */
319 static inline void _sc92031_dummy_read(void __iomem *port_base)
320 {
321         ioread32(port_base + MAC0);
322 }
323
324 static u32 _sc92031_mii_wait(void __iomem *port_base)
325 {
326         u32 mii_status;
327
328         do {
329                 udelay(10);
330                 mii_status = ioread32(port_base + Miistatus);
331         } while (mii_status & Mii_StatusBusy);
332
333         return mii_status;
334 }
335
336 static u32 _sc92031_mii_cmd(void __iomem *port_base, u32 cmd0, u32 cmd1)
337 {
338         iowrite32(Mii_Divider, port_base + Miicmd0);
339
340         _sc92031_mii_wait(port_base);
341
342         iowrite32(cmd1, port_base + Miicmd1);
343         iowrite32(Mii_Divider | cmd0, port_base + Miicmd0);
344
345         return _sc92031_mii_wait(port_base);
346 }
347
348 static void _sc92031_mii_scan(void __iomem *port_base)
349 {
350         _sc92031_mii_cmd(port_base, Mii_SCAN, 0x1 << 6);
351 }
352
353 static u16 _sc92031_mii_read(void __iomem *port_base, unsigned reg)
354 {
355         return _sc92031_mii_cmd(port_base, Mii_READ, reg << 6) >> 13;
356 }
357
358 static void _sc92031_mii_write(void __iomem *port_base, unsigned reg, u16 val)
359 {
360         _sc92031_mii_cmd(port_base, Mii_WRITE, (reg << 6) | ((u32)val << 11));
361 }
362
363 static void sc92031_disable_interrupts(struct net_device *dev)
364 {
365         struct sc92031_priv *priv = netdev_priv(dev);
366         void __iomem *port_base = priv->port_base;
367
368         /* tell the tasklet/interrupt not to enable interrupts */
369         atomic_set(&priv->intr_mask, 0);
370         wmb();
371
372         /* stop interrupts */
373         iowrite32(0, port_base + IntrMask);
374         _sc92031_dummy_read(port_base);
375         mmiowb();
376
377         /* wait for any concurrent interrupt/tasklet to finish */
378         synchronize_irq(dev->irq);
379         tasklet_disable(&priv->tasklet);
380 }
381
382 static void sc92031_enable_interrupts(struct net_device *dev)
383 {
384         struct sc92031_priv *priv = netdev_priv(dev);
385         void __iomem *port_base = priv->port_base;
386
387         tasklet_enable(&priv->tasklet);
388
389         atomic_set(&priv->intr_mask, IntrBits);
390         wmb();
391
392         iowrite32(IntrBits, port_base + IntrMask);
393         mmiowb();
394 }
395
396 static void _sc92031_disable_tx_rx(struct net_device *dev)
397 {
398         struct sc92031_priv *priv = netdev_priv(dev);
399         void __iomem *port_base = priv->port_base;
400
401         priv->rx_config &= ~RxEnb;
402         priv->tx_config &= ~TxEnb;
403         iowrite32(priv->rx_config, port_base + RxConfig);
404         iowrite32(priv->tx_config, port_base + TxConfig);
405 }
406
407 static void _sc92031_enable_tx_rx(struct net_device *dev)
408 {
409         struct sc92031_priv *priv = netdev_priv(dev);
410         void __iomem *port_base = priv->port_base;
411
412         priv->rx_config |= RxEnb;
413         priv->tx_config |= TxEnb;
414         iowrite32(priv->rx_config, port_base + RxConfig);
415         iowrite32(priv->tx_config, port_base + TxConfig);
416 }
417
418 static void _sc92031_tx_clear(struct net_device *dev)
419 {
420         struct sc92031_priv *priv = netdev_priv(dev);
421
422         while (priv->tx_head - priv->tx_tail > 0) {
423                 priv->tx_tail++;
424                 priv->stats.tx_dropped++;
425         }
426         priv->tx_head = priv->tx_tail = 0;
427 }
428
429 static void _sc92031_set_mar(struct net_device *dev)
430 {
431         struct sc92031_priv *priv = netdev_priv(dev);
432         void __iomem *port_base = priv->port_base;
433         u32 mar0 = 0, mar1 = 0;
434
435         if ((dev->flags & IFF_PROMISC)
436                         || dev->mc_count > multicast_filter_limit
437                         || (dev->flags & IFF_ALLMULTI))
438                 mar0 = mar1 = 0xffffffff;
439         else if (dev->flags & IFF_MULTICAST) {
440                 struct dev_mc_list *mc_list;
441
442                 for (mc_list = dev->mc_list; mc_list; mc_list = mc_list->next) {
443                         u32 crc;
444                         unsigned bit = 0;
445
446                         crc = ~ether_crc(ETH_ALEN, mc_list->dmi_addr);
447                         crc >>= 24;
448
449                         if (crc & 0x01) bit |= 0x02;
450                         if (crc & 0x02) bit |= 0x01;
451                         if (crc & 0x10) bit |= 0x20;
452                         if (crc & 0x20) bit |= 0x10;
453                         if (crc & 0x40) bit |= 0x08;
454                         if (crc & 0x80) bit |= 0x04;
455
456                         if (bit > 31)
457                                 mar0 |= 0x1 << (bit - 32);
458                         else
459                                 mar1 |= 0x1 << bit;
460                 }
461         }
462
463         iowrite32(mar0, port_base + MAR0);
464         iowrite32(mar1, port_base + MAR0 + 4);
465 }
466
467 static void _sc92031_set_rx_config(struct net_device *dev)
468 {
469         struct sc92031_priv *priv = netdev_priv(dev);
470         void __iomem *port_base = priv->port_base;
471         unsigned int old_mc_flags;
472         u32 rx_config_bits = 0;
473
474         old_mc_flags = priv->mc_flags;
475
476         if (dev->flags & IFF_PROMISC)
477                 rx_config_bits |= RxSmall | RxHuge | RxErr | RxBroadcast
478                                 | RxMulticast | RxAllphys;
479
480         if (dev->flags & (IFF_ALLMULTI | IFF_MULTICAST))
481                 rx_config_bits |= RxMulticast;
482
483         if (dev->flags & IFF_BROADCAST)
484                 rx_config_bits |= RxBroadcast;
485
486         priv->rx_config &= ~(RxSmall | RxHuge | RxErr | RxBroadcast
487                         | RxMulticast | RxAllphys);
488         priv->rx_config |= rx_config_bits;
489
490         priv->mc_flags = dev->flags & (IFF_PROMISC | IFF_ALLMULTI
491                         | IFF_MULTICAST | IFF_BROADCAST);
492
493         if (netif_carrier_ok(dev) && priv->mc_flags != old_mc_flags)
494                 iowrite32(priv->rx_config, port_base + RxConfig);
495 }
496
497 static bool _sc92031_check_media(struct net_device *dev)
498 {
499         struct sc92031_priv *priv = netdev_priv(dev);
500         void __iomem *port_base = priv->port_base;
501         u16 bmsr;
502
503         bmsr = _sc92031_mii_read(port_base, MII_BMSR);
504         rmb();
505         if (bmsr & BMSR_LSTATUS) {
506                 bool speed_100, duplex_full;
507                 u32 flow_ctrl_config = 0;
508                 u16 output_status = _sc92031_mii_read(port_base,
509                                 MII_OutputStatus);
510                 _sc92031_mii_scan(port_base);
511
512                 speed_100 = output_status & 0x2;
513                 duplex_full = output_status & 0x4;
514
515                 /* Initial Tx/Rx configuration */
516                 priv->rx_config = (0x40 << LowThresholdShift) | (0x1c0 << HighThresholdShift);
517                 priv->tx_config = 0x48800000;
518
519                 /* NOTE: vendor driver had dead code here to enable tx padding */
520
521                 if (!speed_100)
522                         priv->tx_config |= 0x80000;
523
524                 // configure rx mode
525                 _sc92031_set_rx_config(dev);
526
527                 if (duplex_full) {
528                         priv->rx_config |= RxFullDx;
529                         priv->tx_config |= TxFullDx;
530                         flow_ctrl_config = FlowCtrlFullDX | FlowCtrlEnb;
531                 } else {
532                         priv->rx_config &= ~RxFullDx;
533                         priv->tx_config &= ~TxFullDx;
534                 }
535
536                 _sc92031_set_mar(dev);
537                 _sc92031_set_rx_config(dev);
538                 _sc92031_enable_tx_rx(dev);
539                 iowrite32(flow_ctrl_config, port_base + FlowCtrlConfig);
540
541                 netif_carrier_on(dev);
542
543                 if (printk_ratelimit())
544                         printk(KERN_INFO "%s: link up, %sMbps, %s-duplex\n",
545                                 dev->name,
546                                 speed_100 ? "100" : "10",
547                                 duplex_full ? "full" : "half");
548                 return true;
549         } else {
550                 _sc92031_mii_scan(port_base);
551
552                 netif_carrier_off(dev);
553
554                 _sc92031_disable_tx_rx(dev);
555
556                 if (printk_ratelimit())
557                         printk(KERN_INFO "%s: link down\n", dev->name);
558                 return false;
559         }
560 }
561
562 static void _sc92031_phy_reset(struct net_device *dev)
563 {
564         struct sc92031_priv *priv = netdev_priv(dev);
565         void __iomem *port_base = priv->port_base;
566         u32 phy_ctrl;
567
568         phy_ctrl = ioread32(port_base + PhyCtrl);
569         phy_ctrl &= ~(PhyCtrlDux | PhyCtrlSpd100 | PhyCtrlSpd10);
570         phy_ctrl |= PhyCtrlAne | PhyCtrlReset;
571
572         switch (media) {
573         default:
574         case AUTOSELECT:
575                 phy_ctrl |= PhyCtrlDux | PhyCtrlSpd100 | PhyCtrlSpd10;
576                 break;
577         case M10_HALF:
578                 phy_ctrl |= PhyCtrlSpd10;
579                 break;
580         case M10_FULL:
581                 phy_ctrl |= PhyCtrlDux | PhyCtrlSpd10;
582                 break;
583         case M100_HALF:
584                 phy_ctrl |= PhyCtrlSpd100;
585                 break;
586         case M100_FULL:
587                 phy_ctrl |= PhyCtrlDux | PhyCtrlSpd100;
588                 break;
589         }
590
591         iowrite32(phy_ctrl, port_base + PhyCtrl);
592         mdelay(10);
593
594         phy_ctrl &= ~PhyCtrlReset;
595         iowrite32(phy_ctrl, port_base + PhyCtrl);
596         mdelay(1);
597
598         _sc92031_mii_write(port_base, MII_JAB,
599                         PHY_16_JAB_ENB | PHY_16_PORT_ENB);
600         _sc92031_mii_scan(port_base);
601
602         netif_carrier_off(dev);
603         netif_stop_queue(dev);
604 }
605
606 static void _sc92031_reset(struct net_device *dev)
607 {
608         struct sc92031_priv *priv = netdev_priv(dev);
609         void __iomem *port_base = priv->port_base;
610
611         /* disable PM */
612         iowrite32(0, port_base + PMConfig);
613
614         /* soft reset the chip */
615         iowrite32(Cfg0_Reset, port_base + Config0);
616         mdelay(200);
617
618         iowrite32(0, port_base + Config0);
619         mdelay(10);
620
621         /* disable interrupts */
622         iowrite32(0, port_base + IntrMask);
623
624         /* clear multicast address */
625         iowrite32(0, port_base + MAR0);
626         iowrite32(0, port_base + MAR0 + 4);
627
628         /* init rx ring */
629         iowrite32(priv->rx_ring_dma_addr, port_base + RxbufAddr);
630         priv->rx_ring_tail = priv->rx_ring_dma_addr;
631
632         /* init tx ring */
633         _sc92031_tx_clear(dev);
634
635         /* clear old register values */
636         priv->intr_status = 0;
637         atomic_set(&priv->intr_mask, 0);
638         priv->rx_config = 0;
639         priv->tx_config = 0;
640         priv->mc_flags = 0;
641
642         /* configure rx buffer size */
643         /* NOTE: vendor driver had dead code here to enable early tx/rx */
644         iowrite32(Cfg1_Rcv64K, port_base + Config1);
645
646         _sc92031_phy_reset(dev);
647         _sc92031_check_media(dev);
648
649         /* calculate rx fifo overflow */
650         priv->rx_value = 0;
651
652         /* enable PM */
653         iowrite32(priv->pm_config, port_base + PMConfig);
654
655         /* clear intr register */
656         ioread32(port_base + IntrStatus);
657 }
658
659 static void _sc92031_tx_tasklet(struct net_device *dev)
660 {
661         struct sc92031_priv *priv = netdev_priv(dev);
662         void __iomem *port_base = priv->port_base;
663
664         unsigned old_tx_tail;
665         unsigned entry;
666         u32 tx_status;
667
668         old_tx_tail = priv->tx_tail;
669         while (priv->tx_head - priv->tx_tail > 0) {
670                 entry = priv->tx_tail % NUM_TX_DESC;
671                 tx_status = ioread32(port_base + TxStatus0 + entry * 4);
672
673                 if (!(tx_status & (TxStatOK | TxUnderrun | TxAborted)))
674                         break;
675
676                 priv->tx_tail++;
677
678                 if (tx_status & TxStatOK) {
679                         priv->stats.tx_bytes += tx_status & 0x1fff;
680                         priv->stats.tx_packets++;
681                         /* Note: TxCarrierLost is always asserted at 100mbps. */
682                         priv->stats.collisions += (tx_status >> 22) & 0xf;
683                 }
684
685                 if (tx_status & (TxOutOfWindow | TxAborted)) {
686                         priv->stats.tx_errors++;
687
688                         if (tx_status & TxAborted)
689                                 priv->stats.tx_aborted_errors++;
690
691                         if (tx_status & TxCarrierLost)
692                                 priv->stats.tx_carrier_errors++;
693
694                         if (tx_status & TxOutOfWindow)
695                                 priv->stats.tx_window_errors++;
696                 }
697
698                 if (tx_status & TxUnderrun)
699                         priv->stats.tx_fifo_errors++;
700         }
701
702         if (priv->tx_tail != old_tx_tail)
703                 if (netif_queue_stopped(dev))
704                         netif_wake_queue(dev);
705 }
706
707 static void _sc92031_rx_tasklet_error(u32 rx_status,
708                 struct sc92031_priv *priv, unsigned rx_size)
709 {
710         if(rx_size > (MAX_ETH_FRAME_SIZE + 4) || rx_size < 16) {
711                 priv->stats.rx_errors++;
712                 priv->stats.rx_length_errors++;
713         }
714
715         if (!(rx_status & RxStatesOK)) {
716                 priv->stats.rx_errors++;
717
718                 if (rx_status & (RxHugeFrame | RxSmallFrame))
719                         priv->stats.rx_length_errors++;
720
721                 if (rx_status & RxBadAlign)
722                         priv->stats.rx_frame_errors++;
723
724                 if (!(rx_status & RxCRCOK))
725                         priv->stats.rx_crc_errors++;
726         } else
727                 priv->rx_loss++;
728 }
729
730 static void _sc92031_rx_tasklet(struct net_device *dev)
731 {
732         struct sc92031_priv *priv = netdev_priv(dev);
733         void __iomem *port_base = priv->port_base;
734
735         dma_addr_t rx_ring_head;
736         unsigned rx_len;
737         unsigned rx_ring_offset;
738         void *rx_ring = priv->rx_ring;
739
740         rx_ring_head = ioread32(port_base + RxBufWPtr);
741         rmb();
742
743         /* rx_ring_head is only 17 bits in the RxBufWPtr register.
744          * we need to change it to 32 bits physical address
745          */
746         rx_ring_head &= (dma_addr_t)(RX_BUF_LEN - 1);
747         rx_ring_head |= priv->rx_ring_dma_addr & ~(dma_addr_t)(RX_BUF_LEN - 1);
748         if (rx_ring_head < priv->rx_ring_dma_addr)
749                 rx_ring_head += RX_BUF_LEN;
750
751         if (rx_ring_head >= priv->rx_ring_tail)
752                 rx_len = rx_ring_head - priv->rx_ring_tail;
753         else
754                 rx_len = RX_BUF_LEN - (priv->rx_ring_tail - rx_ring_head);
755
756         if (!rx_len)
757                 return;
758
759         if (unlikely(rx_len > RX_BUF_LEN)) {
760                 if (printk_ratelimit())
761                         printk(KERN_ERR "%s: rx packets length > rx buffer\n",
762                                         dev->name);
763                 return;
764         }
765
766         rx_ring_offset = (priv->rx_ring_tail - priv->rx_ring_dma_addr) % RX_BUF_LEN;
767
768         while (rx_len) {
769                 u32 rx_status;
770                 unsigned rx_size, rx_size_align, pkt_size;
771                 struct sk_buff *skb;
772
773                 rx_status = le32_to_cpup((__le32 *)(rx_ring + rx_ring_offset));
774                 rmb();
775
776                 rx_size = rx_status >> 20;
777                 rx_size_align = (rx_size + 3) & ~3;     // for 4 bytes aligned
778                 pkt_size = rx_size - 4; // Omit the four octet CRC from the length.
779
780                 rx_ring_offset = (rx_ring_offset + 4) % RX_BUF_LEN;
781
782                 if (unlikely(rx_status == 0
783                                 || rx_size > (MAX_ETH_FRAME_SIZE + 4)
784                                 || rx_size < 16
785                                 || !(rx_status & RxStatesOK))) {
786                         _sc92031_rx_tasklet_error(rx_status, priv, rx_size);
787                         break;
788                 }
789
790                 if (unlikely(rx_size_align + 4 > rx_len)) {
791                         if (printk_ratelimit())
792                                 printk(KERN_ERR "%s: rx_len is too small\n", dev->name);
793                         break;
794                 }
795
796                 rx_len -= rx_size_align + 4;
797
798                 skb = dev_alloc_skb(pkt_size + NET_IP_ALIGN);
799                 if (unlikely(!skb)) {
800                         if (printk_ratelimit())
801                                 printk(KERN_ERR "%s: Couldn't allocate a skb_buff for a packet of size %u\n",
802                                                 dev->name, pkt_size);
803                         goto next;
804                 }
805
806                 skb_reserve(skb, NET_IP_ALIGN);
807
808                 if ((rx_ring_offset + pkt_size) > RX_BUF_LEN) {
809                         memcpy(skb_put(skb, RX_BUF_LEN - rx_ring_offset),
810                                 rx_ring + rx_ring_offset, RX_BUF_LEN - rx_ring_offset);
811                         memcpy(skb_put(skb, pkt_size - (RX_BUF_LEN - rx_ring_offset)),
812                                 rx_ring, pkt_size - (RX_BUF_LEN - rx_ring_offset));
813                 } else {
814                         memcpy(skb_put(skb, pkt_size), rx_ring + rx_ring_offset, pkt_size);
815                 }
816
817                 skb->protocol = eth_type_trans(skb, dev);
818                 dev->last_rx = jiffies;
819                 netif_rx(skb);
820
821                 priv->stats.rx_bytes += pkt_size;
822                 priv->stats.rx_packets++;
823
824                 if (rx_status & Rx_Multicast)
825                         priv->stats.multicast++;
826
827         next:
828                 rx_ring_offset = (rx_ring_offset + rx_size_align) % RX_BUF_LEN;
829         }
830         mb();
831
832         priv->rx_ring_tail = rx_ring_head;
833         iowrite32(priv->rx_ring_tail, port_base + RxBufRPtr);
834 }
835
836 static void _sc92031_link_tasklet(struct net_device *dev)
837 {
838         struct sc92031_priv *priv = netdev_priv(dev);
839
840         if (_sc92031_check_media(dev))
841                 netif_wake_queue(dev);
842         else {
843                 netif_stop_queue(dev);
844                 priv->stats.tx_carrier_errors++;
845         }
846 }
847
848 static void sc92031_tasklet(unsigned long data)
849 {
850         struct net_device *dev = (struct net_device *)data;
851         struct sc92031_priv *priv = netdev_priv(dev);
852         void __iomem *port_base = priv->port_base;
853         u32 intr_status, intr_mask;
854
855         intr_status = priv->intr_status;
856
857         spin_lock(&priv->lock);
858
859         if (unlikely(!netif_running(dev)))
860                 goto out;
861
862         if (intr_status & TxOK)
863                 _sc92031_tx_tasklet(dev);
864
865         if (intr_status & RxOK)
866                 _sc92031_rx_tasklet(dev);
867
868         if (intr_status & RxOverflow)
869                 priv->stats.rx_errors++;
870
871         if (intr_status & TimeOut) {
872                 priv->stats.rx_errors++;
873                 priv->stats.rx_length_errors++;
874         }
875
876         if (intr_status & (LinkFail | LinkOK))
877                 _sc92031_link_tasklet(dev);
878
879 out:
880         intr_mask = atomic_read(&priv->intr_mask);
881         rmb();
882
883         iowrite32(intr_mask, port_base + IntrMask);
884         mmiowb();
885
886         spin_unlock(&priv->lock);
887 }
888
889 static irqreturn_t sc92031_interrupt(int irq, void *dev_id)
890 {
891         struct net_device *dev = dev_id;
892         struct sc92031_priv *priv = netdev_priv(dev);
893         void __iomem *port_base = priv->port_base;
894         u32 intr_status, intr_mask;
895
896         /* mask interrupts before clearing IntrStatus */
897         iowrite32(0, port_base + IntrMask);
898         _sc92031_dummy_read(port_base);
899
900         intr_status = ioread32(port_base + IntrStatus);
901         if (unlikely(intr_status == 0xffffffff))
902                 return IRQ_NONE;        // hardware has gone missing
903
904         intr_status &= IntrBits;
905         if (!intr_status)
906                 goto out_none;
907
908         priv->intr_status = intr_status;
909         tasklet_schedule(&priv->tasklet);
910
911         return IRQ_HANDLED;
912
913 out_none:
914         intr_mask = atomic_read(&priv->intr_mask);
915         rmb();
916
917         iowrite32(intr_mask, port_base + IntrMask);
918         mmiowb();
919
920         return IRQ_NONE;
921 }
922
923 static struct net_device_stats *sc92031_get_stats(struct net_device *dev)
924 {
925         struct sc92031_priv *priv = netdev_priv(dev);
926         void __iomem *port_base = priv->port_base;
927
928         // FIXME I do not understand what is this trying to do.
929         if (netif_running(dev)) {
930                 int temp;
931
932                 spin_lock_bh(&priv->lock);
933
934                 /* Update the error count. */
935                 temp = (ioread32(port_base + RxStatus0) >> 16) & 0xffff;
936
937                 if (temp == 0xffff) {
938                         priv->rx_value += temp;
939                         priv->stats.rx_fifo_errors = priv->rx_value;
940                 } else {
941                         priv->stats.rx_fifo_errors = temp + priv->rx_value;
942                 }
943
944                 spin_unlock_bh(&priv->lock);
945         }
946
947         return &priv->stats;
948 }
949
950 static int sc92031_start_xmit(struct sk_buff *skb, struct net_device *dev)
951 {
952         int err = 0;
953         struct sc92031_priv *priv = netdev_priv(dev);
954         void __iomem *port_base = priv->port_base;
955
956         unsigned len;
957         unsigned entry;
958         u32 tx_status;
959
960         if (unlikely(skb->len > TX_BUF_SIZE)) {
961                 err = -EMSGSIZE;
962                 priv->stats.tx_dropped++;
963                 goto out;
964         }
965
966         spin_lock(&priv->lock);
967
968         if (unlikely(!netif_carrier_ok(dev))) {
969                 err = -ENOLINK;
970                 priv->stats.tx_dropped++;
971                 goto out_unlock;
972         }
973
974         BUG_ON(priv->tx_head - priv->tx_tail >= NUM_TX_DESC);
975
976         entry = priv->tx_head++ % NUM_TX_DESC;
977
978         skb_copy_and_csum_dev(skb, priv->tx_bufs + entry * TX_BUF_SIZE);
979
980         len = skb->len;
981         if (unlikely(len < ETH_ZLEN)) {
982                 memset(priv->tx_bufs + entry * TX_BUF_SIZE + len,
983                                 0, ETH_ZLEN - len);
984                 len = ETH_ZLEN;
985         }
986
987         wmb();
988
989         if (len < 100)
990                 tx_status = len;
991         else if (len < 300)
992                 tx_status = 0x30000 | len;
993         else
994                 tx_status = 0x50000 | len;
995
996         iowrite32(priv->tx_bufs_dma_addr + entry * TX_BUF_SIZE,
997                         port_base + TxAddr0 + entry * 4);
998         iowrite32(tx_status, port_base + TxStatus0 + entry * 4);
999         mmiowb();
1000
1001         dev->trans_start = jiffies;
1002
1003         if (priv->tx_head - priv->tx_tail >= NUM_TX_DESC)
1004                 netif_stop_queue(dev);
1005
1006 out_unlock:
1007         spin_unlock(&priv->lock);
1008
1009 out:
1010         dev_kfree_skb(skb);
1011
1012         return err;
1013 }
1014
1015 static int sc92031_open(struct net_device *dev)
1016 {
1017         int err;
1018         struct sc92031_priv *priv = netdev_priv(dev);
1019         struct pci_dev *pdev = priv->pdev;
1020
1021         priv->rx_ring = pci_alloc_consistent(pdev, RX_BUF_LEN,
1022                         &priv->rx_ring_dma_addr);
1023         if (unlikely(!priv->rx_ring)) {
1024                 err = -ENOMEM;
1025                 goto out_alloc_rx_ring;
1026         }
1027
1028         priv->tx_bufs = pci_alloc_consistent(pdev, TX_BUF_TOT_LEN,
1029                         &priv->tx_bufs_dma_addr);
1030         if (unlikely(!priv->tx_bufs)) {
1031                 err = -ENOMEM;
1032                 goto out_alloc_tx_bufs;
1033         }
1034         priv->tx_head = priv->tx_tail = 0;
1035
1036         err = request_irq(pdev->irq, sc92031_interrupt,
1037                         IRQF_SHARED, dev->name, dev);
1038         if (unlikely(err < 0))
1039                 goto out_request_irq;
1040
1041         priv->pm_config = 0;
1042
1043         /* Interrupts already disabled by sc92031_stop or sc92031_probe */
1044         spin_lock_bh(&priv->lock);
1045
1046         _sc92031_reset(dev);
1047         mmiowb();
1048
1049         spin_unlock_bh(&priv->lock);
1050         sc92031_enable_interrupts(dev);
1051
1052         if (netif_carrier_ok(dev))
1053                 netif_start_queue(dev);
1054         else
1055                 netif_tx_disable(dev);
1056
1057         return 0;
1058
1059 out_request_irq:
1060         pci_free_consistent(pdev, TX_BUF_TOT_LEN, priv->tx_bufs,
1061                         priv->tx_bufs_dma_addr);
1062 out_alloc_tx_bufs:
1063         pci_free_consistent(pdev, RX_BUF_LEN, priv->rx_ring,
1064                         priv->rx_ring_dma_addr);
1065 out_alloc_rx_ring:
1066         return err;
1067 }
1068
1069 static int sc92031_stop(struct net_device *dev)
1070 {
1071         struct sc92031_priv *priv = netdev_priv(dev);
1072         struct pci_dev *pdev = priv->pdev;
1073
1074         netif_tx_disable(dev);
1075
1076         /* Disable interrupts, stop Tx and Rx. */
1077         sc92031_disable_interrupts(dev);
1078
1079         spin_lock_bh(&priv->lock);
1080
1081         _sc92031_disable_tx_rx(dev);
1082         _sc92031_tx_clear(dev);
1083         mmiowb();
1084
1085         spin_unlock_bh(&priv->lock);
1086
1087         free_irq(pdev->irq, dev);
1088         pci_free_consistent(pdev, TX_BUF_TOT_LEN, priv->tx_bufs,
1089                         priv->tx_bufs_dma_addr);
1090         pci_free_consistent(pdev, RX_BUF_LEN, priv->rx_ring,
1091                         priv->rx_ring_dma_addr);
1092
1093         return 0;
1094 }
1095
1096 static void sc92031_set_multicast_list(struct net_device *dev)
1097 {
1098         struct sc92031_priv *priv = netdev_priv(dev);
1099
1100         spin_lock_bh(&priv->lock);
1101
1102         _sc92031_set_mar(dev);
1103         _sc92031_set_rx_config(dev);
1104         mmiowb();
1105
1106         spin_unlock_bh(&priv->lock);
1107 }
1108
1109 static void sc92031_tx_timeout(struct net_device *dev)
1110 {
1111         struct sc92031_priv *priv = netdev_priv(dev);
1112
1113         /* Disable interrupts by clearing the interrupt mask.*/
1114         sc92031_disable_interrupts(dev);
1115
1116         spin_lock(&priv->lock);
1117
1118         priv->tx_timeouts++;
1119
1120         _sc92031_reset(dev);
1121         mmiowb();
1122
1123         spin_unlock(&priv->lock);
1124
1125         /* enable interrupts */
1126         sc92031_enable_interrupts(dev);
1127
1128         if (netif_carrier_ok(dev))
1129                 netif_wake_queue(dev);
1130 }
1131
1132 #ifdef CONFIG_NET_POLL_CONTROLLER
1133 static void sc92031_poll_controller(struct net_device *dev)
1134 {
1135         disable_irq(dev->irq);
1136         if (sc92031_interrupt(dev->irq, dev) != IRQ_NONE)
1137                 sc92031_tasklet((unsigned long)dev);
1138         enable_irq(dev->irq);
1139 }
1140 #endif
1141
1142 static int sc92031_ethtool_get_settings(struct net_device *dev,
1143                 struct ethtool_cmd *cmd)
1144 {
1145         struct sc92031_priv *priv = netdev_priv(dev);
1146         void __iomem *port_base = priv->port_base;
1147         u8 phy_address;
1148         u32 phy_ctrl;
1149         u16 output_status;
1150
1151         spin_lock_bh(&priv->lock);
1152
1153         phy_address = ioread32(port_base + Miicmd1) >> 27;
1154         phy_ctrl = ioread32(port_base + PhyCtrl);
1155
1156         output_status = _sc92031_mii_read(port_base, MII_OutputStatus);
1157         _sc92031_mii_scan(port_base);
1158         mmiowb();
1159
1160         spin_unlock_bh(&priv->lock);
1161
1162         cmd->supported = SUPPORTED_10baseT_Half | SUPPORTED_10baseT_Full
1163                         | SUPPORTED_100baseT_Half | SUPPORTED_100baseT_Full
1164                         | SUPPORTED_Autoneg | SUPPORTED_TP | SUPPORTED_MII;
1165
1166         cmd->advertising = ADVERTISED_TP | ADVERTISED_MII;
1167
1168         if ((phy_ctrl & (PhyCtrlDux | PhyCtrlSpd100 | PhyCtrlSpd10))
1169                         == (PhyCtrlDux | PhyCtrlSpd100 | PhyCtrlSpd10))
1170                 cmd->advertising |= ADVERTISED_Autoneg;
1171
1172         if ((phy_ctrl & PhyCtrlSpd10) == PhyCtrlSpd10)
1173                 cmd->advertising |= ADVERTISED_10baseT_Half;
1174
1175         if ((phy_ctrl & (PhyCtrlSpd10 | PhyCtrlDux))
1176                         == (PhyCtrlSpd10 | PhyCtrlDux))
1177                 cmd->advertising |= ADVERTISED_10baseT_Full;
1178
1179         if ((phy_ctrl & PhyCtrlSpd100) == PhyCtrlSpd100)
1180                 cmd->advertising |= ADVERTISED_100baseT_Half;
1181
1182         if ((phy_ctrl & (PhyCtrlSpd100 | PhyCtrlDux))
1183                         == (PhyCtrlSpd100 | PhyCtrlDux))
1184                 cmd->advertising |= ADVERTISED_100baseT_Full;
1185
1186         if (phy_ctrl & PhyCtrlAne)
1187                 cmd->advertising |= ADVERTISED_Autoneg;
1188
1189         cmd->speed = (output_status & 0x2) ? SPEED_100 : SPEED_10;
1190         cmd->duplex = (output_status & 0x4) ? DUPLEX_FULL : DUPLEX_HALF;
1191         cmd->port = PORT_MII;
1192         cmd->phy_address = phy_address;
1193         cmd->transceiver = XCVR_INTERNAL;
1194         cmd->autoneg = (phy_ctrl & PhyCtrlAne) ? AUTONEG_ENABLE : AUTONEG_DISABLE;
1195
1196         return 0;
1197 }
1198
1199 static int sc92031_ethtool_set_settings(struct net_device *dev,
1200                 struct ethtool_cmd *cmd)
1201 {
1202         struct sc92031_priv *priv = netdev_priv(dev);
1203         void __iomem *port_base = priv->port_base;
1204         u32 phy_ctrl;
1205         u32 old_phy_ctrl;
1206
1207         if (!(cmd->speed == SPEED_10 || cmd->speed == SPEED_100))
1208                 return -EINVAL;
1209         if (!(cmd->duplex == DUPLEX_HALF || cmd->duplex == DUPLEX_FULL))
1210                 return -EINVAL;
1211         if (!(cmd->port == PORT_MII))
1212                 return -EINVAL;
1213         if (!(cmd->phy_address == 0x1f))
1214                 return -EINVAL;
1215         if (!(cmd->transceiver == XCVR_INTERNAL))
1216                 return -EINVAL;
1217         if (!(cmd->autoneg == AUTONEG_DISABLE || cmd->autoneg == AUTONEG_ENABLE))
1218                 return -EINVAL;
1219
1220         if (cmd->autoneg == AUTONEG_ENABLE) {
1221                 if (!(cmd->advertising & (ADVERTISED_Autoneg
1222                                 | ADVERTISED_100baseT_Full
1223                                 | ADVERTISED_100baseT_Half
1224                                 | ADVERTISED_10baseT_Full
1225                                 | ADVERTISED_10baseT_Half)))
1226                         return -EINVAL;
1227
1228                 phy_ctrl = PhyCtrlAne;
1229
1230                 // FIXME: I'm not sure what the original code was trying to do
1231                 if (cmd->advertising & ADVERTISED_Autoneg)
1232                         phy_ctrl |= PhyCtrlDux | PhyCtrlSpd100 | PhyCtrlSpd10;
1233                 if (cmd->advertising & ADVERTISED_100baseT_Full)
1234                         phy_ctrl |= PhyCtrlDux | PhyCtrlSpd100;
1235                 if (cmd->advertising & ADVERTISED_100baseT_Half)
1236                         phy_ctrl |= PhyCtrlSpd100;
1237                 if (cmd->advertising & ADVERTISED_10baseT_Full)
1238                         phy_ctrl |= PhyCtrlSpd10 | PhyCtrlDux;
1239                 if (cmd->advertising & ADVERTISED_10baseT_Half)
1240                         phy_ctrl |= PhyCtrlSpd10;
1241         } else {
1242                 // FIXME: Whole branch guessed
1243                 phy_ctrl = 0;
1244
1245                 if (cmd->speed == SPEED_10)
1246                         phy_ctrl |= PhyCtrlSpd10;
1247                 else /* cmd->speed == SPEED_100 */
1248                         phy_ctrl |= PhyCtrlSpd100;
1249
1250                 if (cmd->duplex == DUPLEX_FULL)
1251                         phy_ctrl |= PhyCtrlDux;
1252         }
1253
1254         spin_lock_bh(&priv->lock);
1255
1256         old_phy_ctrl = ioread32(port_base + PhyCtrl);
1257         phy_ctrl |= old_phy_ctrl & ~(PhyCtrlAne | PhyCtrlDux
1258                         | PhyCtrlSpd100 | PhyCtrlSpd10);
1259         if (phy_ctrl != old_phy_ctrl)
1260                 iowrite32(phy_ctrl, port_base + PhyCtrl);
1261
1262         spin_unlock_bh(&priv->lock);
1263
1264         return 0;
1265 }
1266
1267 static void sc92031_ethtool_get_drvinfo(struct net_device *dev,
1268                 struct ethtool_drvinfo *drvinfo)
1269 {
1270         struct sc92031_priv *priv = netdev_priv(dev);
1271         struct pci_dev *pdev = priv->pdev;
1272
1273         strcpy(drvinfo->driver, SC92031_NAME);
1274         strcpy(drvinfo->version, SC92031_VERSION);
1275         strcpy(drvinfo->bus_info, pci_name(pdev));
1276 }
1277
1278 static void sc92031_ethtool_get_wol(struct net_device *dev,
1279                 struct ethtool_wolinfo *wolinfo)
1280 {
1281         struct sc92031_priv *priv = netdev_priv(dev);
1282         void __iomem *port_base = priv->port_base;
1283         u32 pm_config;
1284
1285         spin_lock_bh(&priv->lock);
1286         pm_config = ioread32(port_base + PMConfig);
1287         spin_unlock_bh(&priv->lock);
1288
1289         // FIXME: Guessed
1290         wolinfo->supported = WAKE_PHY | WAKE_MAGIC
1291                         | WAKE_UCAST | WAKE_MCAST | WAKE_BCAST;
1292         wolinfo->wolopts = 0;
1293
1294         if (pm_config & PM_LinkUp)
1295                 wolinfo->wolopts |= WAKE_PHY;
1296
1297         if (pm_config & PM_Magic)
1298                 wolinfo->wolopts |= WAKE_MAGIC;
1299
1300         if (pm_config & PM_WakeUp)
1301                 // FIXME: Guessed
1302                 wolinfo->wolopts |= WAKE_UCAST | WAKE_MCAST | WAKE_BCAST;
1303 }
1304
1305 static int sc92031_ethtool_set_wol(struct net_device *dev,
1306                 struct ethtool_wolinfo *wolinfo)
1307 {
1308         struct sc92031_priv *priv = netdev_priv(dev);
1309         void __iomem *port_base = priv->port_base;
1310         u32 pm_config;
1311
1312         spin_lock_bh(&priv->lock);
1313
1314         pm_config = ioread32(port_base + PMConfig)
1315                         & ~(PM_LinkUp | PM_Magic | PM_WakeUp);
1316
1317         if (wolinfo->wolopts & WAKE_PHY)
1318                 pm_config |= PM_LinkUp;
1319
1320         if (wolinfo->wolopts & WAKE_MAGIC)
1321                 pm_config |= PM_Magic;
1322
1323         // FIXME: Guessed
1324         if (wolinfo->wolopts & (WAKE_UCAST | WAKE_MCAST | WAKE_BCAST))
1325                 pm_config |= PM_WakeUp;
1326
1327         priv->pm_config = pm_config;
1328         iowrite32(pm_config, port_base + PMConfig);
1329         mmiowb();
1330
1331         spin_unlock_bh(&priv->lock);
1332
1333         return 0;
1334 }
1335
1336 static int sc92031_ethtool_nway_reset(struct net_device *dev)
1337 {
1338         int err = 0;
1339         struct sc92031_priv *priv = netdev_priv(dev);
1340         void __iomem *port_base = priv->port_base;
1341         u16 bmcr;
1342
1343         spin_lock_bh(&priv->lock);
1344
1345         bmcr = _sc92031_mii_read(port_base, MII_BMCR);
1346         if (!(bmcr & BMCR_ANENABLE)) {
1347                 err = -EINVAL;
1348                 goto out;
1349         }
1350
1351         _sc92031_mii_write(port_base, MII_BMCR, bmcr | BMCR_ANRESTART);
1352
1353 out:
1354         _sc92031_mii_scan(port_base);
1355         mmiowb();
1356
1357         spin_unlock_bh(&priv->lock);
1358
1359         return err;
1360 }
1361
1362 static const char sc92031_ethtool_stats_strings[SILAN_STATS_NUM][ETH_GSTRING_LEN] = {
1363         "tx_timeout",
1364         "rx_loss",
1365 };
1366
1367 static void sc92031_ethtool_get_strings(struct net_device *dev,
1368                 u32 stringset, u8 *data)
1369 {
1370         if (stringset == ETH_SS_STATS)
1371                 memcpy(data, sc92031_ethtool_stats_strings,
1372                                 SILAN_STATS_NUM * ETH_GSTRING_LEN);
1373 }
1374
1375 static int sc92031_ethtool_get_stats_count(struct net_device *dev)
1376 {
1377         return SILAN_STATS_NUM;
1378 }
1379
1380 static void sc92031_ethtool_get_ethtool_stats(struct net_device *dev,
1381                 struct ethtool_stats *stats, u64 *data)
1382 {
1383         struct sc92031_priv *priv = netdev_priv(dev);
1384
1385         spin_lock_bh(&priv->lock);
1386         data[0] = priv->tx_timeouts;
1387         data[1] = priv->rx_loss;
1388         spin_unlock_bh(&priv->lock);
1389 }
1390
1391 static struct ethtool_ops sc92031_ethtool_ops = {
1392         .get_settings           = sc92031_ethtool_get_settings,
1393         .set_settings           = sc92031_ethtool_set_settings,
1394         .get_drvinfo            = sc92031_ethtool_get_drvinfo,
1395         .get_wol                = sc92031_ethtool_get_wol,
1396         .set_wol                = sc92031_ethtool_set_wol,
1397         .nway_reset             = sc92031_ethtool_nway_reset,
1398         .get_link               = ethtool_op_get_link,
1399         .get_tx_csum            = ethtool_op_get_tx_csum,
1400         .get_sg                 = ethtool_op_get_sg,
1401         .get_tso                = ethtool_op_get_tso,
1402         .get_strings            = sc92031_ethtool_get_strings,
1403         .get_stats_count        = sc92031_ethtool_get_stats_count,
1404         .get_ethtool_stats      = sc92031_ethtool_get_ethtool_stats,
1405         .get_ufo                = ethtool_op_get_ufo,
1406 };
1407
1408 static int __devinit sc92031_probe(struct pci_dev *pdev,
1409                 const struct pci_device_id *id)
1410 {
1411         int err;
1412         void __iomem* port_base;
1413         struct net_device *dev;
1414         struct sc92031_priv *priv;
1415         u32 mac0, mac1;
1416
1417         err = pci_enable_device(pdev);
1418         if (unlikely(err < 0))
1419                 goto out_enable_device;
1420
1421         pci_set_master(pdev);
1422
1423         err = pci_set_dma_mask(pdev, DMA_32BIT_MASK);
1424         if (unlikely(err < 0))
1425                 goto out_set_dma_mask;
1426
1427         err = pci_set_consistent_dma_mask(pdev, DMA_32BIT_MASK);
1428         if (unlikely(err < 0))
1429                 goto out_set_dma_mask;
1430
1431         err = pci_request_regions(pdev, SC92031_NAME);
1432         if (unlikely(err < 0))
1433                 goto out_request_regions;
1434
1435         port_base = pci_iomap(pdev, SC92031_USE_BAR, 0);
1436         if (unlikely(!port_base)) {
1437                 err = -EIO;
1438                 goto out_iomap;
1439         }
1440
1441         dev = alloc_etherdev(sizeof(struct sc92031_priv));
1442         if (unlikely(!dev)) {
1443                 err = -ENOMEM;
1444                 goto out_alloc_etherdev;
1445         }
1446
1447         pci_set_drvdata(pdev, dev);
1448
1449 #if SC92031_USE_BAR == 0
1450         dev->mem_start = pci_resource_start(pdev, SC92031_USE_BAR);
1451         dev->mem_end = pci_resource_end(pdev, SC92031_USE_BAR);
1452 #elif SC92031_USE_BAR == 1
1453         dev->base_addr = pci_resource_start(pdev, SC92031_USE_BAR);
1454 #endif
1455         dev->irq = pdev->irq;
1456
1457         /* faked with skb_copy_and_csum_dev */
1458         dev->features = NETIF_F_SG | NETIF_F_HW_CSUM | NETIF_F_HIGHDMA;
1459
1460         dev->get_stats          = sc92031_get_stats;
1461         dev->ethtool_ops        = &sc92031_ethtool_ops;
1462         dev->hard_start_xmit    = sc92031_start_xmit;
1463         dev->watchdog_timeo     = TX_TIMEOUT;
1464         dev->open               = sc92031_open;
1465         dev->stop               = sc92031_stop;
1466         dev->set_multicast_list = sc92031_set_multicast_list;
1467         dev->tx_timeout         = sc92031_tx_timeout;
1468 #ifdef CONFIG_NET_POLL_CONTROLLER
1469         dev->poll_controller    = sc92031_poll_controller;
1470 #endif
1471
1472         priv = netdev_priv(dev);
1473         spin_lock_init(&priv->lock);
1474         priv->port_base = port_base;
1475         priv->pdev = pdev;
1476         tasklet_init(&priv->tasklet, sc92031_tasklet, (unsigned long)dev);
1477         /* Fudge tasklet count so the call to sc92031_enable_interrupts at
1478          * sc92031_open will work correctly */
1479         tasklet_disable_nosync(&priv->tasklet);
1480
1481         /* PCI PM Wakeup */
1482         iowrite32((~PM_LongWF & ~PM_LWPTN) | PM_Enable, port_base + PMConfig);
1483
1484         mac0 = ioread32(port_base + MAC0);
1485         mac1 = ioread32(port_base + MAC0 + 4);
1486         dev->dev_addr[0] = dev->perm_addr[0] = mac0 >> 24;
1487         dev->dev_addr[1] = dev->perm_addr[1] = mac0 >> 16;
1488         dev->dev_addr[2] = dev->perm_addr[2] = mac0 >> 8;
1489         dev->dev_addr[3] = dev->perm_addr[3] = mac0;
1490         dev->dev_addr[4] = dev->perm_addr[4] = mac1 >> 8;
1491         dev->dev_addr[5] = dev->perm_addr[5] = mac1;
1492
1493         err = register_netdev(dev);
1494         if (err < 0)
1495                 goto out_register_netdev;
1496
1497         return 0;
1498
1499 out_register_netdev:
1500         free_netdev(dev);
1501 out_alloc_etherdev:
1502         pci_iounmap(pdev, port_base);
1503 out_iomap:
1504         pci_release_regions(pdev);
1505 out_request_regions:
1506 out_set_dma_mask:
1507         pci_disable_device(pdev);
1508 out_enable_device:
1509         return err;
1510 }
1511
1512 static void __devexit sc92031_remove(struct pci_dev *pdev)
1513 {
1514         struct net_device *dev = pci_get_drvdata(pdev);
1515         struct sc92031_priv *priv = netdev_priv(dev);
1516         void __iomem* port_base = priv->port_base;
1517
1518         unregister_netdev(dev);
1519         free_netdev(dev);
1520         pci_iounmap(pdev, port_base);
1521         pci_release_regions(pdev);
1522         pci_disable_device(pdev);
1523 }
1524
1525 static int sc92031_suspend(struct pci_dev *pdev, pm_message_t state)
1526 {
1527         struct net_device *dev = pci_get_drvdata(pdev);
1528         struct sc92031_priv *priv = netdev_priv(dev);
1529
1530         pci_save_state(pdev);
1531
1532         if (!netif_running(dev))
1533                 goto out;
1534
1535         netif_device_detach(dev);
1536
1537         /* Disable interrupts, stop Tx and Rx. */
1538         sc92031_disable_interrupts(dev);
1539
1540         spin_lock_bh(&priv->lock);
1541
1542         _sc92031_disable_tx_rx(dev);
1543         _sc92031_tx_clear(dev);
1544         mmiowb();
1545
1546         spin_unlock_bh(&priv->lock);
1547
1548 out:
1549         pci_set_power_state(pdev, pci_choose_state(pdev, state));
1550
1551         return 0;
1552 }
1553
1554 static int sc92031_resume(struct pci_dev *pdev)
1555 {
1556         struct net_device *dev = pci_get_drvdata(pdev);
1557         struct sc92031_priv *priv = netdev_priv(dev);
1558
1559         pci_restore_state(pdev);
1560         pci_set_power_state(pdev, PCI_D0);
1561
1562         if (!netif_running(dev))
1563                 goto out;
1564
1565         /* Interrupts already disabled by sc92031_suspend */
1566         spin_lock_bh(&priv->lock);
1567
1568         _sc92031_reset(dev);
1569         mmiowb();
1570
1571         spin_unlock_bh(&priv->lock);
1572         sc92031_enable_interrupts(dev);
1573
1574         netif_device_attach(dev);
1575
1576         if (netif_carrier_ok(dev))
1577                 netif_wake_queue(dev);
1578         else
1579                 netif_tx_disable(dev);
1580
1581 out:
1582         return 0;
1583 }
1584
1585 static struct pci_device_id sc92031_pci_device_id_table[] __devinitdata = {
1586         { PCI_DEVICE(PCI_VENDOR_ID_SILAN, PCI_DEVICE_ID_SILAN_SC92031) },
1587         { PCI_DEVICE(PCI_VENDOR_ID_SILAN, PCI_DEVICE_ID_SILAN_8139D) },
1588         { 0, }
1589 };
1590 MODULE_DEVICE_TABLE(pci, sc92031_pci_device_id_table);
1591
1592 static struct pci_driver sc92031_pci_driver = {
1593         .name           = SC92031_NAME,
1594         .id_table       = sc92031_pci_device_id_table,
1595         .probe          = sc92031_probe,
1596         .remove         = __devexit_p(sc92031_remove),
1597         .suspend        = sc92031_suspend,
1598         .resume         = sc92031_resume,
1599 };
1600
1601 static int __init sc92031_init(void)
1602 {
1603         printk(KERN_INFO SC92031_DESCRIPTION " " SC92031_VERSION "\n");
1604         return pci_register_driver(&sc92031_pci_driver);
1605 }
1606
1607 static void __exit sc92031_exit(void)
1608 {
1609         pci_unregister_driver(&sc92031_pci_driver);
1610 }
1611
1612 module_init(sc92031_init);
1613 module_exit(sc92031_exit);
1614
1615 MODULE_LICENSE("GPL");
1616 MODULE_AUTHOR("Cesar Eduardo Barros <cesarb@cesarb.net>");
1617 MODULE_DESCRIPTION(SC92031_DESCRIPTION);
1618 MODULE_VERSION(SC92031_VERSION);