xconfig: Change the titlebar if using Qt3
[linux-2.6.git] / drivers / net / mace.h
1 /*
2  * mace.h - definitions for the registers in the Am79C940 MACE
3  * (Medium Access Control for Ethernet) controller.
4  *
5  * Copyright (C) 1996 Paul Mackerras.
6  *
7  * This program is free software; you can redistribute it and/or
8  * modify it under the terms of the GNU General Public License
9  * as published by the Free Software Foundation; either version
10  * 2 of the License, or (at your option) any later version.
11  */
12
13 #define REG(x)  volatile unsigned char x; char x ## _pad[15]
14
15 struct mace {
16         REG(rcvfifo);           /* receive FIFO */
17         REG(xmtfifo);           /* transmit FIFO */
18         REG(xmtfc);             /* transmit frame control */
19         REG(xmtfs);             /* transmit frame status */
20         REG(xmtrc);             /* transmit retry count */
21         REG(rcvfc);             /* receive frame control */
22         REG(rcvfs);             /* receive frame status (4 bytes) */
23         REG(fifofc);            /* FIFO frame count */
24         REG(ir);                /* interrupt register */
25         REG(imr);               /* interrupt mask register */
26         REG(pr);                /* poll register */
27         REG(biucc);             /* bus interface unit config control */
28         REG(fifocc);            /* FIFO configuration control */
29         REG(maccc);             /* medium access control config control */
30         REG(plscc);             /* phys layer signalling config control */
31         REG(phycc);             /* physical configuration control */
32         REG(chipid_lo);         /* chip ID, lsb */
33         REG(chipid_hi);         /* chip ID, msb */
34         REG(iac);               /* internal address config */
35         REG(reg19);
36         REG(ladrf);             /* logical address filter (8 bytes) */
37         REG(padr);              /* physical address (6 bytes) */
38         REG(reg22);
39         REG(reg23);
40         REG(mpc);               /* missed packet count (clears when read) */
41         REG(reg25);
42         REG(rntpc);             /* runt packet count (clears when read) */
43         REG(rcvcc);             /* recv collision count (clears when read) */
44         REG(reg28);
45         REG(utr);               /* user test reg */
46         REG(reg30);
47         REG(reg31);
48 };
49
50 /* Bits in XMTFC */
51 #define DRTRY           0x80    /* don't retry transmission after collision */
52 #define DXMTFCS         0x08    /* don't append FCS to transmitted frame */
53 #define AUTO_PAD_XMIT   0x01    /* auto-pad short packets on transmission */
54
55 /* Bits in XMTFS: only valid when XMTSV is set in PR and XMTFS */
56 #define XMTSV           0x80    /* transmit status (i.e. XMTFS) valid */
57 #define UFLO            0x40    /* underflow - xmit fifo ran dry */
58 #define LCOL            0x20    /* late collision (transmission aborted) */
59 #define MORE            0x10    /* 2 or more retries needed to xmit frame */
60 #define ONE             0x08    /* 1 retry needed to xmit frame */
61 #define DEFER           0x04    /* MACE had to defer xmission (enet busy) */
62 #define LCAR            0x02    /* loss of carrier (transmission aborted) */
63 #define RTRY            0x01    /* too many retries (transmission aborted) */
64
65 /* Bits in XMTRC: only valid when XMTSV is set in PR (and XMTFS) */
66 #define EXDEF           0x80    /* had to defer for excessive time */
67 #define RETRY_MASK      0x0f    /* number of retries (0 - 15) */
68
69 /* Bits in RCVFC */
70 #define LLRCV           0x08    /* low latency receive: early DMA request */
71 #define M_RBAR          0x04    /* sets function of EAM/R pin */
72 #define AUTO_STRIP_RCV  0x01    /* auto-strip short LLC frames on recv */
73
74 /*
75  * Bits in RCVFS.  After a frame is received, four bytes of status
76  * are automatically read from this register and appended to the frame
77  * data in memory.  These are:
78  * Byte 0 and 1: message byte count and frame status
79  * Byte 2: runt packet count
80  * Byte 3: receive collision count
81  */
82 #define RS_OFLO         0x8000  /* receive FIFO overflowed */
83 #define RS_CLSN         0x4000  /* received frame suffered (late) collision */
84 #define RS_FRAMERR      0x2000  /* framing error flag */
85 #define RS_FCSERR       0x1000  /* frame had FCS error */
86 #define RS_COUNT        0x0fff  /* mask for byte count field */
87
88 /* Bits (fields) in FIFOFC */
89 #define RCVFC_SH        4       /* receive frame count in FIFO */
90 #define RCVFC_MASK      0x0f
91 #define XMTFC_SH        0       /* transmit frame count in FIFO */
92 #define XMTFC_MASK      0x0f
93
94 /*
95  * Bits in IR and IMR.  The IR clears itself when read.
96  * Setting a bit in the IMR will disable the corresponding interrupt.
97  */
98 #define JABBER          0x80    /* jabber error - 10baseT xmission too long */
99 #define BABBLE          0x40    /* babble - xmitter xmitting for too long */
100 #define CERR            0x20    /* collision err - no SQE test (heartbeat) */
101 #define RCVCCO          0x10    /* RCVCC overflow */
102 #define RNTPCO          0x08    /* RNTPC overflow */
103 #define MPCO            0x04    /* MPC overflow */
104 #define RCVINT          0x02    /* receive interrupt */
105 #define XMTINT          0x01    /* transmitter interrupt */
106
107 /* Bits in PR */
108 #define XMTSV           0x80    /* XMTFS valid (same as in XMTFS) */
109 #define TDTREQ          0x40    /* set when xmit fifo is requesting data */
110 #define RDTREQ          0x20    /* set when recv fifo requests data xfer */
111
112 /* Bits in BIUCC */
113 #define BSWP            0x40    /* byte swap, i.e. big-endian bus */
114 #define XMTSP_4         0x00    /* start xmitting when 4 bytes in FIFO */
115 #define XMTSP_16        0x10    /* start xmitting when 16 bytes in FIFO */
116 #define XMTSP_64        0x20    /* start xmitting when 64 bytes in FIFO */
117 #define XMTSP_112       0x30    /* start xmitting when 112 bytes in FIFO */
118 #define SWRST           0x01    /* software reset */
119
120 /* Bits in FIFOCC */
121 #define XMTFW_8         0x00    /* xmit fifo watermark = 8 words free */
122 #define XMTFW_16        0x40    /*  16 words free */
123 #define XMTFW_32        0x80    /*  32 words free */
124 #define RCVFW_16        0x00    /* recv fifo watermark = 16 bytes avail */
125 #define RCVFW_32        0x10    /*  32 bytes avail */
126 #define RCVFW_64        0x20    /*  64 bytes avail */
127 #define XMTFWU          0x08    /* xmit fifo watermark update enable */
128 #define RCVFWU          0x04    /* recv fifo watermark update enable */
129 #define XMTBRST         0x02    /* enable transmit burst mode */
130 #define RCVBRST         0x01    /* enable receive burst mode */
131
132 /* Bits in MACCC */
133 #define PROM            0x80    /* promiscuous mode */
134 #define DXMT2PD         0x40    /* disable xmit two-part deferral algorithm */
135 #define EMBA            0x20    /* enable modified backoff algorithm */
136 #define DRCVPA          0x08    /* disable receiving physical address */
137 #define DRCVBC          0x04    /* disable receiving broadcasts */
138 #define ENXMT           0x02    /* enable transmitter */
139 #define ENRCV           0x01    /* enable receiver */
140
141 /* Bits in PLSCC */
142 #define XMTSEL          0x08    /* select DO+/DO- state when idle */
143 #define PORTSEL_AUI     0x00    /* select AUI port */
144 #define PORTSEL_10T     0x02    /* select 10Base-T port */
145 #define PORTSEL_DAI     0x04    /* select DAI port */
146 #define PORTSEL_GPSI    0x06    /* select GPSI port */
147 #define ENPLSIO         0x01    /* enable optional PLS I/O pins */
148
149 /* Bits in PHYCC */
150 #define LNKFL           0x80    /* reports 10Base-T link failure */
151 #define DLNKTST         0x40    /* disable 10Base-T link test */
152 #define REVPOL          0x20    /* 10Base-T receiver polarity reversed */
153 #define DAPC            0x10    /* disable auto receiver polarity correction */
154 #define LRT             0x08    /* low receive threshold for long links */
155 #define ASEL            0x04    /* auto-select AUI or 10Base-T port */
156 #define RWAKE           0x02    /* remote wake function */
157 #define AWAKE           0x01    /* auto wake function */
158
159 /* Bits in IAC */
160 #define ADDRCHG         0x80    /* request address change */
161 #define PHYADDR         0x04    /* access physical address */
162 #define LOGADDR         0x02    /* access multicast filter */
163
164 /* Bits in UTR */
165 #define RTRE            0x80    /* reserved test register enable. DON'T SET. */
166 #define RTRD            0x40    /* reserved test register disable.  Sticky */
167 #define RPAC            0x20    /* accept runt packets */
168 #define FCOLL           0x10    /* force collision */
169 #define RCVFCSE         0x08    /* receive FCS enable */
170 #define LOOP_NONE       0x00    /* no loopback */
171 #define LOOP_EXT        0x02    /* external loopback */
172 #define LOOP_INT        0x04    /* internal loopback, excludes MENDEC */
173 #define LOOP_MENDEC     0x06    /* internal loopback, includes MENDEC */